温补晶振 削峰正弦波输出怎么转换？

hao2012

请教熟悉晶振的大侠，在选 一种温补晶振FPGA 用，但是看到大部分输出格式都是削峰正弦波的，CMOS 的很少而且几乎都没货，想请都如果是削峰输出的要怎样才能转为FPGA可以直接用的？50M 左右的频率，谢谢~
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超級狗

hao2012 发表于 2017-3-4 15:50
3 j! K1 i! U/ L* q4 d/ E0 l# w7 i狗大，看了那个TI的clk buffer CDC3RL02，里面没有明确说两路输出没有相位差啊？这种结构的buffer都是同 ...

4 X& z' G4 ^' H6 e/ w是喔～你一開始也只問「温补晶振 削峰正弦波输出怎么转换」。
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% t% c1 l9 A& G* P; u' X: m無相位差只是供應商宣傳的手法啦！通常低於 ns 級以下（ps 級）的相位差，就會被宣稱為無相位差。

  ~( C9 a/ W2 y8 |我不知道樓主想做什麼應用，乾脆給你幾本寶典自已選好了！

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/ v% B* D) E8 w  f" c  y4 ^
9 l: Q: ?$ t8 c8 D3 k8 j. Q

超級狗

hao2012 发表于 2017-3-1 09:13
  A! X7 b& n4 _- H! Z4 C谢谢版主回答这么仔细。狗大还有一个问题：这些用反相器的电路不知道能不能引入误差啊？晶振本来稳定度很 ...

5 g" g1 \+ W! G# }- Z2 pCMOS 邏輯閘引入 Phase Noise 和 Jitter 應該是在所難免，用方案四吧！

# |( C' h( W- h( Y; v% ]至少他們有保障雞皮噎死（GPS）的應用無虞，這是 2.5ppm 以下的精準度。
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6 C7 C' F5 s$ O8 B3 ^# W
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hao2012

超級狗 发表于 2017-2-28 11:34
方法四︰
有一種叫 Clock Buffer 的哀西，這種哀西很多，Cypress 和 SiliconLabs 好像也有。

狗大，看了那个TI的clk buffer CDC3RL02，里面没有明确说两路输出没有相位差啊？这种结构的buffer都是同相位的吗？

超級狗

方法一：
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超級狗

方法二：

超級狗

方法三：
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超級狗

方法四︰
有一種叫 Clock Buffer 的哀西，這種哀西很多，Cypress 和 SiliconLabs 好像也有。

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超級狗

附帶說明：
5 v4 F5 I2 M5 I' g: `以上方案是某 TCXO 供應商，搭配賽靈思（Xilinx）所出版的應用指南（Application Note）。

3 X0 Z( M3 b  B: a7 O) x% Z2 }

超級狗

忘了提醒樓主！

74HC 系列的傳輸延遲（Propagation Delay）大概就在 25ns 上下，換句話說最大的工作頻率只有 40MHz 左右。所以如果要使用外部邏輯閘電路，最好選用 74AHC 系列。
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! F: ?- ^& E- g5 O, B

张湘岳

超級狗 发表于 2017-2-28 12:35
8 `( x9 a# C0 s; K1 ~  y5 l忘了提醒樓主！

74HC 系列的傳輸延遲（Propagation Delay）大概就在 25ns 上下，換句話說最大的工作頻率 ...

版主真乃高人,什么都能找到资料,有理有据

松哥无敌

版主真乃高人,什么都能找到资料,有理有据

hao2012

超級狗 发表于 2017-2-28 11:18
/ }( h, F6 g# r" B方法一：

: u+ I/ R9 n/ y. t& Z谢谢版主回答这么仔细。狗大还有一个问题：这些用反相器的电路不知道能不能引入误差啊？晶振本来稳定度很高都是1.5，2ppm，用这些反相器会不会使它稳定度变差啊？

超級狗

SEIKO/EPSON TCXO for Xilinx Stratum III

超級狗

Isotemp TCXO for Xilinx Stratum III
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超級狗

IDT Ultra Low Jitter Single-Ended Clock Buffer

看起來也不錯！
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( P& C. O' A% g: H8 B, d0 v- w

KERYHE

好东西，谢谢，学习了