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74AHC32 的逻辑图,最后加了两级的非?

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发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如下图.  为何, 74AHC32 的逻辑图的最后加了两个非。& A2 i: j, t5 R( f
1. 不加, 逻辑上也正确。( w+ _5 W# d5 A
2. 为了增加延迟吗?
: A3 e1 w6 Q& H" o0 g7 Q* W3. 还是为了驱动TTL?
# {/ R3 ~5 ]- b: q
6 r3 |; X! q6 u/ O谢谢!

OR.png (11.62 KB, 下载次数: 0)

OR logic Diag

OR logic  Diag

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支持!: 5
可以送我 2TB 的硬盤嗎?^_^  发表于 2016-8-30 11:19
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发表于 2016-8-29 22:42 | 只看该作者
打完收工!
  f& ]% e+ u9 a, s( ?" J1 p4 @+ \; n7 a) s
" G8 a( ?5 A; B* v# o( }

Buffered and Unbuffered CD4001B.jpg (28.67 KB, 下载次数: 0)

Buffered and Unbuffered CD4001B.jpg

Comparison of Buffered and Unbuffered Logic Gate.jpg (60.33 KB, 下载次数: 0)

Comparison of Buffered and Unbuffered Logic Gate.jpg

Application of Buffered and Unbuffered Logic Gate.jpg (83.46 KB, 下载次数: 0)

Application of Buffered and Unbuffered Logic Gate.jpg

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狗然是老司机啊!  发表于 2016-8-30 11:20
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支持 ! 讚 !  发表于 2016-8-29 22:46
哈士奇是一種連主人都咬的爛狗!

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发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰5 G' P& v1 n: e# ?8 g/ G$ s4 ]
讚 !

) u% ]% V8 h# y1 d7 l
/ c8 l/ d% H' O! g' B+ a2 r/ V1 _8 x' l看!  L5 d. T4 c5 b0 A2 O, Y- x  P
$ k) @1 `: R  a) V0 S( F

' T' O! ~9 ~8 f5 A5 e/ a- `$ ^$ w1 _1 w2 t/ S7 s" p( L/ u2 S
沒有啦!我是叫大家看內容。
4 j& U' V& Q6 a$ e8 d' q  o7 h- M8 w, d) X8 i6 A* ]& L

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也對! 要用力看,努力看,好好看! ^_^  发表于 2016-8-31 07:49
哈士奇是一種連主人都咬的爛狗!

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发表于 2016-9-15 22:55 来自手机 | 只看该作者
mark

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发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片,比楼主的问题亮得多。个人认为是同步时序。

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发表于 2016-9-26 09:19 | 只看该作者
学习了~
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