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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准
8 x2 Q+ `' E3 k, x8 y! G2 A+ B  j& |- C哪位大师可以给参考资料. d. }5 V5 |- U! ^% }
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发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:023 e( p) Q, U1 x- j. M$ P, z+ M
我公司的某PCBA 发到 I....公司做测试。9 _. Y4 W6 p+ r/ z6 ^, S% _3 [" ^+ g
他们反馈的信息是.   ~" D# W+ V* S
--Find a problem during return loss tes ...
6 r' m3 z  w& _( W* G  N
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?* E( l4 V$ }1 U' K: `  s3 ?
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。) U/ S8 ?$ x! M1 P& A1 e: T

2 `( W' Q' B0 `/ w( M5 B9 J- {1 S6 o2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
* z  T# o# N) F) _% F- SRL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。7 Q' Z2 _4 M% i7 h' F

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发表于 2014-11-22 09:36 | 只看该作者
先参考协议
, J5 L# V- P1 U3 @. |- {再根据走线长度来定,关键还是接收端可接受level
新年伊始,稳中求胜

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 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36: g5 O* Y+ w4 G4 h) C
先参考协议
$ r/ E4 r4 S, y$ C再根据走线长度来定,关键还是接收端可接受level
# F: D* }* a  `! H+ e
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:08, Z9 V4 w- J" h
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
  `/ {$ q8 e  l6 B1 T1 {/ c  N
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。! g8 e0 o/ a8 ]) n! `2 j8 [- C

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那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
9 R! X. E% Y. l. Q5 W9 z因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
. G. h  A. i* w: |
我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况
5 e# h  A) g7 Z# V

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发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:03
) Z7 N# N2 L" v9 }  d: a" u3 |因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...

; |. j+ e. N; p( }% _! j% @! f那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
+ l6 L' }; F7 N2 v) }( J. d  `

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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964008794 发表于 2015-10-31 23:36
! z" m+ j  r  M3 U$ ^: t7 y那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
3 x! j  t% Z+ a2 h& n9 p
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32! t  d- x* |9 p4 l1 Z, C( i
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...
. F8 g& j* [- g1 ~! \: H! O8 @
我公司的某PCBA 发到 I....公司做测试。0 K: q8 d2 ^; ]- w5 S  l
他们反馈的信息是. # S  G# l! }/ [5 Q3 O
--Find a problem during return loss test on T..3 connectors.
9 w. a" \+ u1 g9 o  }6 \1 n3 @% g  V  j* i此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。
+ L2 o8 r* G% c& v我的问题是:( |! t) W  _/ z" O) y9 N
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?
. Q1 n  Y( V8 m* t. t2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!5 r1 Q4 S4 ^+ `7 r7 `. R* x
/ A: P  {9 _- R/ f0 a( \

0 e; u0 c8 X; X; P& |9 U: x+ \$ o/ E- f0 x, n

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10
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