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ARM+DDR六层PCB,附件是原图,请高手前来指点!!

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发表于 2014-8-2 22:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 - G3 v3 Q/ H/ Y% g6 i/ s

6 W: j: V, [; ?' Z- B* [描述:
* D4 \& e7 j+ H        1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。
$ E! G) z- `) z        2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
% q. ~9 r9 y# V1 i, f& P        3、时钟线从TOP换到Mid1,阻抗100欧。; ~; ?3 l1 ]7 k% J
        4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。
. Z/ J2 \" `( N  d- f        5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。
# J) j0 U6 j6 m- Y. ^$ ], t        6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。
- m6 ?' G3 Z7 \' m7 m- s        7、所用软件,Altium Designer 10.0
8 ]) ]9 e* q- U
% f4 ?! j) ^" i8 n, g! y
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?  R) [- X' A$ U
, e' W( A& z# R
! e1 l3 h. T& [1 \
热烈欢迎各路高手前来指导!谢谢!!!

DDR_XXX.zip

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 楼主| 发表于 2014-8-18 21:40 | 只看该作者
本帖最后由 w5555456 于 2014-8-18 21:42 编辑 2 x4 P( C$ c' G
kangguolong 发表于 2014-8-18 16:48' a0 ?. g5 [" Z$ _( D, Q
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需 ...
8 A5 z! Z4 C! w/ B. i9 l
5 k8 _* {8 ^% L% |- N
非常感谢这位兄台的点评!0 j* \5 E0 `+ a4 Y
1、盲埋孔已经去掉了,直接6层的通孔,勉强画出来了,不过电源走的不大好(用盲孔的话总成本会增加大概60%的样子,而且制作难度大了很多)。# K0 D' ?0 E! c+ W
2、差分时钟线绕成了下图所示:  a2 I+ |5 f9 q' \8 z" q( d
1 }) C' `5 |- ^3 r2 D: p5 l9 j
3、差分阻抗控制100欧左右,3.5/9.5mil。据我的了解,差分对紧密耦合是为了提高抗干扰能力,如果太过紧密,两根线之间的相互耦合会对信号边沿产生影响,所以选了这个间距。某些芯片厂商的Layout Guide也建议间距不要过小。% i& h2 I3 F3 W# G1 h
4、数据线我基本都走在了Midlayer1,我用的1W原则,3W空间不够。( D: o, S/ K) _/ Z& e
4 F8 a2 o1 t0 z! ?/ {& d

% T6 h! @; M* M8 v0 ~4 B# y2 m
- P% }. N: g& W1 t
+ o. G, [0 q$ O! y5 X6 }: l
. @; \" J- M" T/ h3 D: |

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 楼主| 发表于 2014-8-18 21:24 | 只看该作者
本帖最后由 w5555456 于 2014-8-19 21:45 编辑
7 L6 _  v0 K; D3 `# D2 R
zgq800712 发表于 2014-8-17 11:16% z/ m  V+ u& z! @
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm
4 g9 J! F3 m, o: a0 U8 G3 ~6 p+ V) p' G1 p8 x0 y
这个板子要什么工艺?打样贵吗?
" z+ u3 g5 e$ ]: w. g" Y
3 D& B! N8 Z; O( ]4 ]* X
一般的工艺就能做出来,6mil的孔是可以不用激光打的。! i$ @  g7 {) _+ T9 ]/ A8 O
今天刚投的板,大概240*180的板子,六层,打样3000左右,五块。! b2 n3 u% @) t* P* ~
在深圳迅捷兴做的,有需要我给你他们销售的联系方式。

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发表于 2014-8-18 16:48 | 只看该作者
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需要调整,不知道差分有没有做阻抗控制,差分线间距过大!另外数据线每一组走线应该遵循同组同层的走法,线 与 线的部分区域间距还是不够3W!还有一些其它的小问题,还需优化。

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 楼主| 发表于 2014-8-4 21:24 | 只看该作者
帖子都好几天了,各路好汉都去哪了???:Q:Q

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发表于 2014-8-5 13:19 | 只看该作者
打开了,看不到东西
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 楼主| 发表于 2014-8-5 21:52 | 只看该作者
zgq800712 发表于 2014-8-5 13:19; t# z& ~" G# u3 Y
打开了,看不到东西
: j& m) b0 I" F; l8 r% P: Y
我的软件版本是AD10.0,应该09及以上的打开都没有问题。2 o. ]1 K8 x6 M; I7 i5 e) d
试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-5 23:36 | 只看该作者
多AD14了
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发表于 2014-8-6 08:46 | 只看该作者
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

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 楼主| 发表于 2014-8-7 22:50 | 只看该作者
沙漠风铃 发表于 2014-8-6 08:469 ?9 F) p# o9 U
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁
! b( c) Y+ ^8 x& q0 `5 @+ O3 N' i- n
呃,,多谢这位仁兄!  ~# `/ W& r# X6 q8 n! }
话说我这板子有没有致命的地方?或者亟需改进的?

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发表于 2014-8-11 22:01 | 只看该作者
打开了,看不到东西

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 楼主| 发表于 2014-8-12 23:23 | 只看该作者
ROBERTZHANG 发表于 2014-8-11 22:01
0 v9 d/ b" M% ^; D/ D6 d打开了,看不到东西
7 v( h+ G0 h/ k/ j
我的软件版本是AD10.0
: ]: D4 Q2 Y8 T试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-17 11:16 | 只看该作者
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm* b: V7 p1 W- g& I, ~9 o: g

- i' ~. ^9 }9 e8 W0 A4 h这个板子要什么工艺?打样贵吗?
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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发表于 2014-8-17 21:35 | 只看该作者
AD的文件就不去看了

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发表于 2014-8-18 09:28 | 只看该作者
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

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 楼主| 发表于 2014-8-18 21:26 | 只看该作者
hb_ben 发表于 2014-8-18 09:283 K8 m5 H- q+ Q% I* g4 P
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多
2 T, m$ r* r# X1 i4 u/ z4 H
没办法啊,BGA下面的焊盘间距20mil,焊盘占掉了10mil........
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