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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 - G3 v3 Q/ H/ Y% g6 i/ s
6 W: j: V, [; ?' Z- B* [描述:
* D4 \& e7 j+ H 1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。
$ E! G) z- `) z 2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
% q. ~9 r9 y# V1 i, f& P 3、时钟线从TOP换到Mid1,阻抗100欧。; ~; ?3 l1 ]7 k% J
4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。
. Z/ J2 \" `( N d- f 5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。
# J) j0 U6 j6 m- Y. ^$ ], t 6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。
- m6 ?' G3 Z7 \' m7 m- s 7、所用软件,Altium Designer 10.08 ]) ]9 e* q- U
% f4 ?! j) ^" i8 n, g! y
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施? R) [- X' A$ U
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