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allegro规则管理器求解

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发表于 2013-10-18 19:18 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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allegro规则管理器中greate class ,greate match group ,greate net group之间的区别是什么,用法怎样?谢谢
/ J4 c7 ?: Q, Y. {! b7 J  }. v
0 ], O1 H8 m% t/ `* V1 k7 Y3 x2 t( r+ A: Q  A9 i

! @- M$ O4 w# ^3 M6 w- ]* n' K# h

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发表于 2013-10-22 00:27 | 只看该作者
molin 发表于 2013-10-20 23:04
+ \3 \9 a3 M3 N& a0 I8 m$ \1 Q2 rEdit Properities 裡面怎样设定BUS。还有great class,great NET group,great match group,这三个的区别是 ...

& B# y" V- R# T1 y1 wCreat Bus 的操作就是用 edit / properties 去點選要設為某一個 Bus 的 Net , 賦予 Bus Name 即可.) c. _( ]5 y/ G! k
至於 Class 的目的在於處理不同 Spacing Constraint 遭遇到時 , 通常是看誰的 Spacing值比較大 , 已大的為準, 但若是想要使用第三種 Spacing條件時才會將這兩組 Net 或 Bus 升格成 Class 來處理
" t' }! t/ E( o( q; X3 m% [至於 Group 和 match group 通常是用在高速訊號的等長比對的 Constraint 設定

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 楼主| 发表于 2013-10-22 09:35 | 只看该作者
本帖最后由 molin 于 2013-10-22 10:50 编辑 ) |1 o$ S  `9 M  w/ \5 Z
procomm1722 发表于 2013-10-22 00:27' P# w: c0 d2 p) ~- k
Creat Bus 的操作就是用 edit / properties 去點選要設為某一個 Bus 的 Net , 賦予 Bus Name 即可.
* {( o2 r8 F8 h6 _3 Q* [至於 ...
/ y( }# W* h3 Y

9 n# Q' P5 J" \谢谢解答 ,还是有些不明,我现在是这样的:
( ~; a4 Z4 c: T. z& \: S9 F* p/ C; b7 ?+ \& V; I% j7 M: q8 m

1 A4 X  i6 u3 |. r; {. G; E" V+ w
, g  y$ m  f. z: B8 x4 Q$ q我要U1的pin1到U2的PIN1和U1的PIN1到U3的PIN1等长,因有电阻端接,我先设XNET等长,然后到sigxplorer设置T形拓扑,这时T形等长的t1和t2合成设置为一个一个class ,不是设成一个BUS,这样做U1的pin1到U2的PIN1和U1的PIN1到U3的PIN1能等长吗!!!9 t5 l# ?" c7 {0 L, U& Y$ y4 H
7 I& g) l% s( b- ^+ t
* u5 k+ z9 q8 B
因为我在waring菜单下设置T形拓扑,创建一组规则只有class 和NET group,我用NET group创建为一组,然后到sigxplorer,出现错误,也不知是那里错了??
3 Y& H; z7 c0 I* _% g: V! `' R, L( [
6 |* t% I7 d; p
% D% m8 y8 z. P6 i
2 e" d& ~* l2 p. Q! {7 J! W/ [: g/ g: n5 a9 m
但如果用创建为class,就是可以进入 sigxplorer,
$ N# n+ ~& r3 L
9 x' {. x- f. j

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发表于 2013-10-24 18:52 | 只看该作者
這個倒是不一定 .
; j7 \7 z, y  n$ \, D9 o假定只有這個 Net 內部要等長的話 , 可以有幾種考慮( l  A0 C) o, W' y
1. 沒有 Xnet 時 , 你只要考慮 T , U2.1 和 T, U3.1 的 Pin pair 等長即可 , 因為T 到 R , R 到 u1.1 是共用的 , 因此若只是考慮等長而沒有考慮實踐的長度時 , 這樣就夠了( 使用 reletive paragation delay , delta=0 , tol . 看你的規範來設定 ).
3 I  O( P# s! y* ^2. 有Xnet 時 , 直接考慮 U1.1 , u2.1 和 u1.1 , U3.1 的  Pin pair 等長即可( 使用 reletive paragation delay ).: T! M( h( R: _* `  N7 c
3. 若有指定真實的長度限制 , 則是使用 Min/Max paragation delay 來對各個 Pin pair 進行 min/ max 的長度限制 , 此時考慮的的 pin pair 會是 U1.1 , u2.1 及  U1.1 , U3.1 或是 U1.1 ,T , 一個長度限制 , T , U2.1 和  T,U3.1 一種長度限制..../ X2 {9 K- z% [: x" e6 K

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发表于 2017-9-18 13:50 | 只看该作者

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发表于 2013-10-25 21:56 | 只看该作者
yes) N2 \# m: z9 }8 G% x

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 楼主| 发表于 2013-10-25 18:38 | 只看该作者
procomm1722 发表于 2013-10-25 18:178 n# N% Z- Y, l% ?0 U; C
參考這份文件好了

5 O: `( T/ T# F7 r谢谢,大哥 ,从CM管理 器中打开SigXplorer 的默认版本XL的吗!!!

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发表于 2013-10-25 18:17 | 只看该作者
參考這份文件好了

Create_Xnet_v165.pdf

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 楼主| 发表于 2013-10-25 17:34 | 只看该作者
procomm1722 发表于 2013-10-25 09:21
8 ?+ g; T: d5 N$ B6 xYes , 因為你的計算的基點就是 T 點
  C6 p6 P6 o2 u
!!感谢大哥一直的帮助解答!!
% v4 A0 ~; O3 b$ _4 p& b$ w; P! N0 K
这回有出问题了:如图 ,图中数字 是操作步骤7 P1 i; k" `: B, z& x" R4 K) q8 c
) x) q# `: d0 I
% e/ o( x& u% O  l/ i0 F
$ G, `7 Q! ^7 I& @3 O- \1 l

& V" Y- r% Y  P5 b: w请问大哥 怎样解决,拓扑已设置好,现在是要进sigXployer中设置等长,进不了,提示这个东西???

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发表于 2013-10-25 09:21 | 只看该作者
Yes , 因為你的計算的基點就是 T 點

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 楼主| 发表于 2013-10-24 19:48 | 只看该作者
procomm1722 发表于 2013-10-24 18:52
, U$ f9 f2 Y) ?# z8 S5 ]: e這個倒是不一定 .* {- s6 @6 ~0 e, A7 s' |. g9 o
假定只有這個 Net 內部要等長的話 , 可以有幾種考慮
$ ^" V5 `: L6 H# f8 {7 C6 U1. 沒有 Xnet 時 , 你只要考慮 T , ...

9 h3 b) }. Y! H- _. v7 o1 v" w; K谢谢解答 ,还有一个问题,假如在t1和t2等长,在走线时的连接点是不是一定要在设置的T形点标识那里,结点和标识点重叠才等长的!!!

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 楼主| 发表于 2013-10-24 17:39 | 只看该作者
本帖最后由 molin 于 2013-10-24 17:42 编辑
" g  i; @& n# S4 ]' I' M
procomm1722 发表于 2013-10-24 14:36( w7 _' V( M+ z  S
有時候覺得很囉嗦就懶得寫了

. `9 |8 I9 b& t6 |3 @5 t) F4 X' r" x
出现起来找也麻烦 哦,上面的问题没解答:U1到U2和U1到U3的网络这二个要等长,是不是要Xent1=xent2,t1=t2就可以了+ K5 @' i# ^; ]& O; r

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发表于 2013-10-24 14:36 | 只看该作者
有時候覺得很囉嗦就懶得寫了

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 楼主| 发表于 2013-10-24 14:02 | 只看该作者
procomm1722 发表于 2013-10-23 16:21
/ [( {$ A3 R7 v8 s, R這份文件是我寫的 ,給大家參考吧!
/ @! I' n6 f6 w其中要注意 Xnet  的問題 , 很多人都是直接由 Net  來提取Topology .
' s! R& W8 w+ e1 G6 Z1 l, c ...
7 U  b" M  L; X5 Y0 s2 k: M
大哥 ,谢谢分享,能不能把環境設置問題也写一个文档,不知道怎样操作好哦!!!!

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发表于 2013-10-23 16:21 | 只看该作者
這份文件是我寫的 ,給大家參考吧!
, m) V+ X4 Z' Y其中要注意 Xnet  的問題 , 很多人都是直接由 Net  來提取Topology .
5 N7 F& o( K' R) _% f但是遇到 Xnet 情況時必須注意環境設置問題 ( Setup Advisor , V16.5 以後改由 Setup / SI design setup 來設定 )* Y) H2 l, u) N; |. b
沒有把 DC net 搞定 , 可能提取出來的 Xnet 會有問題.

Allegro SPB SI 等長設定方式.pdf

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 楼主| 发表于 2013-10-22 21:06 | 只看该作者
我只装了16.6,所以不一样!!!

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 楼主| 发表于 2013-10-22 21:00 | 只看该作者
我是看了于博士的视频 里,做得,它里面是用BUS做,
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