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VERIBEST 就是现在的WG,呵呵。 ALLEGRO VS VERIBEST
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* [6 v: c, O0 h4 P* t9 `- @4 A |
+ n9 X, a5 y5 j2 E% H8 y2 A9 a3 W* n ?0 G# G1 v, A
长度匹配的布线实现: Allegro―〉手工的方法;Veribest―〉成批量地自动完成(可以将设计时间从2周或更长到缩短几个小时)
. z1 B; N0 W+ X8 e多线并行布线: Allegro―〉一次只能完成一根线;Veribest―〉一次可以多根线并能自动调整,打过孔等等(可得益10倍以上的设计效率的提高)
% g- s, ?- x) q% ^) ^4 @动态推挤(调线): Allegro―〉有限的能力(比如出现毛刺);Veribest―〉 随意推挤没有毛刺(5倍以上的效率提高)
* g! n5 h/ @: A- v差分对布线: Allegro―〉 无 ;Veribest―〉可自动差分布线(手工布线下10倍以上的效率提高)
+ y: B4 `4 P9 x; X" P: {" x1 a& k: w无限次的Undo和Redo Allegro: Allegro―〉无Veribest―〉可缩短总设计时间的10%
4 h& C0 g6 A' o* a" }! X5 }1 g集成的库管理: Allegro―〉功能有限;Veribest―〉需很少的数据切换
* A- ~0 l# V% J6 \原理图和PCB的集成: Allegro―〉基于网表的;Veribest―〉无缝集成(更出色的ECO和BOM,100倍的设计改进) # G% q4 K( V- q4 l" w
中文输入: Allegro―〉不支持;Veribest―〉原理图中输入中文,PCB任意位置任意层输入中文,支持全部字体 A( k+ \! B! P; S% Z
使用Veribest的酷功能 " F. e( O; _. A/ s$ m2 z/ [) b% w
1. 差分对/多线布线
4 j8 s2 |9 Q+ V6 D2. 高速网线的动态调整(比如可以调整或推挤蛇形线,而蛇形线的形状和长度可以动态的保持不变)
2 J* Q) t. }- L/ t* R. c$ r3. 可以敷铜区中进行布局布线,并可以在已敷铜区域内推挤布线、过孔,移动器件
$ k) v$ g$ p5 h2 L9 `8 D4. 在一个集成环境下的单一layout设计系统(交互布线与自动布线统一环境)
+ l" S# u# U$ F# A8 u5 W) h5. 基于形状的交互布线和自动布线
: L* B2 k! Q5 F) O% y6. 动态改变线宽和过孔大小的规则区域定义;
/ r5 p/ a5 e, X, k7. 能将电路从一边推挤到另一边 5 J% T" a* R8 ?" Z" b( X" ~. k( \
8. 能将过孔合并到其他过孔和引脚;
* x2 E( ^$ B% R O* q9. 敷铜区易于编辑、拷贝和移动; % y; U) v' ?# X. g6 ?9 V
10. 器件在动态敷铜区的移动; 0 R; V7 B. _3 S/ K1 P
11. 提供BGA扇出模板; * h9 w* w# c @0 C
12. 可以显示引脚号; ( H. D% X- W. d6 S9 f
13. 动态“冒险”显示; * J+ H* m- ]6 W8 z
14. 动态曲线调整(高速约束线); ) l# A: G5 @& D4 `( z7 \9 `
15. 钻孔显示;
4 H9 O" p& o# j% g' G5 G0 c16. 多线布线和多线自动连接;
7 ^1 W/ A# I8 G17. 选择能力(特别是被选中的网线固定); ! K+ j* K) B* C0 V @) h
18. 差分对自动调整;
: A! N2 c- e# L) s% I6 x19. 动态自动调整;
3 G- ^. D z' w K X20. 按网线/错误着色;
2 R2 k6 f% B, [4 ~% G, S5 r x21. 自动的热焊盘旋转; 5 B$ u) q" |6 ~# P( p
22. 丝印字编辑;
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