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敢问各位大侠，小弟近日使用Capture CIS进行原理图设计，完成后输出网表，并想通过Allegro进行PCB设计。但( X2 r; ^9 _. |* Y( y' A
Allegro输入网表后，出错，显示如下：: Z" z" s" r. W/ T2 z" u9 R' ^
Problems with device 'MC74LCX125_0_14PIN, TSSOP_IC_MC'. JEDEC_TYPE property '14PIN, TSSOP' is illegal: ( a& g0 X- L. b1 E1 n
'Package name has invalid characters or is too long.'.Device 'MC74LCX125_0_14PIN, TSSOP_IC_MC' has
7 @3 \2 |5 n! o% _3 y! _9 alibrary errors. Unable to transfer to Allegro.
( j2 j+ j" P" I# J0 u! U所以有以下几个问题：/ w* b8 S9 U* j: A# m) I- C& }
1) 如何解决以上问题，是CAPTURE CIS里定义的封装和 ALLEGRO所提供的封装不符吗？
2 H! M5 v q$ ? H, ?9 _/ u& L) r2）Capture CIS生成的元件库，在Allegro导入网表后会自动将Capture CIS元件库里的元件转换成可以在Allegro里摆/ l& @* F- O, P+ w' v" I# f
放的元件吗？
& `/ o( w) z) _' V) i/ u3）Allegro里提供的“Part developer”工具也会生成原理图里元件封装，与Capture CIS生成的元件库有什么关系？$ f' `% D' _8 L( Y6 H! x) y
4）Allegro里提供的“Part developer”生成的库是否能用到Capture CIS的设计中？
+ ]2 k6 ]5 w: K x/ I I! Q" `1 \# a5）Capture CIS里摆放库里的元件有两种方法：“Place Database Part”，快捷键“Z”与“Part。。。。”，快捷键2 E% N+ t2 R' A* t( r
“P”有什么联系和区别呢：
: u/ }1 ^# e; k* W& |. {& q烦请大哥大姐帮我解决此问题，感激不尽。 |
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发表于 2008-4-17 16:11
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发表于 2008-4-17 17:20