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如何把两个不同的网络用铜皮连接起来?

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发表于 2018-5-2 23:10 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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如题所示,allegro是否有PADS的copper bridge功能,可用一铜皮把连个不同的网络连接起来,DRC时不报警。( n" U9 Z- M8 p& k# E5 c. J
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发表于 2018-5-7 14:13 | 只看该作者
打过孔,
  d* Y. A/ F' d# U* e5 [/ q. R: A6 r  k8 L, ~

! ^, L' V6 a( X1 N( c
$ M+ f8 j, y5 P# J* `& D& p) m/ ~( ?0 I
深圳市惠达康科技有限公司' ^/ W: a8 m" O5 i
PCB层次:2-40层
' ?" L8 O1 n9 O% h产品类型:PCB,FPC, R&F PCB.
9 f8 L4 x: Z) n- A" }- e; B  Y最大尺寸:双面1200mm*1500mm 、 多层1000mm*1200mm
* A) ^( Y/ `" r" |$ p按材质分:FR4、铝基板、铜基板、陶瓷板、无卤素、高Tg、高频板(Arlon、Taconic、Rogers、Isola)5 e, q8 T1 n. p9 ?" m4 }) f% b; h: ?
表面处理:OSP、喷锡、沉金、沉银、沉锡、镍钯金、厚金板(最大金厚40U")6 B, ]3 x( f- f4 R
制程能力:线宽线距3mil、激光孔0.075mm、机械孔0.15mm
  e; ^. t2 V3 y3 @! Q; C铜    厚:1/3OZ--28OZ8 O* j5 H& [  Q( G, ~- [5 w
杨先生竭诚为您服务! 13316575121(微信同号)   sales007@witgain.com
) p( c5 e( d$ z

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发表于 2018-5-4 09:10 | 只看该作者
tangqianfeng 发表于 2018-5-3 19:20
& Z, A5 b2 C) ~( ?& u: k0 U7 N9 f3 ^* ?+ nnet_short属性只有pad 或via有

- m" S0 |) E1 y! q, M我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让

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使用静态铜皮,就不会避让了  详情 回复 发表于 2018-6-21 00:06

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发表于 2018-6-21 00:06 | 只看该作者
王开鑫55 发表于 2018-5-4 09:10
" k2 h- ?) b7 S9 i4 X* x' l+ |我给一个pin via都定义  net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让
, C' `: O8 y) }7 P5 \# T6 e
使用静态铜皮,就不会避让了
! C1 i4 P. q' W( Z9 j
3 S& R, F0 g/ r3 D3 h

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发表于 2018-5-15 16:12 | 只看该作者
应该没有,短路肯定会报DRC的,DRC隐藏即可,

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 楼主| 发表于 2018-5-12 21:06 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:14
- m0 j) \% L# O5 |有的,要给他们定义net_short属性

( N6 Q2 R! O" Q! R5 Y定义了net_short属性后,还是不能用连线或shape把不同网络连接起来。
  b% |! Z' b6 B; _

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 楼主| 发表于 2018-5-12 21:04 | 只看该作者
superlish 发表于 2018-5-7 11:17
5 `. \+ ~, M5 P4 W" \: B6 A0 e5 X% M/ ^可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上

* I6 p5 z* q" X! h- {8 t3 h已经使用此方法,但是感觉不完美。

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发表于 2018-5-7 11:17 | 只看该作者
可以把铜皮画在其它层,出光绘时注意要把这个铜的层加上
7 R" `( {+ ]% S5 }- o* h9 u! u3 q% G7 a$ ^" G9 @5 z; R

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已经使用此方法,但是感觉不完美。  详情 回复 发表于 2018-5-12 21:04

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发表于 2018-5-4 09:12 | 只看该作者
myexpma 发表于 2018-5-3 23:529 R; {2 p" Q# i4 E
pads就有此功能。

/ |) b' y. }5 q我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。& r0 `. R( E* d7 m+ {3 n6 S# y

( r$ a/ [% t7 H* U5 `1 p) n

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 楼主| 发表于 2018-5-3 23:52 | 只看该作者
利涉大川 发表于 2018-5-3 10:54) Z: G" y7 M6 c: V1 r
两个不同的网络连在一起,不报错,怎么可能呢。

) X* D( G: h  m1 U& d: T0 {pads就有此功能。
8 G* _' R) A7 j  Z6 ]4 h  i

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我感觉应该是隐藏了DRC,你要是用CAM350去跑开短路都跑不出来的话,那这个功能就会出大问题的。  详情 回复 发表于 2018-5-4 09:12

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发表于 2018-5-3 19:20 来自手机 | 只看该作者
王开鑫55 发表于 2018-5-3 09:19
+ V0 t6 g" `% W# Wallegro中  edit  properties没有找到net_short属性??

5 }; o9 `1 l. |net_short属性只有pad 或via有
0 W+ u6 h! I+ m3 J

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我给一个pin via都定义 net_short属性,但是用cline线连接的时候,会排斥,铜皮会避让  详情 回复 发表于 2018-5-4 09:10

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发表于 2018-5-3 10:54 | 只看该作者
两个不同的网络连在一起,不报错,怎么可能呢。

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pads就有此功能。  详情 回复 发表于 2018-5-3 23:52

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发表于 2018-5-3 10:03 | 只看该作者
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发表于 2018-5-3 09:19 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:14* e3 C, v4 K4 \5 r  m  j2 S
有的,要给他们定义net_short属性

! \1 v7 \/ {/ `allegro中  edit  properties没有找到net_short属性??& o/ S  O% U! u$ ]$ \

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net_short属性只有pad 或via有  详情 回复 发表于 2018-5-3 19:20

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发表于 2018-5-3 08:58 | 只看该作者
tangqianfeng 发表于 2018-5-3 07:140 o) @, Q, G6 U$ _
有的,要给他们定义net_short属性
* Y, i  h# v! b4 z9 n
这个办法好/ [0 N5 U( p0 f: s7 t' y5 Z( {' b
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