导入新网表后差分对变了

Lora · 发表于 2016-12-19 16:15

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本帖最后由 Lora 于 2016-12-19 16:25 编辑

原理图就改了两个pin的引脚定义，PCB editor 中导入新网表后，规则里设置的差分对有些变了，是什么原因，有没有遇到的同志，怎么解决

zuoanwind · 发表于 2016-12-23 11:19

xxlljj 发表于 2016-12-22 11:33
# P1 X; p# h' `8 o5 s; g) x记得PCB里的约束条件是可以导出的，你试试先导出再导入呢

这个好

Lora · 发表于 2016-12-23 09:47

xxlljj 发表于 2016-12-22 11:33( g$ q) y# d) ?' O6 E! D8 l V; h
记得PCB里的约束条件是可以导出的，你试试先导出再导入呢

试了下，真的可以，感谢感谢

xxlljj · 发表于 2016-12-22 11:33

记得PCB里的约束条件是可以导出的，你试试先导出再导入呢

980155498cai · 发表于 2016-12-20 15:52

Lora 发表于 2016-12-20 13:21
3 \5 x9 n$ n8 ^( ?" ^+ j% r试了也不行

啊，不会吧

Lora · 发表于 2016-12-20 13:21

980155498cai 发表于 2016-12-19 18:269 n" {! z6 e2 L4 T
网标导出之前有一个选项你勾选一下，在setup下的ignore Electrical constraints勾选就好了

试了也不行

980155498cai · 发表于 2016-12-19 18:26

网标导出之前有一个选项你勾选一下，在setup下的ignore Electrical constraints勾选就好了

Lora · 发表于 2016-12-19 17:10

yangjinxing521 发表于 2016-12-19 17:04
, A+ ^# L- G, l重改一下。。。

有好多呢，改的好累呀

yangjinxing521 · 发表于 2016-12-19 17:04

重改一下。。。

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