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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 74AHC32 的逻辑图，最后加了两级的非？
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74AHC32 的逻辑图，最后加了两级的非？

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Quantum_

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发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x
如下图.  为何， 74AHC32 的逻辑图的最后加了两个非。
) `  Y4 C/ ?( Y; D$ F1. 不加， 逻辑上也正确。, n" [: Q! \  f7 V6 o
2. 为了增加延迟吗？9 X! R* J8 e7 g, q4 c; J9 J: @
3. 还是为了驱动TTL?6 P' x" Q  b+ f2 b1 ^: j
, X2 f, b- _, ^3 Z
谢谢！

OR.png (11.62 KB, 下载次数: 0)

OR logic Diag

OR logic Diag

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支持！: 5.0
超級狗
支持！: 5
可以送我 2TB 的硬盤嗎？^_^  发表于 2016-8-30 11:19
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cdbluerian135

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发表于 2016-9-26 09:19 | 只看该作者
学习了~

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hliu0129

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发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片，比楼主的问题亮得多。个人认为是同步时序。

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newcomsky

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发表于 2016-9-15 22:55 来自手机 | 只看该作者
mark

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超級狗

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EDA365特邀版主

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发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰
; c. g2 Z9 }/ R2 Q7 F( x讚 !

# F4 Y$ W" d7 u* V2 D9 C7 c. |, A8 O# a
看！1 R$ K# `' b  Z
3 r: s$ a; s& F7 e

' E9 }3 A0 p/ i! Z  O2 Y, c+ Q3 }$ k$ E8 N! z
沒有啦！我是叫大家看內容。
, y0 R! ^7 r+ ~/ E# Q, K: K8 ?8 x
/ o& g0 k( Z) w

点评

jacklee_47pn
也對！ 要用力看，努力看，好好看！ ^_^  发表于 2016-8-31 07:49
哈士奇是一種連主人都咬的爛狗！

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超級狗

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EDA365特邀版主

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2#
发表于 2016-8-29 22:42 | 只看该作者
打完收工！/ t6 y+ r5 k  k5 z4 ~( \

( [$ q+ L9 O3 j) s3 D; A, T. m5 o& G: M

Buffered and Unbuffered CD4001B.jpg (28.67 KB, 下载次数: 0)

Buffered and Unbuffered CD4001B.jpg

Comparison of Buffered and Unbuffered Logic Gate.jpg (60.33 KB, 下载次数: 0)

Comparison of Buffered and Unbuffered Logic Gate.jpg

Application of Buffered and Unbuffered Logic Gate.jpg (83.46 KB, 下载次数: 0)

Application of Buffered and Unbuffered Logic Gate.jpg

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kobeismygod
支持！: 5
狗然是老司机啊！  发表于 2016-8-30 11:20
jacklee_47pn
支持！: 5
支持 ! 讚 !  发表于 2016-8-29 22:46
哈士奇是一種連主人都咬的爛狗！

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