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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 74AHC32 的逻辑图，最后加了两级的非？
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74AHC32 的逻辑图，最后加了两级的非？

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Quantum_

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发表于 2016-8-29 21:20 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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x
如下图.  为何， 74AHC32 的逻辑图的最后加了两个非。; d! i. [* F2 z
1. 不加， 逻辑上也正确。
* L. A3 E+ @0 x, N( e6 ?3 B( x4 [2. 为了增加延迟吗？8 ?8 Q! ?; m$ k5 A8 u0 I
3. 还是为了驱动TTL?! G9 o& F% d6 v; D2 K: s. j+ b
  A0 P, E8 x+ {2 |& z9 K
谢谢！

OR.png (11.62 KB, 下载次数: 0)

OR logic Diag

OR logic Diag

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支持！: 5.0
超級狗
支持！: 5
可以送我 2TB 的硬盤嗎？^_^  发表于 2016-8-30 11:19
分享到:  QQ好友和群QQ好友和群 QQ空间QQ空间 腾讯微博腾讯微博 腾讯朋友腾讯朋友 微信微信
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cdbluerian135

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发表于 2016-9-26 09:19 | 只看该作者
学习了~

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hliu0129

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发表于 2016-9-21 17:07 | 只看该作者
4楼这个图片，比楼主的问题亮得多。个人认为是同步时序。

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newcomsky

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发表于 2016-9-15 22:55 来自手机 | 只看该作者
mark

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超級狗

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发表于 2016-8-29 23:36 | 只看该作者
jacklee_47pn︰) Y" o! |0 q4 O! A# i
讚 !

( X1 o& z3 O6 Q4 m) o& `$ A' C% i" @8 }+ z% v+ c' m+ q) g& C
看！6 |4 g% v  W+ T6 I, G* c
/ l3 Z0 |1 R# V/ J) p

( l# j5 d, l& a4 ?8 r* w$ L8 r! N1 y1 x% b$ k  ^" w0 T, E
沒有啦！我是叫大家看內容。
8 B1 L. i( o! S; U. j
( Z5 s) J+ s2 Y* v- d; q3 m+ E

点评

jacklee_47pn
也對！ 要用力看，努力看，好好看！ ^_^  发表于 2016-8-31 07:49
哈士奇是一種連主人都咬的爛狗！

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超級狗

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EDA365特邀版主

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2#
发表于 2016-8-29 22:42 | 只看该作者
打完收工！- ]7 {2 \3 E7 L0 j+ B; ^5 L
9 A  J7 T. m: r  z! Z' h, \

+ P9 O, J) w' A$ p( H' M

Buffered and Unbuffered CD4001B.jpg (28.67 KB, 下载次数: 0)

Buffered and Unbuffered CD4001B.jpg

Comparison of Buffered and Unbuffered Logic Gate.jpg (60.33 KB, 下载次数: 0)

Comparison of Buffered and Unbuffered Logic Gate.jpg

Application of Buffered and Unbuffered Logic Gate.jpg (83.46 KB, 下载次数: 0)

Application of Buffered and Unbuffered Logic Gate.jpg

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支持！: 5.0
kobeismygod
支持！: 5
狗然是老司机啊！  发表于 2016-8-30 11:20
jacklee_47pn
支持！: 5
支持 ! 讚 !  发表于 2016-8-29 22:46
哈士奇是一種連主人都咬的爛狗！

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