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Cadence有装配层。Protel需要吗?

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发表于 2014-12-13 18:52 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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  今天学习Cadence看到下面红色颜色一句话:
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴片时就需要装配层来进行定位。
   想请教大家,如果我的Protel器件只有Toplayer层和丝印层,贴片机贴片可以进行吗?因为我好像在Protel里没见过装配层这个啊!
$ n6 P6 t$ S( k. E& G4 ?6 C: y! H
3 W$ m6 u# [% C0 b" D' B
! a+ ~: r% L. P( n2 N8 q) n# W
4 i" \; ^. u  z. N1 l- D

1.png (10.14 KB, 下载次数: 3)

1.png

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没有强制需要...  发表于 2014-12-15 12:24
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发表于 2014-12-15 15:54 | 只看该作者
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴片时就需要装配层来进行定位7 w. a  v# o2 }  l* W2 e
+ B* v- k0 Z/ [& T! b1 W
这句话不太对。
+ ~# ~- a6 K% c+ w2 n5 ^" Z+ `5 f1 v$ u
如果是贴片机贴片时,我们需要提供钢网文件和钢网层,也叫锡膏层,paste mask top和paste mask bottom.与allegro软件不同的是,ad可不无需单独设置paste mask层。在出钢网时,勾选paste mask就可以的。
3 ^0 `: n9 |. I5 F' O: V: o2 N0 ^$ n' y
如果是装配图,只需要输 出器件位号和丝印框即可。
  |4 S9 p# t, U2 r1 |$ ~% c0 w' Q% x4 [
不知道楼主那句话是从哪里看到的,我感觉是有问题的。
专业服务:(价格面议)
代写作业
拉等长
调丝印
喂猪
欺负同学
打老师

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发表于 2018-6-14 10:07 | 只看该作者
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发表于 2016-1-11 19:30 | 只看该作者
谢谢楼主和6楼

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 楼主| 发表于 2014-12-31 22:20 | 只看该作者
wanghanq 发表于 2014-12-20 10:146 B) o" O0 |( J/ P
从楼主提供的文字大致能够找到的源头文档参附件(按说楼主自己来提供是最好的)。" a# z' |  B/ v: E1 x
此附件前面描述可能加有 ...
$ B5 m) A2 u$ g/ \3 j: T2 }0 h1 _
谢谢。你好仔细啊,就是你附件的这个文档。- T# Z% f2 k& G. i- l

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 楼主| 发表于 2014-12-22 22:00 | 只看该作者
感觉大家的知识都好丰富,学习到不少东西。

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发表于 2014-12-20 10:14 | 只看该作者
jimmy 发表于 2014-12-15 15:545 r1 ^& f7 S7 D% R. E* F
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴 ...

6 i. K7 b! g9 P5 U6 @从楼主提供的文字大致能够找到的源头文档参附件(按说楼主自己来提供是最好的)。
& e$ Z$ d4 \+ h; Y2 D此附件前面描述可能加有自己的理解,但在后面操作描述中还是很清晰的...
$ P3 |9 _+ u" z# y3 ^# s  f& w
Cadence_Allegro元件封装制作流程(含实例).zip (1.12 MB, 下载次数: 30)
+ \& |- s" Z  `0 y4 i
业余,多多指正指教。

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发表于 2014-12-17 08:46 | 只看该作者
装配层是一般是在焊接的时候,给个示意图。因为PCB上的Topsilk有的时候不能定位得很清楚。

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发表于 2014-12-16 22:26 | 只看该作者
在机贴焊时,Cadence的我也基本上没用过Assembly层,其实所谓的装配图就是客户拿到PCB板后来比对查找器件所用,与是否机贴焊无关的,机贴焊所用定位是用器件坐标及BOM,以及MARK点来定位的

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发表于 2014-12-15 12:10 | 只看该作者
本帖最后由 wanghanq 于 2014-12-15 12:15 编辑 ' ^) E  n. v/ I3 F, r

: o7 }( n1 Y2 _/ Y" R- I根据不同的检查项目,我们会生成各类图层文档。: a5 d7 C/ j) N) R: C2 F/ u
对于贴片机,通常会 要到的文档 : BOM,坐标  以及其他。
+ M: F* @. z8 S
) i) d; F2 c# B9 X此话题需要拓展下面相关的内容:+ B$ u- z8 v6 E' t4 M- ?2 u) z

6 N* @$ Q! X* |' f% j- Q" G7 }贴片机编程8 W6 V8 t+ I# s6 O, U5 @
http://baike.baidu.com/link?url=mfVSgwyoXfHGKA4K18pawxOALwczxuqQM091Of9ScpZP1xu7Qk_v3oau00c6YAz4fN5t0Vi8Bdz8qOzDDIbi2_0 d; n5 o/ P" j0 ?% M
  a/ [/ x' J# D
Cadence各层作用及封装信息传输对应关系  此文未下载,欢迎有下载积分网友下载后补充在帖子中来
, t# ?8 L! I) U& N( thttp://wenku.baidu.com/view/269457535f0e7cd1842536cc.html  `/ F* Q! m8 Q9 a  P1 `) h5 H
+ F8 v8 ~5 ~& Y. P! z! L1 ]8 g
PCB设计软件坐标数据导出方法综述.pdf( e7 Y; u; p: j1 t3 w
PCB设计软件坐标数据导出方法综述.pdf (368.91 KB, 下载次数: 24)
5 ]/ d4 d. x) }: X" ]5 C
7 J' y! P* B& `* o# ]对于你提问中提到的这个层,可以理解为自定义层(有用到的也有不用到的),, z: g, ?+ ]- ]5 ^
在AD中建议你不妨看看最新的PCB封装,里面会有更多的信息层被定义到。
( J9 [9 K- j# W! {不同的软件 层的定义以及使用限制略有不同,我们在学习这类软件时,不要生搬硬套...
$ x0 j$ c5 h5 t, I& F0 h" l: r
5 i3 E, Q% P0 o! \此主题贴 已汇总在 【给初学3-】系列汇总贴中6 ]3 Z8 F; _+ n! e) l- _0 F9 _$ k

& D1 g7 a3 l) ~( |0 B

/ t, C, W5 s4 A' ?7 B3 w( z5 n7 p
& F3 l/ M: p- [2 d
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