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关于QSFP收发信号的处理

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发表于 2014-12-7 11:30 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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本帖最后由 kevin890505 于 2014-12-7 11:31 编辑
2 k" t; }1 Y$ |% g' V3 c" X9 u' @  I4 ^# L
第一次弄QSFP+,完全没信心,请问各位大神,这种10G的差分(4对收,4对发)处理上有什么要注意的:
0 W" x( x! S9 q# a: ~6 W) K% Y1,收/发的4对之间应该不用等长吧?$ N4 _( Z6 q2 C' l* ~/ N, D
2,对于高速的差分,从1mmBGA中出来,BGA下方应该有>2CM的走线.下图neck mode或者每根线各走一个通道,对于信号那种更好?
( Y- F5 B2 r. j# ~7 {4 F3,10G的信号,如果没有长距离的水平,垂直走线,大约小于5cm,用考虑十度走线么?
2 u9 }& _0 ^6 l如果各位大神有其他意见,建议,跪求!!4 T9 Q' |/ s7 k: f9 V, O6 W9 h( B

  n. i5 J0 V* u" n! E! f  T还有关于电源处理,内核0.9V电流>30A,设计的是48A,这种大电流在处理时候有什么要注意的?
: v; L6 n* Z! Q4 v因为是长方形布局,电源在右侧偏下,芯片在左侧,中间偏上有2个DDR3颗粒(不一定会用),这一块地平面回流电流貌似非常大,将来会影响这2个DDR3么,准备跑2133M的。6 N: f5 l9 ^3 \$ Q: v, w9 k

! Q% u8 d" x: Y# K1 [我是很有分享精神的,不过大家懂得起,实在不方便上图。ORZ。
$ |5 `  ^' I/ T* ~/ v

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发表于 2014-12-9 23:34 | 只看该作者
我也来说一下,个人意见,仅供参考:
7 i; Q' T9 {/ r( [/ I& |0 ~; m% q1. 要严格等长;不管是差分线对还是TX,RX对,等长就是了,虽然我们知道后者是无所谓,万一软件调不出来,第一件事就是问你这个:等长了吗?你就可以胸有成竹地说,所有的都等了。0 \, O$ W/ d$ o1 u1 o+ x
2. 不用说了,neck mode;" A& G: r: @$ n! j9 r( k4 G
3. 同上,需要十度走线;
! s  s& ]' O* ?7 h5 H4. 除了多铺铜,最好顶底层用2OZ以上的铜皮,电源是最为关键,对数字部分,我一般看重的是电源和回路。+ n8 @7 U' C, `* [
年底要发奖金,这个时候,一定要注意设计,如果因为一时痛快而被人抓了把柄,奖金分少了,就不好了。

点评

请教下,FR4采用10度走线是和材质有关,我们现在采用ROGERS,不知道还有没有这个问题还需要10度走线不? 大家都采用什么材质,有没有必要换ROGERS的板材, 还有个问题,PHY到光纤口的差分信号是不是50欧姆?有  详情 回复 发表于 2015-5-15 10:46

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 楼主| 发表于 2014-12-9 13:08 | 只看该作者
dzkcool 发表于 2014-12-9 10:27
6 H) n) z) b3 E$ B. t  R1 r1、收发之间无需等长,实际上走线拓扑一致,相差也不会太大;
# `0 z; o* x' Z* X) F2 F2、BGA内用Neck模式,一般是4/4的线宽线距, ...

1 N' l' c, @8 X9 K- K; u9 `多谢大神。关于内核电源处理,我目前使用4内层+1表层铜皮的方式。通流量绝对满足48A要求。( K3 [( X, C5 d! u  u5 k  h
而且电源走向没有经过DDR,但是电源到芯片相当于一根较小的U形铜皮,   DDR大概位置
, X# V# _3 O6 V! r3 L刚好在U的中间偏上侧,虽然电源不影响DDR,但是我经过仿真发现直流回路在地平面
) Z3 ^- g* x) g6 ]* T1 L, R上的电流密度,DDR下方明显要大许多,这个问题应该怎么处理?  单独掏空DDR和内核电
8 `9 [& A+ d! t6 d/ X源地中间形成一个隔离槽的话会影响DDR走线下方的参考地,所以纠结啊!!!或者不用管?
* @8 R% u- O$ g" I2 H2 }7 e

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发表于 2016-4-21 16:42 | 只看该作者
感谢分享,刚好需要。
再烦也别忘微笑,再急也要注意语调!

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发表于 2015-7-14 21:31 | 只看该作者
请问能大概讲下十度走线吗?真的没见过。。。。
- s" O9 S+ f6 _/ T; c# X

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发表于 2015-5-26 14:54 | 只看该作者
感謝分享~~

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发表于 2015-5-21 17:13 | 只看该作者
没有想象中的那么复杂,ALTERA开发板做过类似的板子,具体参考Stratia IV GT 100G Development Kit Board

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发表于 2015-5-20 09:36 | 只看该作者
  是做背板么?一个QSFP+内部是否有CDR?   如果不同差分线之间能保持等长或者尽量等长最好,但是实际上由于接口 芯片引脚位置等因素造成不可能完全等长。 如果不等长并行的信号如何处理,这交给后面的CDR芯片进行数据整形。

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发表于 2015-5-20 09:29 | 只看该作者
你是做QSFP+背板PCB的吧?  为什么需要这么大的电流?对于SFP+ QSFP协议先熟悉下

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发表于 2015-5-15 17:23 | 只看该作者
材质会影响阻抗,更换了材质 阻抗线需要重新计算,已经达到10G 用ROGERS 相对于FR4性能更好 当然价格也贵点。不知道10度走线,都是走直线和135°走线,当时画的是个八层板,收发各有8对吧6 N! i" d# A1 G6 @% Y
一朝英雄拔剑起,又是苍生十年劫
唯刀百辟 唯心不易

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发表于 2015-5-15 10:46 | 只看该作者
part99 发表于 2014-12-9 23:34
4 C/ Y. ^# k" N" m/ @我也来说一下,个人意见,仅供参考:
& M4 v- F  t7 w( A* B4 C* M1. 要严格等长;不管是差分线对还是TX,RX对,等长就是了,虽然我们 ...
2 I; p- A0 T, {3 W) U
请教下,FR4采用10度走线是和材质有关,我们现在采用ROGERS,不知道还有没有这个问题还需要10度走线不?
, |4 t3 l" b; M$ T- N0 S大家都采用什么材质,有没有必要换ROGERS的板材,
3 ?6 M2 v9 J' b. K4 J  Q
6 k  {1 h) i4 ]4 ?- v- G& l& V2 A: a: r& p
还有个问题,PHY到光纤口的差分信号是不是50欧姆?有没有什么资料啊7 a4 f* H; X2 M
这个家伙很懒,从来不写个人签名。

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发表于 2014-12-12 16:45 | 只看该作者
本帖最后由 panpan 于 2014-12-12 16:47 编辑 , f3 ?' o/ l: o  m

# T' n3 `. h' t7 e1 q$ X1,收发之间不需等长! ?& ^) G5 j1 Y2 p, D/ n( O" J( \& @8 x
2,必须用neck mode3,什么是“十度走线”?6 z  h+ C2 \4 J, ~1 z  b: l
! [( {9 y/ D- ^( f

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 楼主| 发表于 2014-12-9 22:32 | 只看该作者
jhh610528 发表于 2014-12-9 22:24
! Q4 e- y( l8 Z" K  K1.不需要等长# l" U+ C% \" w- u/ }0 }& A7 @& e# a
2.neck mode, `8 R2 n. Q/ k( w) ^1 [
3。不需十度走线
9 z% R* r8 I7 e3 d5 n5 D! y0 {
3Q - ?+ o" J0 W4 P. v, L2 k! {3 U

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 楼主| 发表于 2014-12-9 22:31 | 只看该作者
dzkcool 发表于 2014-12-9 15:286 r8 u) \: f& s  O
我想,直流应该对DDR的影响不大
7 V$ Z$ }1 A0 x, h# V& P* l
多谢大神帮忙。' A6 |4 u2 ]9 l+ f1 z

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发表于 2014-12-9 22:24 | 只看该作者
1.不需要等长
) i, y  V6 ], {3 ~2.neck mode
7 Z+ i' }, b- C1 W% h3。不需十度走线$ A/ Q1 p/ h3 T2 j
4。可以在信号层多铺几个铜皮: X( f/ M- P  _5 E8 R, ?: N; t" O
个人处理方法,仅供参考

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发表于 2014-12-9 15:28 | 只看该作者
我想,直流应该对DDR的影响不大
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