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一般做封装时要做Assembly_top吗?

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发表于 2013-3-19 10:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
/ z* O  [9 q8 Z+ N' k+ V7 _4 r
如上图,一般你们做封装时会做Assembly_top吗?1 e) w0 V; M# g0 {
还是只做以下两个就OK了?
- x) p+ P* f' _$ f. r % ^5 \2 t# ~( U: T7 y% i3 y- [

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建议做上去!  发表于 2013-3-19 11:03
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发表于 2013-3-19 11:39 | 只看该作者
Assembly_top是实体大小
6 V7 M% M# I' c( T. d: y; u8 X4 {可用来给机构确认或是标示极性脚位用6 G- n2 x2 {& j' [: q, Y
我目前遇见的此层是必要的

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 楼主| 发表于 2013-3-19 11:58 | 只看该作者
必要?

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 楼主| 发表于 2013-3-19 12:27 | 只看该作者
Assembly_top这个出gerber时貌似用不上啊,还是只是设计时方便做一些标示?

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发表于 2013-3-19 12:32 | 只看该作者
看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

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 楼主| 发表于 2013-3-19 13:15 | 只看该作者
inspiron1501 发表于 2013-3-19 12:32
. E* g7 s1 @6 G" d/ l$ n看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可
# q7 |  j9 S* x3 [
那按正规流程走,这层应该画什么东西?

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发表于 2013-3-19 13:19 | 只看该作者
本帖最后由 幸福万岁 于 2013-3-19 13:27 编辑
$ M$ p- s: k4 t) _! I
' H. Y8 ?! K6 [* O4 z装配层    比如有些需要外接器件可以多画个place_bound_top- S+ c8 R2 N7 v; d
貌似一样 2 j' D; H6 I; L; T  V0 @( b- @0 [
这一层 我从来不画

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发表于 2013-3-19 14:29 | 只看该作者
我一般画原件实际外框

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 楼主| 发表于 2013-3-19 14:54 | 只看该作者
我认为必须画的两个.1,place-bound-top
( \. B2 U( c0 u4 f6 @8 h6 l7 Z9 u                            2,silkscreen-top( q0 ?: x+ C9 x" ]1 N1 l* M
这两个画了就OK了,有不同见解的吗?

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发表于 2013-3-19 22:14 | 只看该作者
没有必要,但是画上去的话,可以用assembly层出装配文件给装配人员,毕竟有一些板子器件密度太高,用丝印层很难看清楚。

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发表于 2013-3-20 14:18 | 只看该作者
有总比不没有好,等你需要用到这层的时侯,再修改就麻烦了。1 I$ F) v% j1 b5 E% A
, r  Y5 u8 V! D6 c
所以尽量都加上,一般是器件形状,方向和其它一些注脚.
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