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设等长遇到问题

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发表于 2013-1-10 13:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
6 W3 G. u, r- y  ?: T

1 F7 ^8 Z4 `1 p5 Q如上图,FPGA、DDR、排阻" a! Y: ~( ?1 r/ P0 B$ A, o6 V

' i$ E8 _/ `6 Z: lDDR在中间
  }0 H7 T8 J. N0 r
  W+ V7 `0 \/ F- l; d$ R$ R这种情况怎样设等长?0 v, c( ]2 T4 e! \

& k4 B- H0 B4 J0 x目前设了FPGA到排阻的pin pair等长
0 c" Q- @0 `' o, v6 P
' B( ]& K2 K1 t7 K1 a/ Q8 T+ j但是这样DDR的那段就没有加进去; i! P3 M$ `' v% w! N* n! e

. k) ~0 F6 k# X' t5 w: `. ^# }因为是同一个网络,又无法设置Xnet
2 L( s5 u1 M; W9 d5 p9 I1 _4 r/ z% y) H& h, d( u# u8 R
请大家指点下,谢谢了
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发表于 2013-1-10 13:57 | 只看该作者
先得确定排阻是干什么用的,目前来看,1.排阻放的位置不对。2.如果排阻放的没问题,那么等长不需要到排阻,直接FPGA到DDR就行

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 楼主| 发表于 2013-1-10 14:00 | 只看该作者
wumeng1217 发表于 2013-1-10 13:57
* S3 T7 M9 R: F( }& Q& G% w7 C; v先得确定排阻是干什么用的,目前来看,1.排阻放的位置不对。2.如果排阻放的没问题,那么等长不需要到排阻, ...

/ \& M7 u$ f  q. P; N排阻是地址线上拉电阻,等长需要加进去么?

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发表于 2013-1-10 14:03 | 只看该作者
上拉不需要

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 楼主| 发表于 2013-1-10 14:24 | 只看该作者
wumeng1217 发表于 2013-1-10 14:03 , A# K5 H4 t" i  L' y' ~8 L) E
上拉不需要
$ Q' @' [* G0 v7 z, N; G7 m
俺们老大说要加进去

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发表于 2013-1-10 14:36 | 只看该作者
地址是上拉到VTT的吧,第一次听说要加进去……
8 C3 W& R, m3 P: j$ W! p1 u另外,如果真要加进去,你就得给DDR附模型,9 L- N: F* y# O
或者直接给PIN强制附模型

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 楼主| 发表于 2013-1-10 15:47 | 只看该作者
wumeng1217 发表于 2013-1-10 14:36
% T% D* x1 S. l" C% e5 n. `4 j地址是上拉到VTT的吧,第一次听说要加进去……1 x! r9 ?- I" P+ j" w; K  _3 D
另外,如果真要加进去,你就得给DDR附模型,1 n8 {) Y8 m* s% b7 W4 f- `4 d
或者直接给PI ...
* ?% b' q" O9 _: n# a6 e( \
对 就是上拉到VTT的

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 楼主| 发表于 2013-1-10 15:48 | 只看该作者
wumeng1217 发表于 2013-1-10 14:36 4 I% [( b9 I" x
地址是上拉到VTT的吧,第一次听说要加进去……
& Q, _# L7 i0 f" p, d  C另外,如果真要加进去,你就得给DDR附模型,
: c) l2 j! W% A$ e# S或者直接给PI ...
/ n4 z+ E+ I* D& v  i
给pin强制附模型 是什么意思?

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发表于 2013-1-10 15:53 | 只看该作者
Edit-Properties,加个pinuse,选bi,就是强制给某个PIN附模型,就可以创建Xnet了

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 楼主| 发表于 2013-1-10 19:58 | 只看该作者
wumeng1217 发表于 2013-1-10 15:53
( m, b% m1 V+ w, WEdit-Properties,加个pinuse,选bi,就是强制给某个PIN附模型,就可以创建Xnet了

7 N; u: _/ o7 _; X  u! V1 _2 Q9 Q谢谢 按照以上步骤把DDR的pin脚设成BI,但是Xnet还是创建不成功/ m& R! l4 d. H9 x9 \( q- _
( d' v: d# H5 U) F. M9 R
不知道什么原因

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 楼主| 发表于 2013-1-10 20:05 | 只看该作者
wumeng1217 发表于 2013-1-10 15:53 6 o4 c; G! h* `" e! S9 H0 A* {. v" ^
Edit-Properties,加个pinuse,选bi,就是强制给某个PIN附模型,就可以创建Xnet了

/ F4 `2 A. O6 K3 E2 y5 i现在的pin pair还是缺少DDR那一段* y% L& e$ K8 l* z* @; D5 C1 P

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发表于 2013-1-11 10:03 | 只看该作者
你排阻附模型了吧,排阻是上拉,不能附。9 x  K# f* r0 ?' e# U+ m
你可以去让你们老大多看看DDR的设计,这个上拉到VTT是不用算在等长里面的

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 楼主| 发表于 2013-1-11 10:53 | 只看该作者
wumeng1217 发表于 2013-1-11 10:03
1 q0 o+ D: j5 E2 s6 p/ p你排阻附模型了吧,排阻是上拉,不能附。
) P3 F- |, D; p你可以去让你们老大多看看DDR的设计,这个上拉到VTT是不用算在等 ...

+ C! c( p! x, m* H  V) O: ~排阻没有附模型 1 m, Q0 |4 D+ M% ^4 f
老大坚持要算进去

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发表于 2013-1-11 10:56 | 只看该作者
suicide915 发表于 2013-1-11 10:53
4 ?. [# ]# X' _4 x% R5 q' [9 [排阻没有附模型 6 ~5 `/ c& ~3 B
老大坚持要算进去

8 B* S+ u" x$ K6 i* E- g! f即使是错误 的,也要听老大的。。不然扣你工资,可能让你以后不爽的。。。自己知道 就行了。。

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发表于 2013-1-11 11:33 | 只看该作者
唉,实在不行你就控制好你的走线方式了,先连到DDR,那样基本没什么误差,你等长控制严格点。
7 k8 l9 C% C& G8 T按理那样是应该能加上Xnet的& {) B& Y0 a- g: G
或者你可以用SigXplorer设置拓扑看看
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