【请教】DEHDL/DECIS+Allegro的module reuse与交互

hdjun · 发表于 2013-8-27 10:52

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本帖最后由 hdjun 于 2013-8-27 10:54 编辑

请教一下，如下情形，可以使用allegro的模块功能吗？
A 板 12 层，设计工具 Design Entry HDL + Allegro
B 板 12 层，设计工具 Design Entry CIS + Allegro
A 与 B 板具有相同的叠层设计，并通过 400 pin的FMC 连接器连接，
现在想把连接器去掉，做到一块板子上，由于A板是模拟数字混合板，较大， B板是数字板，较小，所以想把B板生成模块，加入A板的设计中，请问这样可以吗，可能性有多大？

具体问题：
1. 如何将生成的CIS/Capture原理图以模块或者BLOCK的形式加入DEHDL中？
2. 如果1可以的话，生成新的网表后，如何让allegro知道调用预先生成的模块？（B 板预先create module）

涉及CIS和HDL两个原理图工具的交互，小弟不是很熟DEHDL，特来请教。