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请问DDR2时钟线长度约束

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congbupt

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发表于 2011-4-11 10:44 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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  _: [. f+ {3 v; l) }我做了一个板子,两片DDR,从CPU引出一路CLK,使用了一个时钟缓冲器分成两路送到两片DDR,这样的话时钟的长度怎么算啊,与DDR的数据线怎么匹配长度? 是看 缓冲器到DDR的长度 还是 CPU到缓冲器加上缓冲器到DDR的长度和?
( o: d3 U' [' A8 I如果没有缓冲器,为了建立时间保持时间,CLK长度比数据线长度稍长还是稍短?
' B8 v" }2 _7 c8 i多谢各位做过的来讨论一下啊.
) ~2 w0 A) y2 G& R
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xiaoyong_21

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发表于 2011-4-11 12:44 | 只看该作者
缓冲器前后的长度加上缓冲器的延迟，数据要长用来保证建立时间用

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cccccc32

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发表于 2011-4-11 13:58 | 只看该作者
缓冲器前后的长度加上缓冲器的延迟---对的。' x6 u) W2 T# R4 N
时钟线要比数据线短；% z  q$ O% ^2 a' h; O( K

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congbupt

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 楼主| 发表于 2011-4-11 15:53 | 只看该作者
回复 xiaoyong_21 的帖子0 T& [! B9 [" r: @

$ v: m3 h+ |8 L/ a0 q- u, |你好,这个具体的数值是怎么确定啊? 缓冲器的延迟怎么定?如何转换为走线长度?7 M, C5 G7 _1 I' F& `9 L
数据线比时钟线长多少啊?
* J1 T6 |. u# U! Y. K/ o

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congbupt

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 楼主| 发表于 2011-4-11 15:54 | 只看该作者
回复 xiaoyong_21 的帖子
! {7 L0 W7 X3 r$ q4 o, g# Y' x# \" L) k
你好,这些数值如何确定啊?

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mypostwww

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发表于 2011-4-11 21:11 | 只看该作者
回复 congbupt 的帖子. j' j+ F1 A! ?+ v& Z: u4 d' N

) K7 p+ n4 ~! ]  o, b我也在ddr2
) w! {+ x- ^5 u% H5 p你的主控芯片是什么？
% b5 T" R# k* m- o0 k我的是ti 6446+ |) n5 \) U( a8 B

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