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EDA365电子工程师网»技术社区 › 电子技术社区 › QA检查（免费服务） › 2017年11月18日QA检查报告节选
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2017年11月18日QA检查报告节选

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发表于 2017-11-20 10:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.跨分割了8 o/ X6 n5 `1 h# d( h( b

* q: ?+ X) E7 J; i4 G0 R9 Q
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 楼主| 发表于 2017-11-20 10:19 | 只看该作者
2.高压电源地做隔离
  h/ B: A) c& w; T; s' p# U" i- t 8 I% _7 o1 q8 w  }( i- D' f: C

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 楼主| 发表于 2017-11-20 10:19 | 只看该作者
3.SDRAM没等长
2 l1 [2 Z* u. w ; j+ E) k$ t+ H$ U4 f+ A5 d! g* c5 v

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
4.差分走线未按要求走线
( F6 w" o0 P+ H + g# j, D; ?3 ~5 n) s

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
5.USB的ESD器件离接口太远了，布线先过ESD。3 \& r2 ]0 v9 j8 H. K0 i! }# L' m$ V
% b4 e( X% T2 a- N) a0 \

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 楼主| 发表于 2017-11-20 10:20 | 只看该作者
6.有线在RF挖空区过了，参考层不完整. @4 ^! }- e- M# {% j

5 i, p2 g5 ]* p0 F- P1 F+ A

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
7.400V？没有按照安规做间距隔离
1 F- B, ~1 J) o0 A& C $ C7 e; B% e6 H/ X  y" g4 f8 p

点评

edapcbsyc
安规应该做多大隔离呢？  详情 回复 发表于 2017-11-20 21:28

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
8.封装库记性与原理图不一致
5 m+ |8 J8 U6 n, y  U. ]& J, B5 y; I : i. I3 s6 V6 q) h" ], i

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
9.VIA的隔离盘太大，导致内层多处出现隔断，而且隔断区有走线1 O4 Q8 f( x8 `$ J
. Q  N0 g) r" }& w

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 楼主| 发表于 2017-11-20 10:21 | 只看该作者
10.等长处理! E/ I  i$ b! M
. v! `; B! i7 ]+ h2 `' ?+ m+ J

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 楼主| 发表于 2017-11-20 10:22 | 只看该作者
10-1.等长处理9 I, \" }. l! B! {
6 c! M7 q4 M4 W% T. ?8 J2 q& N$ m) `7 a

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edapcbsyc

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发表于 2017-11-20 21:28 | 只看该作者
EDA365QA 发表于 2017-11-20 10:21# S4 `( f& Y* m2 B# i
7.400V？没有按照安规做间距隔离

2 x6 @% @8 i% Y4 p安规应该做多大隔离呢？
- `2 {7 A; \- G$ e3 @' a4 e) M7 J7 L) a9 S

点评

edapcbsyc
谢谢解答  发表于 2017-11-22 16:20
EDA365QA
可以参考：https://www.eda365.com/thread-146811-1-1.html  详情 回复 发表于 2017-11-21 09:06

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 楼主| 发表于 2017-11-21 09:06 | 只看该作者
edapcbsyc 发表于 2017-11-20 21:288 |- e4 N0 V: [4 \! v1 |+ y) _* f
安规应该做多大隔离呢？
. v" o( z# G; ]7 n% i  z8 |5 w
可以参考：https://www.eda365.com/thread-146811-1-1.html
3 ?. k; u3 O& z8 Y1 P3 @2 i

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qilinwang66

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发表于 2017-12-4 09:38 | 只看该作者

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