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VX11中铺铜的奇怪问题,怎么破?

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发表于 2015-7-22 08:39 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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各位好,
' l+ q; d1 A0 X& I9 c0 u- X8 t' n

+ T6 x5 l; l3 H8 x) F在从Allegro转到VX11的项目中,铺完铜发现下面奇怪的现象,自动避让形状不是自然的随目标形状而变化的,而是动态的距离不规范的形状。
) y0 b5 A  [) X( N5 p! g不知哪位朋友也遇到过类似问题吗?如何解决的呢?
; I% K  F' H5 c感谢!
! E3 a* e, {' y: k
5 _  f, a' N" k% T" w" |+ ~; M

- w4 Y. {0 j, A
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发表于 2015-7-22 20:58 | 只看该作者
这应该是转换的问题,避让边界应该是禁布线把?如果是删掉即可,重新动态避让。请问你是怎么ALlegro转vx的求指导

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不是禁布,删掉后重新画还是一样的,整版所有的地方都是这样。先将Allegro转到EE792,然后再VX打开即可。  详情 回复 发表于 2015-7-23 08:02

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 楼主| 发表于 2015-7-23 08:02 | 只看该作者
haoyingxiang 发表于 2015-7-22 20:582 Y0 j7 v) ]7 q8 ?7 v3 z  i+ {( A
这应该是转换的问题,避让边界应该是禁布线把?如果是删掉即可,重新动态避让。请问你是怎么ALlegro转vx的 ...
: v/ ?6 s; J+ w5 X  p
不是禁布,删掉后重新画还是一样的,整版所有的地方都是这样。先将Allegro转到EE792,然后再VX打开即可。* g4 Z4 f1 ~' k3 ?/ G9 v! B

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allegro怎么转到7.9.2的?有没有操作说明? 你提到的问题,可能在做盘的时候设置了东西,你看一下盘属性。  详情 回复 发表于 2015-8-5 10:18

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发表于 2015-8-5 10:18 | 只看该作者
老吴PCB 发表于 2015-7-23 08:020 E+ p6 @  N+ B3 n3 S4 s7 P% F8 \
不是禁布,删掉后重新画还是一样的,整版所有的地方都是这样。先将Allegro转到EE792,然后再VX打开即可。 ...
' V  ]! j/ K- M1 U, X. s
allegro怎么转到7.9.2的?有没有操作说明?
+ ^/ e; E" S6 ^& l你提到的问题,可能在做盘的时候设置了东西,你看一下盘属性。5 V9 K5 T9 H- Q

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发表于 2015-8-20 16:33 | 只看该作者
可否把出问题的这一小块PCB传上来帮你看看,既然是转换的,那应该只有PCB数据,你可以把其他的涉及到具体电路的部分删掉,只留出问题的这一小块区域,让大家帮你看看。

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感谢你的帮助,但设计数据无法上传。重新创建一个新项目,再将原设计copy过去,问题消失。  详情 回复 发表于 2015-8-24 16:49

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 楼主| 发表于 2015-8-24 16:49 | 只看该作者
prince_yu 发表于 2015-8-20 16:33
1 k9 N# W! T8 B, q可否把出问题的这一小块PCB传上来帮你看看,既然是转换的,那应该只有PCB数据,你可以把其他的涉及到具体电 ...
- y5 \9 j/ ~- h0 X: F6 N' Y& w$ {
感谢你的帮助,但设计数据无法上传。重新创建一个新项目,再将原设计copy过去,问题消失。
+ O  G) y! I: H3 o; |7 P9 H

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发表于 2015-11-5 10:35 | 只看该作者
到時候我在測試一下

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发表于 2016-7-27 15:53 | 只看该作者
应该是CES的问题吧
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