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[仿真讨论] [求助] ddr4 中的 data training 是什么意思

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发表于 2016-11-15 17:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位老大,, \& K! j4 {* T3 K
0 E, ?2 c) W5 ?) Q9 R4 L
    ddr4 中的 data training 是指什么, 看协议看糊涂了, 不是很理解.; O% k1 e. b( _
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发表于 2016-12-9 07:42 来自手机 | 只看该作者
可以理解成数据信号的一个自适应接受的过程,ddr4的数据信号参考电平是不固定的,所以判决门限也不固定,在系统启动的时候就要自适应的去找这个门限,使得数据眼图最优化。

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发表于 2016-12-23 13:13 | 只看该作者
training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

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可以调delay的话那不是不用做等长了?  详情 回复 发表于 2017-1-13 15:11

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 楼主| 发表于 2017-1-13 15:11 | 只看该作者
ljzyhjbfwh 发表于 2016-12-23 13:13
; B9 n( q& k& ]# v6 Vtraining是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。
. u" C3 q+ i5 C6 m# u2 k
可以调delay的话那不是不用做等长了?
) @% L, V5 S3 l3 p! Y

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等长还是需要做,内部调delay有个范围,超多了,就调不到align了。  详情 回复 发表于 2017-1-16 13:45

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发表于 2017-1-16 13:45 | 只看该作者
l888888h 发表于 2017-1-13 15:116 Z$ W# c. O; R1 h" L' e% x
可以调delay的话那不是不用做等长了?
. {# l1 s1 j0 }( T1 B4 L
等长还是需要做,内部调delay有个范围,超多了,就调不到align了。# T: y0 K7 s8 N) N4 u  x/ O

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内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?  详情 回复 发表于 2017-1-16 19:50

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 楼主| 发表于 2017-1-16 19:50 | 只看该作者
ljzyhjbfwh 发表于 2017-1-16 13:45
. A. Z! V! x! j+ S8 M& w等长还是需要做,内部调delay有个范围,超多了,就调不到align了。
7 S/ J2 b# |: H# z. a
内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?
) f9 x( ?' h1 D7 n

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协议上没有。  详情 回复 发表于 2017-1-17 14:02

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发表于 2017-1-17 14:02 | 只看该作者
l888888h 发表于 2017-1-16 19:50) C$ Y+ v( {6 f" D$ |2 N
内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?

) i# N" }& B- a$ N协议上没有。6 S  k$ ?2 X# K8 L

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 楼主| 发表于 2017-1-18 19:00 | 只看该作者
了解, 谢了

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发表于 2017-3-18 10:14 | 只看该作者
有ddr4的文件吗?能不能分享下1145441303@qq.com,多谢
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