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io designer如何指定器件与目标fpga的bank优化？

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mengzhuhao

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发表于 2016-6-16 08:26 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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io designer如何指定器件与目标fpga的bank优化？1 w3 M, g5 S( t6 Q: T/ ~
0 @- W6 A* m+ b, F3 E- m4 \* A5 x
像fpga的vref的管脚如何避开优化？
4 U) {7 p. k2 n& M; J
* ?/ I$ M, y- j1 |. A! k* k. B是不是layout没有网络 是不是就不能进行优化？
6 R8 |: X/ }6 E5 M! Z/ ]  k
0 J/ |' A- d+ V6 I' @) V  I能不能网络优化有优先级？
" `, S& ~: F+ d- d. T9 J" R; Y
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