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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全,仍然提示一下错误

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑 ( a6 U2 J5 U2 u

, }' e4 v: ], t3 Y: p如题,allegro  16.6 导入网表出错,调用别人的封装,错误信息如图1., J- O, }$ Q1 \3 w9 B) q8 l/ A! a

/ o$ [( h4 i( ~& R3 M5 M- a  提示封装的引脚缺失,共有10个元件的封装
$ s- K4 s; w6 t  g" p. H
& V& z! q$ p+ J& j打开其中一个DRA文件,发现缺少引脚,如图2所示
' C% [" f* Q+ E; ]' B& U% j5 _- x$ E; f+ g

+ l' I3 D5 v# x5 c& S这个封装文件在别人的电脑上可用,不缺引脚,而且PSM/PAD/DRA文件齐全,为啥调用过来出现这种错误?2 y1 |0 n% a  e6 S, X8 E7 i

# I) t: t& M; l/ \& H8 J
2 O; U! e* y9 e& s1 Z请问除了重画封装,补上引脚,有没有其他方法?
$ X0 x) w  p, g9 h/ J) P

DST导入网表报错.png (25.14 KB, 下载次数: 1)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 0)

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:26' X0 l1 U# b; @1 E3 Z# P: z
dra文件里面要有焊盘才行。
0 H  u/ h/ g6 y# f你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目 ...

5 X6 [2 B2 }0 L导出封装成功,可以看到FPC_10_0_5M  正常 ,图1.
9 a6 s) m! k, i* k" j9 i# c1 M7 ?0 C; s8 G
回看原理图这个元件,图2,图1和图2引脚一致,
" P4 Y% W0 s- g! F
' I! ]6 e3 f: S* y/ s2 V# `2 `" D. ~" j6 v, S
但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚,图32 K1 A* k& H2 x9 j, m
[size=14.3999996185303px]) k/ r. n: J6 t) f
( C( x- b+ ^. ^4 l
[size=14.3999996185303px]
# g7 Z! m" S0 R" L0 \$ |9 G  f+ c9 a
[size=14.3999996185303px]编辑原理图的这个元件,并没有看'UART'脚。" G, }- D# ~5 Q) c0 _
' D; G3 v2 N2 ?0 @

2 a$ J3 w$ I+ i& a) O( |封装重画,原理图这个元件重画,仍然有这个错误。
$ p- r6 m$ u! M( R  l  ?8 {* B/ Y- i/ a" |

3 f- D3 L+ H6 o4 Z5 P; l& c/ e: f求教!( c1 Z% f! B- n; {

导出封装FPC.png (7.49 KB, 下载次数: 0)

1

1

原理图FPC.png (21.46 KB, 下载次数: 0)

原理图FPC.png

NET错.png (16.01 KB, 下载次数: 0)

NET错.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:05, Q0 Y# K! r9 A3 y; ~# P; F
我没做任何改动,只是导入了一下网表,没发现什么问题。
: B8 o" P  t( [4 y! X$ A4 O
我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板框内,其他的元件可以放置。
4 x9 X9 {9 Y" z% P) `% g7 n  f2 Q% F. f! |
跟生产网表/导入网表的设置有关么?
  h! X  \& w5 u. h, w) H' h

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我直接用第一方导入,没任何问题。  详情 回复 发表于 2015-4-21 17:53

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发表于 2015-4-22 10:37 | 只看该作者
fangxiaoyan 发表于 2015-4-22 09:43
: N% _9 U8 C# o) l- I现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...

+ h5 R; b8 [( R估计跟1、2有关。
( N8 G7 g+ P. g  J( C实在看不下去了,大哥,你才是楼主,不要老是称呼我是楼主
5 R" X2 |+ J( z5 l% S. i" C9 l
; y0 ?6 E( k" u: L; Q9 J; U
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 楼主| 发表于 2015-4-16 20:32 | 只看该作者
没人知道么,还是问题太幼稚了?

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发表于 2015-4-17 09:26 | 只看该作者
dra文件里面要有焊盘才行。
& e1 A/ x+ f$ ]你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目录下,然后再导出封装。

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导出封装成功,可以看到FPC_10_0_5M 正常 ,图1. 回看原理图这个元件,图2,图1和图2引脚一致, 但导入网表时提示FPC_10_0_5M 缺少引脚,图3 编辑原理图的这个元件,并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
同事直接发的封装文件。现在打算重新从同事的板子导出,再试下。  详情 回复 发表于 2015-4-17 10:35
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 楼主| 发表于 2015-4-17 10:35 | 只看该作者
dzkcool 发表于 2015-4-17 09:26. J# d  ?6 K  s; D. Q5 Y
dra文件里面要有焊盘才行。  U& l/ L( }. f2 C! C
你从别人的板子上导出封装之前,把封装库路径(尤其是PadPath)设置到板子所在目 ...

. X" t" s' {+ I" @. s同事直接发的封装文件。现在打算重新从同事的板子导出,再试下。
) {7 x) D1 G+ v% s

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发表于 2015-4-21 08:26 | 只看该作者
原理图上有其他元件用到FPC_10_0_5M这个封装吗?每个都要看下。
1 @  @+ |1 c( q" O5 d5 Z) I6 ]* J如果没问题,把原理图和封装放上来看看吧。

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检查完毕,没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15
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 楼主| 发表于 2015-4-21 10:15 | 只看该作者
dzkcool 发表于 2015-4-21 08:266 T9 p( d3 k8 p5 ]8 z& p" \
原理图上有其他元件用到FPC_10_0_5M这个封装吗?每个都要看下。
  Q0 ~* B( M1 X0 l如果没问题,把原理图和封装放上来看看吧 ...

  L) P8 c3 ]4 ^" d' ~) ~检查完毕,没有其他元件用到这个封装4 u+ d( q5 F2 h

DEBUG_BOARD_0523P1.rar

30.08 KB, 下载次数: 6, 下载积分: 威望 -5

原理图

FT232.rar

19.47 KB, 下载次数: 5, 下载积分: 威望 -5

BRD文件

lib.rar

257.69 KB, 下载次数: 5, 下载积分: 威望 -5

库文件

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我没做任何改动,只是导入了一下网表,没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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发表于 2015-4-21 13:05 | 只看该作者
fangxiaoyan 发表于 2015-4-21 10:15* X) [% ~( c: I
检查完毕,没有其他元件用到这个封装
3 P0 [* U5 ~5 O( F) Q
我没做任何改动,只是导入了一下网表,没发现什么问题。$ J* m2 K" {0 G% r
FT232-eda365.rar (43.18 KB, 下载次数: 2) . p. E2 U8 j' n" W3 w4 X1 {

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我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板框内,其他的元件可以放置。 跟生产网表/导入网表的设置有关么?  详情 回复 发表于 2015-4-21 17:32
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发表于 2015-4-21 17:53 | 只看该作者
fangxiaoyan 发表于 2015-4-21 17:32& ~/ k- ?1 f/ y8 g) V3 J
我这边生成网表无错,导入的时候提示上述ERROR 。以OTHER的方式导入,ERROR中涉及的3个PART不能放置到板 ...
5 C9 i' m$ L" M
我直接用第一方导入,没任何问题。
/ {. l5 f! w7 g8 Z( \

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那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06
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 楼主| 发表于 2015-4-21 19:06 | 只看该作者
dzkcool 发表于 2015-4-21 17:534 J' D# E  U  t' u
我直接用第一方导入,没任何问题。
! T6 |0 `( T  j! W- X4 U
那找不出问题的原因了。
. g  U) Y+ B' g( d" \

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你在我导入的PCB上再重新导入一下网表呢?  详情 回复 发表于 2015-4-21 19:08

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发表于 2015-4-21 19:08 | 只看该作者
fangxiaoyan 发表于 2015-4-21 19:06
7 h3 @( a' w$ g3 Q- V那找不出问题的原因了。
+ K& ^* k; G$ K% B. W& q+ Q
你在我导入的PCB上再重新导入一下网表呢?
0 ]: ]8 m( ^9 D0 c! Y2 M6 h

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导入的选项如图1, 导入报错如图2,  详情 回复 发表于 2015-4-21 19:21
需要先导出网表,再重新导入网表?  详情 回复 发表于 2015-4-21 19:15
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 楼主| 发表于 2015-4-21 19:15 | 只看该作者
dzkcool 发表于 2015-4-21 19:08
6 t+ H* c' J1 {+ a你在我导入的PCB上再重新导入一下网表呢?

1 X8 c+ r, X6 e7 ?2 k需要先导出网表,再重新导入网表?

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先从你的原理图中导出网表,再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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fangxiaoyan 发表于 2015-4-21 19:157 r7 B! m2 p4 A* x* I4 ~& R6 @
需要先导出网表,再重新导入网表?
, u% l, W8 {: s% V% `$ |4 R
先从你的原理图中导出网表,再用我的brd导入网表。
* p- O! n# f$ r

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楼主,以第三方的方式导入你的PCB,OK.  详情 回复 发表于 2015-4-21 19:24
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 楼主| 发表于 2015-4-21 19:21 | 只看该作者
dzkcool 发表于 2015-4-21 19:08
6 F* u1 \% j9 k) ]" y7 E  g# X你在我导入的PCB上再重新导入一下网表呢?

' ?) o5 I5 S/ Q7 y导入的选项如图1,. o. y. C% h" U0 S) _6 k; c

( b! r" ^% B$ ~导入报错如图2,
- z7 o6 w+ x3 N- l

导入配置.png (55.33 KB, 下载次数: 0)

1

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导入报错.png (23.8 KB, 下载次数: 0)

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太诡异了,我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53
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