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又一块PCB,进行了部分改进

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发表于 2013-1-14 19:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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此块板子已经能跑安卓系统了。用的AD10.0画的。但是有个问题,在用FROM-to-edior做T点的时候,经常测量不准,出现莫名其妙的长度。我后来用的NET的功能进行调整的线长。不知道大家遇到过没有?个人感觉没有CANDENCE好用。欢迎大家拍砖。

PCB1.zip

2.22 MB, 下载次数: 775, 下载积分: 威望 -5

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发表于 2015-1-13 17:12 | 只看该作者
MARK...' C$ V0 E+ R+ ^1 z$ v2 {& j) @9 Z
0 l: Y3 N& _* y3 N! s$ n
明天看。

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wanghanq + 2 等候...

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发表于 2015-1-19 16:12 | 只看该作者
这还有说没摸到门的,还给不给作为菜鸟的一点信心?

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发表于 2013-1-14 20:06 | 只看该作者
AD我也发现那个问题!不知道是不是设置问题~!# P/ G0 k7 \# S- T: }
板子瞧瞧,学习下!

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 楼主| 发表于 2013-1-15 08:51 | 只看该作者
评价的人很少呀

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 楼主| 发表于 2013-1-17 08:49 | 只看该作者

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发表于 2013-1-17 09:14 | 只看该作者
还在看,板子画的不错!

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 楼主| 发表于 2013-1-17 10:36 | 只看该作者
Randy1022 发表于 2013-1-17 09:14
  W& l2 |. U; T还在看,板子画的不错!

. k+ F7 v" g5 f4 |( B给点客观评价哈,交流交流

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发表于 2013-1-17 17:44 | 只看该作者
向高手致敬

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发表于 2013-1-21 16:42 | 只看该作者
粗看了一下,一看就知道没有正规培训过的,线宽I2C的两根线线宽都不一致,孔打的杂乱无章,差分线都没有设置,3w规则更是一点都不懂,唉,好好练吧。

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发表于 2013-1-21 16:42 | 只看该作者
走线技巧,。。。该走差分的没走差分,不控阻抗吗?线宽还不一样。一些4mil,一些5mil。孔也没有打齐。你的地平面不是负片层,而是信号层,间距也太近了

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发表于 2013-1-21 18:03 | 只看该作者
高手都是在深山老林隐居啊

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发表于 2013-1-26 08:41 | 只看该作者
太差了。需要狂补理论课。

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发表于 2013-1-30 16:53 | 只看该作者
flyover 发表于 2013-1-21 16:42
7 v5 C! ?5 J' o7 A+ V走线技巧,。。。该走差分的没走差分,不控阻抗吗?线宽还不一样。一些4mil,一些5mil。孔也没有打齐。你的 ...

6 [* y! O  q6 O需要走差分的都走了啊,只是没有设置而已!线宽不一样啊,看看!过空没打齐是指什么呢?板子受层数的影响,确实参考平面是信号层,距离太近是指层叠太近了么?

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发表于 2013-1-31 16:09 | 只看该作者
现在板子高频率跑不上去,大家给点建议,现在重新改版
/ y# b" j5 m% p4 a( ^1 Y# @! n/ h1、地参考平面完整性的调整(过孔位置调整)
% m9 \5 d$ \$ e2、DDR3严格规范走线; C, }7 x/ {9 y+ y! Z  u( @
3、绕线技巧的改善
, r% s4 Y4 f- [% Q7 Z* Y1 @3 b还有哪些比较关键的地方需要改善,大家给些详细的建议,谢谢!{:soso_e183:}

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发表于 2013-1-31 19:02 | 只看该作者
本帖最后由 77991338 于 2013-1-31 19:11 编辑
9 C( @' k/ ^6 _, L7 [) I# Y. m( r
haoshanmi 发表于 2013-1-31 16:09 8 E' ?) H& m: w
现在板子高频率跑不上去,大家给点建议,现在重新改版! {. w$ C' w' k: P3 \/ K' _# t
1、地参考平面完整性的调整(过孔位置调整)
8 f. C( v* i8 K/ |$ ?4 }3 p9 G$ s2、DD ...
$ G4 [( u2 p4 w- c0 l

! p3 Q7 e( V4 p. I) x就DDR部分来说...你的数据线如果实在做不到统一参考平面...那起码也要同组数据线同层...就如DRAM_D0到DRAM_D7这八根线要与DRAM_DQM0还有DRAM_SDQS0这对差分同层 一共4组线数据线....既然你有两片DDR的话....可以考虑下在地址线上串个22Ω的电阻...DDR的时钟差分就不说了....没个差分样子...不管是电阻的哪端都要严格差分形式...而且差分绕线的方法也不对...要绕就在焊盘出来附近绕...不要在走线途中绕....时钟差分等长要求一般是组内5mil以内.电阻两断的走线都要计算在内的....
' h2 t! p/ g6 Y2 ]& ^7 I$ M& s
8 q6 t3 \* s6 t8 \7 H3 T最近做的两块有关DDR的PCB截图....
! }/ b7 m$ c* t( o1 m; j
8 U2 G' I# _* y: w. K. _" U; b+ J) ?

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hqg + 2 赞一个!2层搞定DDR2
haoshanmi + 5 谢谢版主的指点

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发表于 2013-1-31 19:29 | 只看该作者
77991338 发表于 2013-1-31 19:02 4 }: V9 ^: d  @! N
就DDR部分来说...你的数据线如果实在做不到统一参考平面...那起码也要同组数据线同层...就如DRAM_D0到D ...
* N+ _* E, \- |( f" V' v
谢谢版主的指点~!此板子跑安卓系统200M就跑不起来,版主认为哪个地方的不到位是最关键的呢?是否是差分信号的处理呢?当然版主的指导在下版全部都改正!主要是现在时间很急,下一版要跑上400M才行!楼主多多指点下,这方面我们经验很少,谢谢!
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