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ARM+DDR六层PCB,附件是原图,请高手前来指点!!

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发表于 2014-8-2 22:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 w5555456 于 2014-8-2 22:32 编辑 . e! L, B& b; i$ w. Y: T

( {$ l2 \* w( F2 J描述:4 A9 D/ I. f# l9 C! q; m
        1、数据线和DQS均走在TOP和Mid1。长度误差150Mil。
  M7 R6 ^: @4 v- Q5 e6 w        2、地址和控制线走在TOP、Mid2、Bottom,拓扑结构为T形分支等长,CPU分别到两片DDR的长度误差300mil。
) F1 b1 n/ e* M7 }* ^7 r        3、时钟线从TOP换到Mid1,阻抗100欧。+ @- g+ G- S. S4 m
        4、DDR的1.8V走在了Mid2,VCC层主要铺3.3V(给Mid2层的信号提供返回路径)。
7 v: A9 Q  z% W: a& a' ?2 \        5、信号线宽4mil,间距3mil(BGA区域)/4mil(其他区域),BGA区域内的信号线都采用盲孔设计。$ m& Q2 ~6 |, h$ o" c& ]; p8 L8 b
        6、PCB中大部分无关的电路我都删了,CPU还有几个电源没有布,不过DDR相关的基本都弄完了。
7 N1 W. U- ^4 H( F1 J        7、所用软件,Altium Designer 10.0

0 Y& |( {' ?2 o+ M  {2 S% D% c7 J2 H6 O# d
PS:CPU的引脚间距是0.5mm的,过孔用的6/11.8mil,而且到焊盘的距离只有3mil,这样做出来板子焊接时是否会导致短路?有没有改善措施?5 ?7 a1 y/ S- ]2 A( g6 V

. k: U- K/ ]# C# B
' ]; `6 ?9 l1 Y* S. U9 H) x( V" D热烈欢迎各路高手前来指导!谢谢!!!

DDR_XXX.zip

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 楼主| 发表于 2014-8-18 21:40 | 只看该作者
本帖最后由 w5555456 于 2014-8-18 21:42 编辑 7 u8 s2 W* j: D% w
kangguolong 发表于 2014-8-18 16:48
, N! H  X) x# r3 k这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需 ...
, S4 f# g/ j9 `. [; H$ b7 T9 @
- o. l& a9 }; B
非常感谢这位兄台的点评!
3 x0 A1 c5 }0 y: _1、盲埋孔已经去掉了,直接6层的通孔,勉强画出来了,不过电源走的不大好(用盲孔的话总成本会增加大概60%的样子,而且制作难度大了很多)。1 Q. f9 y3 P" b, E, Y3 k
2、差分时钟线绕成了下图所示:
( T6 q7 d2 C, c# f; S" ~9 |
' s* ?5 {4 o) s% u6 i# l3、差分阻抗控制100欧左右,3.5/9.5mil。据我的了解,差分对紧密耦合是为了提高抗干扰能力,如果太过紧密,两根线之间的相互耦合会对信号边沿产生影响,所以选了这个间距。某些芯片厂商的Layout Guide也建议间距不要过小。
' L3 ~4 J' U' R1 C5 D8 a$ V4、数据线我基本都走在了Midlayer1,我用的1W原则,3W空间不够。
& u/ D* D# H  b, T( x( O
* t# h7 W8 n2 x$ c1 [
# s; C: q/ T. x. `1 ~' t! y0 i/ i
' n, U! k# j/ Y) O/ w$ N( }
, G! O% \# z: P' |( i

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 楼主| 发表于 2014-8-18 21:24 | 只看该作者
本帖最后由 w5555456 于 2014-8-19 21:45 编辑
1 @9 Q+ b5 A/ f; Y+ P
zgq800712 发表于 2014-8-17 11:16  a/ {. x7 D1 |- t8 j# _3 F  x7 j
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm
8 p" w; f% o" `* m! ]8 u# H+ j4 A7 D, l7 K: T" l6 j. Y: O
这个板子要什么工艺?打样贵吗?
, r* E) ~* k5 N# d3 k

; ^9 x: p7 c7 H0 Q- |一般的工艺就能做出来,6mil的孔是可以不用激光打的。7 R2 ~9 m$ C7 V, m8 I$ g6 [" P
今天刚投的板,大概240*180的板子,六层,打样3000左右,五块。( s# }$ F) U* C/ O+ m* R" V3 {
在深圳迅捷兴做的,有需要我给你他们销售的联系方式。

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发表于 2014-8-18 16:48 | 只看该作者
这个板子还有需要优化的地方,板子可以不用盲埋孔工艺,这样加工成本会成倍的增加,差分等长绕的有问题,需要调整,不知道差分有没有做阻抗控制,差分线间距过大!另外数据线每一组走线应该遵循同组同层的走法,线 与 线的部分区域间距还是不够3W!还有一些其它的小问题,还需优化。

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 楼主| 发表于 2014-8-4 21:24 | 只看该作者
帖子都好几天了,各路好汉都去哪了???:Q:Q

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发表于 2014-8-5 13:19 | 只看该作者
打开了,看不到东西
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 楼主| 发表于 2014-8-5 21:52 | 只看该作者
zgq800712 发表于 2014-8-5 13:19
+ _$ J+ B; j, r# N9 r- j打开了,看不到东西
7 S- T; B3 A! o1 D' H! w8 u" D
我的软件版本是AD10.0,应该09及以上的打开都没有问题。
2 @( F+ J! e* Y5 d, i试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-5 23:36 | 只看该作者
多AD14了
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发表于 2014-8-6 08:46 | 只看该作者
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁

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 楼主| 发表于 2014-8-7 22:50 | 只看该作者
沙漠风铃 发表于 2014-8-6 08:46+ y! Y4 p+ y$ a5 T9 f8 ^
走得挺漂亮,但是感觉线走得有点多,我看到过,在DDR之间打规则过孔的做法,比较清洁
- \0 F- D# d& Z9 ?( E
呃,,多谢这位仁兄!3 F' H" {' T6 `2 D. B6 k" \8 G  d
话说我这板子有没有致命的地方?或者亟需改进的?

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发表于 2014-8-11 22:01 | 只看该作者
打开了,看不到东西

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 楼主| 发表于 2014-8-12 23:23 | 只看该作者
ROBERTZHANG 发表于 2014-8-11 22:01
% Y- V& l3 I8 g% ]  U* D: H7 G# H打开了,看不到东西

; A. j- |+ u0 A/ P5 c& m5 q& C  K我的软件版本是AD10.0
# H( S5 k8 Q2 ]- o/ ]; j试试工具栏的View—Fit Board功能,快捷键V+F

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发表于 2014-8-17 11:16 | 只看该作者
这个板子 走线进BGA 0.083mm,其他线0.102mm。过孔 0.152mm/0.3mm
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) N/ ~$ s6 j( ~, b* n  A这个板子要什么工艺?打样贵吗?
硬件工程师[原理图+PCB],电驱动方面,无刷控制器,电动工具,太阳能无刷泵,锂电保护板,仅限Altium。

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发表于 2014-8-17 21:35 | 只看该作者
AD的文件就不去看了

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发表于 2014-8-18 09:28 | 只看该作者
3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

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 楼主| 发表于 2014-8-18 21:26 | 只看该作者
hb_ben 发表于 2014-8-18 09:28
5 I# k( y4 O& j& I" p4 G9 [9 A3mil 是不是有点太近了,加工会很困难,一般3.5mil以上还好一点,3mil以上能做的加工厂不多

3 I. _% A4 E7 b  O没办法啊,BGA下面的焊盘间距20mil,焊盘占掉了10mil........
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