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[仿真讨论] 关于我对DDR2走线规则的理解,欢迎高手指点。

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发表于 2012-8-14 21:08 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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发表于 2012-8-15 14:10 | 只看该作者
误差作的是可以的,只是线长长一倍,我们都是做1200mil的。

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发表于 2012-8-15 15:07 | 只看该作者
线宽都是5mil?不应该通过阻抗计算得出吗?

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 楼主| 发表于 2012-8-15 21:20 | 只看该作者
本帖最后由 NIWO99 于 2012-8-15 21:29 编辑 . }" |% ^7 h( Y0 \9 {
rose_333 发表于 2012-8-15 14:10
1 K6 l$ W2 b9 |, l- E. ~1 y误差作的是可以的,只是线长长一倍,我们都是做1200mil的。

1 R3 h& o. {( V+ l5 u, b+ o# C( h( e: b
我的意思是说,最长时不能超过2500MIL.

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 楼主| 发表于 2012-8-15 21:28 | 只看该作者
carolyn8507 发表于 2012-8-15 15:07   V9 C4 t7 P9 _8 D
线宽都是5mil?不应该通过阻抗计算得出吗?
! G7 x5 Y( ]4 D' O
其实线宽是可变的,一般4到6MIL之内,可根据板厂实际生产能力算出。主要是帮我看看线间距和等长要求是否正确,差分对里面是否包括UDM,LDM?我看有些资料上没有要求UDM,LDM走差分?我也不知道这两根线是用来做什么的?

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发表于 2012-8-19 10:09 | 只看该作者
楼主,你使用的是什么软件作图?PADS Layout进行DDR设计是不是很大困难?

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发表于 2012-8-19 16:30 | 只看该作者
DDR2最多能Support 8根DIMM,最外面那根线长估计是不够。相互之间的时序绑定是可以的。

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发表于 2012-8-21 17:37 | 只看该作者
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 楼主| 发表于 2012-8-25 15:44 | 只看该作者
chenlinfeng88 发表于 2012-8-19 10:09 6 @7 W% C8 |5 j) i
楼主,你使用的是什么软件作图?PADS Layout进行DDR设计是不是很大困难?

- {0 h. I6 p2 M( H比ALLEGRO还简单,只是你要会用ROUTER。

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 楼主| 发表于 2012-8-25 15:46 | 只看该作者
jekyllcao 发表于 2012-8-19 16:30 . j/ ~1 `. S! t/ W6 G( o# t9 z
DDR2最多能Support 8根DIMM,最外面那根线长估计是不够。相互之间的时序绑定是可以的。
/ @& j' A3 Q( I# D- U7 O& x$ j9 y# X
ALLEGRO的多线同时走的确方更,听说PADS的最新版本也有这个能力。

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发表于 2012-8-26 22:06 | 只看该作者
NIWO99 发表于 2012-8-25 15:44
0 k( D7 x" c3 v. `$ K比ALLEGRO还简单,只是你要会用ROUTER。
) }4 ^) r& g2 M
但是使用PADS Router画完使用什么进行仿真?

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发表于 2013-9-3 16:50 | 只看该作者
ALLEGRO的多线同时走的确方更,听说PADS的最新版本也有这个能力。

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发表于 2013-9-6 15:07 | 只看该作者
同组之间的误差是不是要去的有点小呀?10-20mil,那绕线狠麻烦啊。绕的狠累人。
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