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VERIBEST 就是现在的WG,呵呵。 ALLEGRO VS VERIBEST) n1 o* N7 D6 X9 g6 m
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4 x1 T" {+ L- d( |0 c! y, \0 Z
长度匹配的布线实现: Allegro―〉手工的方法;Veribest―〉成批量地自动完成(可以将设计时间从2周或更长到缩短几个小时) ! M: g* K2 |, r3 w8 W; m. E
多线并行布线: Allegro―〉一次只能完成一根线;Veribest―〉一次可以多根线并能自动调整,打过孔等等(可得益10倍以上的设计效率的提高)
3 g: S6 ^1 D+ ?动态推挤(调线): Allegro―〉有限的能力(比如出现毛刺);Veribest―〉 随意推挤没有毛刺(5倍以上的效率提高) ; g: X* Y, I* @3 J1 d6 H+ o; q) S
差分对布线: Allegro―〉 无 ;Veribest―〉可自动差分布线(手工布线下10倍以上的效率提高)
) n. U( Y7 Z1 J f, [1 U! y无限次的Undo和Redo Allegro: Allegro―〉无Veribest―〉可缩短总设计时间的10% : v$ a- z/ T A2 f6 Q
集成的库管理: Allegro―〉功能有限;Veribest―〉需很少的数据切换 9 W6 U9 O/ t& W/ X
原理图和PCB的集成: Allegro―〉基于网表的;Veribest―〉无缝集成(更出色的ECO和BOM,100倍的设计改进) * k5 |, t& U9 Q% P" E
中文输入: Allegro―〉不支持;Veribest―〉原理图中输入中文,PCB任意位置任意层输入中文,支持全部字体
% B6 {; x7 R3 t) q使用Veribest的酷功能
9 \. l% R* ^; a. I: b' B1. 差分对/多线布线 - ^% H- b" s9 }$ {4 t6 X0 G" ?+ [) T# \
2. 高速网线的动态调整(比如可以调整或推挤蛇形线,而蛇形线的形状和长度可以动态的保持不变)
. I- S: u% R! K5 v3. 可以敷铜区中进行布局布线,并可以在已敷铜区域内推挤布线、过孔,移动器件
! z. E* M" {7 p1 }4. 在一个集成环境下的单一layout设计系统(交互布线与自动布线统一环境)
2 F7 L) B( K9 w; K5. 基于形状的交互布线和自动布线
! K0 k7 C; ?( a. N% t. H6. 动态改变线宽和过孔大小的规则区域定义; % x" E5 {3 d( C( n/ ^6 J
7. 能将电路从一边推挤到另一边
# `+ e8 K5 }; d0 X @# j4 E8. 能将过孔合并到其他过孔和引脚; # B/ o3 C; T) C* H8 K0 {4 ^
9. 敷铜区易于编辑、拷贝和移动;
# [* C3 C$ e3 n. ]7 Y( S10. 器件在动态敷铜区的移动; 5 s, L1 V$ Q6 t U; H/ p3 U
11. 提供BGA扇出模板;
! z* A& a5 m* d! ?12. 可以显示引脚号;
" f& o' }& D3 b( M13. 动态“冒险”显示;
% D7 @+ o% V( Q1 ]# D4 w i3 v14. 动态曲线调整(高速约束线); ! U1 ~* \) t# I. Q
15. 钻孔显示;
4 B' i S( z; z! A1 y, _16. 多线布线和多线自动连接; . j0 Q5 c/ H( Z* j: H0 _" H
17. 选择能力(特别是被选中的网线固定);
* H( K7 p! @- q' {, ]18. 差分对自动调整;
7 K: t2 ?& n: @1 r* ?6 z9 s19. 动态自动调整; ! X/ M7 f+ j; }4 a) B, n' l
20. 按网线/错误着色;
* N9 C, r) J/ i5 y+ \- Y21. 自动的热焊盘旋转; 3 Q7 c4 z) o) p( e# N- t
22. 丝印字编辑; 5 u: E, o3 a1 s8 n, F' b/ [) o5 l
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