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Cadence有装配层。Protel需要吗?

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发表于 2014-12-13 18:52 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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  今天学习Cadence看到下面红色颜色一句话:
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴片时就需要装配层来进行定位。
   想请教大家,如果我的Protel器件只有Toplayer层和丝印层,贴片机贴片可以进行吗?因为我好像在Protel里没见过装配层这个啊!
$ @9 j# }. W( _4 [2 K; W- O% e
! l* u0 b8 c$ H% ]- |1 J

. S* o& [# q& k. [/ X9 h2 `: c

1 S+ C+ T% l# k9 B8 q

1.png (10.14 KB, 下载次数: 3)

1.png

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没有强制需要...  发表于 2014-12-15 12:24
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发表于 2014-12-15 15:54 | 只看该作者
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴片时就需要装配层来进行定位
; `( U4 A' u( x- E( Z
& s: u: i4 w& d+ p& ^/ N这句话不太对。, X* T0 V/ f- H+ Z% F
2 l- U. O1 D: n9 _# |- s, w; Q& S
如果是贴片机贴片时,我们需要提供钢网文件和钢网层,也叫锡膏层,paste mask top和paste mask bottom.与allegro软件不同的是,ad可不无需单独设置paste mask层。在出钢网时,勾选paste mask就可以的。) J- E4 v- b1 Q+ |( b; K  {3 ?; O
6 F9 M* Y% p' v: G! U6 j" ^
如果是装配图,只需要输 出器件位号和丝印框即可。
- W( f# a7 s' S  T! U
1 x6 e$ A7 G4 X9 ~/ o' s7 w& j不知道楼主那句话是从哪里看到的,我感觉是有问题的。
专业服务:(价格面议)
代写作业
拉等长
调丝印
喂猪
欺负同学
打老师

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发表于 2014-12-15 12:10 | 只看该作者
本帖最后由 wanghanq 于 2014-12-15 12:15 编辑 # q* o  E# ]- l: ~3 M( u9 G

  f1 F( L: D) k# A; W根据不同的检查项目,我们会生成各类图层文档。
' H* t3 @0 [+ y8 N. S; ^对于贴片机,通常会 要到的文档 : BOM,坐标  以及其他。) j  v- |! P: Y8 P5 R' g8 h, M# f

0 B7 ]: J- w; ^1 Q; b6 s此话题需要拓展下面相关的内容:; ~& A8 F, q. |3 E, ~& |
) c+ X; y1 `/ t* A( E3 m4 R( D7 [
贴片机编程6 w/ J( p6 n; K4 @' y2 p# V: _
http://baike.baidu.com/link?url=mfVSgwyoXfHGKA4K18pawxOALwczxuqQM091Of9ScpZP1xu7Qk_v3oau00c6YAz4fN5t0Vi8Bdz8qOzDDIbi2_
) D8 J3 K  {6 i0 j
' c$ j% o/ h' T, b1 ?Cadence各层作用及封装信息传输对应关系  此文未下载,欢迎有下载积分网友下载后补充在帖子中来- v! S% o5 k. F3 E/ h  c8 D
http://wenku.baidu.com/view/269457535f0e7cd1842536cc.html
" ]+ E6 o0 H* p! W+ S2 y
2 R, U6 O0 t- r$ z2 R2 XPCB设计软件坐标数据导出方法综述.pdf9 r, ~# X# ~  _- \( ?
PCB设计软件坐标数据导出方法综述.pdf (368.91 KB, 下载次数: 24) ( n7 L9 z& N0 y2 \  Z% L

- }2 W9 V' {  s: D" t对于你提问中提到的这个层,可以理解为自定义层(有用到的也有不用到的),
1 o. P$ M7 n- f" R1 y. A7 b/ F; r2 W在AD中建议你不妨看看最新的PCB封装,里面会有更多的信息层被定义到。9 ^5 D& Y' ^, d! B1 `
不同的软件 层的定义以及使用限制略有不同,我们在学习这类软件时,不要生搬硬套...) A( X% ^  }/ ~# Q( i8 f

, [- @9 s6 i3 [此主题贴 已汇总在 【给初学3-】系列汇总贴中) G( Q5 ^9 X+ i, b# H+ _

6 e: K, J+ e8 [7 k, X
; K) O3 ^' O  ?1 F2 O8 K7 P* @

# t" C  e7 {. F/ f4 g
业余,多多指正指教。

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发表于 2014-12-16 22:26 | 只看该作者
在机贴焊时,Cadence的我也基本上没用过Assembly层,其实所谓的装配图就是客户拿到PCB板后来比对查找器件所用,与是否机贴焊无关的,机贴焊所用定位是用器件坐标及BOM,以及MARK点来定位的

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发表于 2014-12-17 08:46 | 只看该作者
装配层是一般是在焊接的时候,给个示意图。因为PCB上的Topsilk有的时候不能定位得很清楚。

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发表于 2014-12-20 10:14 | 只看该作者
jimmy 发表于 2014-12-15 15:54' W$ ~2 j8 R' S! H/ d
装配层(Assembly):用于将各种电子元件组装焊接在电路板上的一层,机械焊接时才会使用到,例如用贴片机贴 ...

7 T. |4 K  I, j0 \" v从楼主提供的文字大致能够找到的源头文档参附件(按说楼主自己来提供是最好的)。0 m7 k3 A; y0 F% W
此附件前面描述可能加有自己的理解,但在后面操作描述中还是很清晰的...# l$ h$ W3 L3 U4 a, ]4 v
" c0 g% V2 }4 F+ [3 I: i& k
Cadence_Allegro元件封装制作流程(含实例).zip (1.12 MB, 下载次数: 30)
* Z2 l0 f% n9 p9 q
业余,多多指正指教。

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 楼主| 发表于 2014-12-22 22:00 | 只看该作者
感觉大家的知识都好丰富,学习到不少东西。

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 楼主| 发表于 2014-12-31 22:20 | 只看该作者
wanghanq 发表于 2014-12-20 10:14. t% v' A* i$ Z7 ^' r7 @# w
从楼主提供的文字大致能够找到的源头文档参附件(按说楼主自己来提供是最好的)。
( X% t! e, |, w) V6 _: U( F4 s/ ?此附件前面描述可能加有 ...

8 B. f* C6 Z. c谢谢。你好仔细啊,就是你附件的这个文档。
- g) o# B0 r( n/ ~' w

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发表于 2016-1-11 19:30 | 只看该作者
谢谢楼主和6楼

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发表于 2018-6-14 10:07 | 只看该作者
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