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求助，8片DDR3可以正反贴布局吗？

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发表于 2013-6-9 13:03 | 只看该作者 |只看大图回帖奖励

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大家好！DDR3 指导书要求FANOUT分支要短，如果正反贴，FANOUT分支就超出200mil以上了。DDR3是96PIN的，0.8mm间距，
要布局单面的话，占板面空间太大了，这种情况大家是怎么处理的。
如有实例PCB请分享下咯，非常感谢{:soso_e163:}
看帖的每人一个粽子{:soso_e177:}，{:soso_e100:}

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发表于 2013-6-9 13:24 | 只看该作者

本帖最后由 jimmy 于 2013-6-9 13:36 编辑

DDR3我们通常采用fly-by的拓扑结构，采用正反贴错开布局

最近我们也在做16片DDR3的板

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支持！: 5.0

谁另莪吣淡

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我感觉好厉害！实在佩服啊~！发表于 2013-8-8 08:55

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太太太强大了。。。。。发表于 2013-6-29 11:09

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非常好，学习了！发表于 2013-6-13 01:10

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3^#

发表于 2013-6-10 10:11 | 只看该作者

太厉害了{:soso_e179:}

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发表于 2013-6-10 10:48 | 只看该作者

顶，又学到了。{:soso_e113:}

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发表于 2013-6-10 11:37 | 只看该作者

厉害啊

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发表于 2013-6-12 22:46 | 只看该作者

{:soso_e179:}

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楼主| 发表于 2013-6-13 01:14 | 只看该作者

本帖最后由 leese2002 于 2013-6-13 01:19 编辑

{:soso_e178:} {:soso_e179:}{:soso_e163:}
16个DDR3，地址线要很长吧，控制在多少范围呀

5555.jpg (315.58 KB, 下载次数: 6)

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发表于 2013-6-13 09:26 | 只看该作者

leese2002 发表于 2013-6-13 01:14 * Z- [ s. p! h% O5 ], c7 R
16个DDR3，地址线要很长吧，控制在多少范围呀

CPU到第一片的长度<2500
第二片到第三片的长度<650
依次类推

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9^#

发表于 2013-6-13 09:33 | 只看该作者

DDR3 地址线是菊花链，只要在每个DDR3等长就可以了，DDR3 有个写平衡控制，ddr3控制器初始化的时候，会自动测试 DQS 与 clk 是否同步，如果不同步，会自动延时DQS. 地址线与CLK 等长。

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‘菊花'嘿嘿发表于 2013-6-28 14:10

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楼主| 发表于 2013-6-13 09:56 | 只看该作者

jimmy 发表于 2013-6-13 09:26
% m! Y( T0 o5 v+ y' b" ZCPU到第一片的长度

{:soso_e178:} 谢谢
16个DDR3，靠边上的DDR3远离CPU,这样数据线长度能要控制在多少合适

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<2500 发表于 2013-6-13 11:14

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楼主| 发表于 2013-6-13 09:58 | 只看该作者

pmp_mcu 发表于 2013-6-13 09:33 2 h! a% v( y b/ H8 k+ g8 i1 @" }" ?
DDR3 地址线是菊花链，只要在每个DDR3等长就可以了，DDR3 有个写平衡控制，ddr3控制器初始化的时候，会自动 ...

{:soso_e178:} {:soso_e163:} 谢谢

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发表于 2013-6-13 15:20 | 只看该作者

2楼太牛啦

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13^#

发表于 2013-6-13 19:00 | 只看该作者

学习了

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发表于 2013-6-28 10:20 | 只看该作者

学习

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15^#

发表于 2013-6-28 14:12 | 只看该作者

搞了快两年的平板了也没有机会自己弄一板DDR来跑一下，唉，啥时候才有机会自己的搞一板DDR的板子。每次都用公板，不管公板有多烂都不能自己弄DDR部分。

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