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2017年7月19日公益PCB评审报告节选

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发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.
2 }2 u% O* }, x7 m( J' x1 h 5 f# ^; L& V9 I8 x' h9 h
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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:323 \8 T, c5 l2 G2 L
请问这条如何理解? pcb小白求教

% G( ^6 F, e7 k1 `1.平面铜只有一个VIA,肯定的说这块铜没有作用.6 `: @/ B+ Z! l( C
2.电源被VIA隔小了,电源通路太细.
" l! D* D4 p; V$ ~

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:585 E3 |1 N8 s8 o
10.  平面铜只有一个VIA,电源被VIA隔小了.

, d2 m2 Y  Y# ?- a: x7 K8 @) L& z2 k请问这条如何理解? pcb小白求教5 s+ S$ V* `; }0 E' ?9 U

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.$ ]' P2 C& h' n! H) k+ s

$ e( k9 t9 F5 ~, h: ]4 p7 I

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 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.
  h- n1 f: |" b" q
* c" Z8 f7 Z* _) I5 |9 V

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 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.' N" r: B! n& b) z7 {1 r

7 w" c0 L, ?! R# [& j' F6 b! P9 o

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 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.
& {% i$ U0 w9 P) N, g" c
8 i; H* t1 C/ \, P3 _- ~( M9 k! A# k

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
8 e2 b3 D3 @' O8 p$ g& I7 w5 r
6 S  j" i4 Z. x; Y% k, J" L6 b

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
' H$ s: F+ Q! E* a# r
* g4 t) ?; C3 H- D4 G; \/ M

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.9 x: q# h  N% E8 x1 M
& [7 N  g3 j9 o# F

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.
( z. v* h, R) e' N6 M 8 V* Q' @. K. V  W" @) A

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 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
9 G0 B" T( \3 \+ a+ H
4 T+ a3 U' X4 R: K9 v3 n4 e6 n

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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发表于 2017-7-20 11:31 | 只看该作者
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发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
( c, W7 m  w$ U9 T. e& O* p

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发表于 2017-7-21 08:43 | 只看该作者
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