Net wire has multiple net name

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在使用AD10的时候出现以下编译错误
Net wire has multiple net name（Net label SRAM_A0. Sheet Entry U_SRAM_Interface SRAM_A0(passive)）
/ Q$ g2 w8 O1 ^Wire SRAM_A0
% Y& s/ s6 G0 N3 cNet label SRAM_A0
Sheet Entry U_SRAM-Interface SRAM_A0(passive)
) K% M2 M7 K, h& d
sheet symbol的图纸


总的sheet的图纸
3 _" }, f: |6 V/ s5 C) M
# s/ k% l, A0 N& V0 p9 D4 A& z
8 P5 Q2 Y; C  H. [为什么我所有的net name都是sram_a0，他还是说我在一根线上有多个net name。而且仅仅是warm，导入到PCB还是sram_a0, 不影响PCB layout
. [; C$ \  i6 w) m很纠结，因为一编译message满是这种错误，也不知该如何解决。很烦

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仅当我将project->project option中的Net identifier scope更改为
" R" r3 V8 R; m' V  k3 r+ iGlobal (net label and port global)
编译错误会没有，但是这非我所愿，很纠结