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2D line 如元件外框 為什麼設于all layer ? 期待大家討論關注..

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发表于 2008-8-29 18:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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情況說明:
0 Q; T7 ~; t+ a. c  n6 \我在DECAL DEIT環境下分別在primary component layer & silkscreen top & all layer 用2d line畫元件邊線.后保存為part type. 8 {2 [) P; D3 z% {
調入pcb layout后,經板層色彩設置后,三個邊線均正常顯示.(當然,在silkscreen top上的邊線顯示為黃色,其餘兩個邊線顯示則一致為灰色).但在導出cam時,我只應用默認設置導出.發現在cam中打開后,唯獨不見primary component layer的邊線顯示... u# ?  b& [+ X# v) [
經本人苦思冥想,終于知道為何...原來在cam輸出設置時,不可應用默認設置(我指的是如果你的邊線設在了top layer的話).在select items中設置primary component side的items on primary 要勾選outlines一項,如此作previw便可發現設置在primary component layer的元件邊線終於露出了可愛的面目.如下所示:
$ w" }/ `& [+ {: h' U2 C) V $ I: S' X8 z) O1 ]3 p4 w: S
以上只是自己摸索出的一些設置,但可惜的是只是解決了具體的問題,卻無法總結出真正的原由....
7 F8 @/ x) d9 d+ V3 f" @  g於是便不可避免地產生了以下問題,希望版主可以指點一二.....+ e# J( h$ Z; e' o
2D line 如元件外框 為什麼設于top layer ?設于all layer為什麼也是在layout中可以顯示的?
% L, g- g1 K8 i7 i' N- @兩者有區別嗎?- y, x& T3 Y9 K8 j5 C
為什麼又可以設於silkscreen layer? 0 H* _4 U& T6 n
且以上三种設置均是可以輸出gerber的?
( t" G1 G2 n$ y) B5 B% N/ C8 P它們各自的分工究竟是怎樣的?$ {0 Q: t# a$ }: L6 R9 x) v7 o
以上菜鳥問題,還請高人指點.謝謝.2 d8 Z* E8 Q% L$ Z- H# I$ d; c* @

5 j+ q0 b* f# k1 j1 j+ {' b[ 本帖最后由 stqw1987 于 2008-8-29 20:36 编辑 ]
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发表于 2008-8-29 20:12 | 只看该作者
元件外框建议设于all layer2 _+ A; E7 M& p" ]) |: @6 z

$ _- _4 E* |: e* v之所以不设在screen或top,是因为出丝印层的gerber时,系统默认是all layer.
3 f6 J* D! P' A: ?" u# Z% ]9 m2 ]! \( s8 z0 \) S: K
当然,你也可以设在screnn或top层,但是出gerber时要添加进来.
" M4 q3 q- \8 ^* f* i% E0 {) r2 I' I/ D& Y* A+ I
建议:做元件封装时外框统一设置在同一层。
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发表于 2008-9-2 10:02 | 只看该作者
https://www.eda365.com/viewthread.php?tid=4756&page=1#pid40952
& F" m: U2 Q: f4 q$ n* j7 p" ^10#,希望对LZ理解有所帮助。
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 楼主| 发表于 2008-9-2 21:46 | 只看该作者
我看了,不過覺得不知所以然....
8 h! r& ?5 B0 Z$ ~8 m+ J  F這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....
, l6 a0 f) M. E& I  ohttps://www.eda365.com/thread-10203-1-1.html
* u, I1 d" ~1 m# a( u, o還請高人指點.
, D2 h! o+ z6 U# E
. o* V+ L% |# G/ B$ f. t1 }8 B[ 本帖最后由 stqw1987 于 2008-9-2 21:48 编辑 ]
Not necessarily to be strong , but to feel strong!

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发表于 2008-9-3 09:29 | 只看该作者
Original posted by stqw1987 at 2008-9-2 21:46
/ ?, [2 Q9 |' m- \我看了,不過覺得不知所以然....
  `- S# o0 M+ C) Z這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....
% ^' ?, j  d( g. ?+ j) Fhttps://www.eda365.com/thread-10203-1-1.html
' F& M: C6 F# ^/ @( P; i還請高人指點.
+ a; B( m0 s" j& ]& G0 o8 n, Q$ [( U1 z7 C8 u9 t9 I
[ 本帖最后由 stqw1987 于 2008-9-2 21: ...
* H* X! z& P+ F& H0 `2 n
可能是我表达问题,哈哈,如果实在看不明白,咱们可以通过邮件慢慢讨论,我的邮箱请见签名档。
/ j( M. |  E0 Y( N7 X8 ^( {难怪有这么多人在问这问题最近,唉。。。。。
r_agreement@126.com

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发表于 2008-9-3 17:42 | 只看该作者
元件外框设为ALL LAYER层,就说明在任何一层,外框都能显示出来,而元件封装本身有个属性,TOP/BOTTOM,而外框是属于元件封装的,所以元件封装在哪层,也就跟着是哪层了。 总之就是将外框设为ALL LAYER层的好处就是外框始终是与封装在同一层。不知我的理解正确与否。

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发表于 2008-9-6 15:44 | 只看该作者
正确!就是如果在封装里标注字符如:1脚orVCC等就会在DRC时出错的。

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发表于 2008-9-6 19:14 | 只看该作者
怎么是繁体字呢

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发表于 2008-9-6 22:54 | 只看该作者
个人认为这个比较灵活    也就自已灵活处理
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