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亟待高手解答

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发表于 2013-6-6 11:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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为什么PCB中有参考电源层和地层这一说法??不是一般都参考地层吗?为什么电源层也可以参考??到底是什么意思?请高手帮忙解答!!
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发表于 2013-6-6 12:46 | 只看该作者
誰說的?
$ a% j* v- Q9 }& P1 I; P
% k! k2 A! z; m1 \$ y8 G{:soso_e101:} ' P7 r- u( c' D$ j$ F/ `% e+ V

" Q, T% T) w. t( d* Q7 D$ R0 t7 @# G高頻的東西,把地掏空、只留電源層試試看!/ Y/ X- p7 L; F2 Q8 S/ ~# k
1 U; P+ q) E9 ~7 h+ m
{:soso_e119:}
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 楼主| 发表于 2013-6-6 13:13 | 只看该作者
超級狗 发表于 2013-6-6 12:46
4 K6 ~) C  A# v誰說的?
1 s# m, A. U& m, ?6 f% N4 B- h) z( C) k$ R- I  |
& u0 M7 T4 T5 M( k6 u% g! J
不太明白狗老大的意思?能说的具体点么??

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发表于 2013-6-6 14:03 | 只看该作者
Jean_psz 发表于 2013-6-6 13:13
  F+ L, @5 X' }+ ~0 F8 X; e& `不太明白狗老大的意思?能说的具体点么??

! t1 N2 W* |: Q* `
  P3 C8 z) E, ^6 [7 |( P樓主講的應該是有些 Stripline 或 Micro Stripline 文章中的這段話︰
- k. Z* m2 ]: W3 w0 P6 C5 q6 L
" b9 I' y  N1 j; rNote that the figures below use the term "ground plane". It should be understood that this plane is in fact a large area, low impedance reference plane. In practice it may actually be either a ground plane or a power plane, both of which are assumed to be at zero ac potential.
: e4 l& P$ Y1 R- L  B, u, D5 ], n
  `- n: Z2 V; ]. G) C4 X; q2 B  R8 L但注意到最後一句,電源層交流電位(Power Plance AC Potential)要為才能符合條件。現實世界中沒有電源層交流電位(Power Plance AC Potential)的環境。電路中有處理器(CPU)、內存(Memory)、邏輯閘(Logic Gate)......工作時會產生電流擾動。除非負載是一個純電阻,這樣交流電位(AC Potential)就會是零。7 ^% V5 M& s$ I

6 |" G& h: y: }% \" N  M所以,以敝公司射頻(RF)人員的設計習慣,一定都是參考地、而不是電源層。四層板阻抗線走背面,第三層(VCC)掏空、參考第二層(GND)。4 w) V9 _2 h2 [- c+ u
. r% ~  L' i) K9 s  S# L! @
{:soso_e183:}
: \! j9 g1 {6 a, h
0 ~: k2 x" e. E3 d& Y1 ]

Impedance Trace.jpg (21.2 KB, 下载次数: 0)

Impedance Trace.jpg
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 楼主| 发表于 2013-6-6 14:09 | 只看该作者
超級狗 发表于 2013-6-6 14:03
. R- N! W4 G9 @7 v! b樓主講的應該是有些 Stripline 或 Micro Stripline 文章中的這段話︰0 Q5 Q+ ?1 U# G7 b! R4 @" N

- q- s# F5 Z( K1 f5 \Note that the figures below  ...

: R9 {( o% s5 h3 ?/ a谢谢狗老大,不过还是不太明白什么叫電源層交流電位(Power Plance AC Potential)??

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发表于 2013-6-6 14:23 | 只看该作者
Jean_psz 发表于 2013-6-6 14:09 ( W$ Y8 |- x& F: f. w  Q2 I
谢谢狗老大,不过还是不太明白什么叫電源層交流電位(Power Plance AC Potential)??

3 G4 j! e. h% `; v就是你電源層不能有交流電流,有電流變化微觀上電位也會跟著變化。7 G6 G1 i5 l; q5 r( g8 U
8 r: U6 p8 s0 C* E; r( b
我們觀念上電源層等電位,是假設銅片很大、電阻為零,但微觀上銅片上還是有電阻,電流流過就會有電位差。+ Q. Z* a8 o0 Q5 H$ x: u

& M/ o& E+ ^+ g. h{:soso_e100:}

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 楼主| 发表于 2013-6-6 14:29 | 只看该作者
超級狗 发表于 2013-6-6 14:23
9 Q: Z/ I% F7 f  g! r. y  j就是你電源層不能有交流電流,有電流變化微觀上電位也會跟著變化。
( {3 E$ P$ i1 a; }& y) c& q+ A+ P2 D% M) Y
我們觀念上電源層等電位,是假設銅 ...

4 j' k2 L6 {7 w3 \原来如此,多谢了!

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发表于 2013-6-6 22:25 | 只看该作者
看什么类型的电源和什么类型的信号了。内层的信号,一般两个参考平面,一边是地,一边是电源,也没事的。参考平面是做个回流和阻抗控制的。如果是四层板,不是射频信号,电源波动也不大,完全可以参考电源层。如果信号要求高,一般没人选择四层板设计的。

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发表于 2013-6-7 00:37 | 只看该作者
kk_wishes 发表于 2013-6-6 22:25 , ^7 Z: x0 q5 f4 ]: g
看什么类型的电源和什么类型的信号了。内层的信号,一般两个参考平面,一边是地,一边是电源,也没事的。参 ...

3 @. m, d$ b3 x( nFM 75MHz 開始就有了,AM 更低到 500KHz!1 h# t, \' d* L2 J+ b

7 o, p$ T5 Q  N) c^_^
. @9 }/ a& [  }4 [3 G0 E- {5 R7 Q+ k' r7 G
{:soso_e113:}
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发表于 2013-6-7 11:21 | 只看该作者
超級狗 发表于 2013-6-6 14:03 + s; d) ~! c3 f7 p( K
樓主講的應該是有些 Stripline 或 Micro Stripline 文章中的這段話︰
/ q( p8 }4 }8 r
+ l: Q; }  s5 W$ O2 ~8 Q9 \Note that the figures below  ...
- q4 ^4 g" R: m/ w* d6 E) E" R

7 J. c' h% E+ X, u( C  oPower Plance AC Potential要为零是不是可以这样理解,比如电源层是3.3V的,整个板子上会有很多3.3V的滤波电容(0.1uf,0.01uf),这样是不是可以近似的理解为Power Plance AC Potential为零? 所以如果非要参考电源层的时候必须在该走线附近加些电容。  不知道这样理解对不对?

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发表于 2013-6-7 20:17 | 只看该作者
超級狗 发表于 2013-6-7 00:37 - D7 c- F" x: _$ f
FM 75MHz 開始就有了,AM 更低到 500KHz!( o4 s7 H" T. @% W/ g& l

: ~/ d. K* N! E8 w0 K) D4 o^_^
( A$ D5 k. _! ]6 f0 m0 n
他问题里面没说啊

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发表于 2013-6-7 22:10 | 只看该作者
参考哪一个平面是可以选择和优化的,以DDR3-1066 UDIMM Systems设计为例,若芯片内部某IO Pad参考的是电源平面,则应确保trace以power为参考面,已确保最小回流路径。   l2 \! T, U( O/ C

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发表于 2013-6-8 20:20 | 只看该作者
本帖最后由 超級狗 于 2013-6-8 20:21 编辑 - T" A' T  S% v' v  P" ~* h; W/ c

$ }9 a& R  T7 {5 r3 {' R/ OBoard Stack-Up3 D- L% {5 y# k, F. s; C" t, h
Freescale recommends placing all DDR signals on critical layers that are ground-referenced, which ensures the lowest impedance for the return currents and provides improved signal integrity performance.
& R/ }3 {- n4 F) N; J: i5 B. h' `3 i! [& V: _9 i
我想大家繼續搞下去,可能連鐵框(Metal Can)也能 Reference。# o9 ]3 t8 ?* m: \
* T, Z0 W0 v' t
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发表于 2013-6-8 20:35 | 只看该作者
xiongbindhu 发表于 2013-6-7 11:21 . l" A+ f  p  w8 g( V+ X+ S
Power Plance AC Potential要为零是不是可以这样理解,比如电源层是3.3V的,整个板子上会有很多3.3V的滤 ...

; m9 z8 B0 |" d! S向射頻(RF)主管請教了這個問題,他說理論上是對。但要放多少濾波電容才能達到顯著的效果,值得商榷!
; V5 u+ n  p$ H
$ H# W. m; O7 X3 ]{:soso_e101:}
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发表于 2013-6-8 23:15 | 只看该作者
理论上只要是个平面就可以参考,哪怕是没有网络的铜皮。但是回流路径到芯片引脚附近时候,最终要回到芯片的地上,需要让这个参考平面和芯片的地形成低阻抗的交流通路,也就是加无穷大的电容。不然就会出现阻抗不连续。  所以最理想的,就是直接参考一个完整的地。  参考电源的话,最终的回流照样是通过去耦电容回到地的。

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  发表于 2013-6-28 17:46

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