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一个DC-DC电源转换,纹波有点大,传上原理图和PCB图,请大家斧正。

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发表于 2013-5-31 22:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
用AOZ1050PI设计的一款DC-DC电源转换,输入9~18V,输出1.2V,AOZ1050开关频率500KHz,现在用示波器测得输出大概有100mV,Vp-p在485KHz左右的纹波。
8 _3 [) p# ~" s2 W" ^
9 f: Q3 b7 ^) k请问各位专家:
+ ]  e: F% T+ o  f" C, X' Q) |3 `, |1、这个指标的纹波是否在设计许可的范围之内?在一般情况下,DC-DC电源转换的纹波在一个什么范围内可以认为是正常的?$ f) C: l) K, N
2、从原理图上,PCB图上,这个设计是否还能够进一步优化降低纹波?还请指出。
- ^2 d5 d% J" u/ I4 d* W
1 q& ?* i/ q) T+ u+ B0 b3 m敬请各位斧正。  \6 H: i+ e7 M9 S

7 W1 Z* ?' B$ @- N+ J
+ D9 Z5 T& b2 U* H8 N! J& f
4 U0 e- ]' H1 ^6 g# |
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发表于 2015-5-28 20:17 | 只看该作者
ann_wz 发表于 2015-5-28 19:56
5 E9 N( s0 d7 m+ d) w: s0 }0 M敢问师傅,本公司某些人才,要求输入电容跟输出电容的必须要共地,我想问一下,输入电容的地跟输出电容的 ...

9 _& a0 a& T* u3 J! ], j: u你们公司的人才说的对,输入和输出的电容必须共地,而且要靠的很近。
# \& K0 C3 X: ^! K+ b这里主要是考虑两个环路:
* y* L/ x! y7 L7 Y2 g  j1 打开MOS管,CIN-MOSFET-LOUT-COUT-GND-CIN
# G: S. B; u& j5 l: s- j4 c2 关闭MOS管,LOUT-COUT-GND-DIODES/MOSFET-LOUT' x$ n# g7 B6 g' `$ i* }0 i
PWM使得MOS的开关和闭合,导致环路缩放,这样会引起辐射,缩放的比例减小可以减小辐射。
# {2 I4 ]  q! |' h' N. \8 P6 }1 w# |- q8 q' B5 X3 w
6 S/ Z% r( u" `

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我一直对于回路面积的计算很不解,,有资料说器件放一排,从地平面回流,这样面积最小了,fallen大师,对于回路面积的计算,能不能举个例子说明一下那样布局会回路最小,如果在把开关器件放在同一面(不一定回路最小  详情 回复 发表于 2015-5-28 20:52

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发表于 2014-5-30 15:59 | 只看该作者
建议楼主将C60换成两个陶瓷22uF电容并联,不建议用电解。
- n+ k, O2 _( H可以在不改布局情况下,将电容换了试试。9 l2 ~8 N; A+ h/ D" M0 y
另外,纹波测量,跟测量方法有很大关系,尤其是地参考点的选择。' ]& u# x( S" I0 Z1 K9 H
(这个啰嗦下,前阵子,做的一个DCDC,芯片是踢哀的TPS54527,输出用的钽电容;测量纹波用的是就近找地参考,示波器的夹子夹到钽电容的负,示波器探针测电容的正,结果纹波80mV+;将钽电容换成陶瓷,测量方法同样,纹波60mV+……没达到手册的指标。。。。后来,改了测试方法,用示波器带的测小信号专用的夹具,纹波一下子到25mV以内了。。。。说明测试方法很重要,测试方法不得当,会走错路的。)
& \; U0 k* o2 `( |* e6 s5 g; H
不要痴迷于阅读成功人士的传记,从中寻找经验,这些书大部分经过了精致的包装,没有人会随随便便成功。更不要痴迷哥,哥还没成功!

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发表于 2013-6-1 19:54 | 只看该作者
jielove2003 发表于 2013-6-1 14:05
; _- H3 l) _. ^6 d" u非常感谢热心的超级狗大侠的提出的建议,提得很中肯。
# z" g, }& b: b1 J' e
! \& }0 h9 q6 y, k. `3 `1、在改版中改善。
8 d: Y  o: N" P3 H* r! b# K
兄台也不用客氣啦!以前有人上傳 PCB 圖請求 Review 協助,但因為這工作需要心無旁鶩且較耗費時間,過去都沒有幫上忙,今天早上剛好閒來無事就看了一下。
8 X  @8 k% D6 A5 O# [- V. k! [' c# r* s
不過要讓老闆知道放著公司裏的事不做,還幫外人 Review,吾狗命休矣!$ t- B& t0 V* K4 b7 S, S7 E
% M+ e+ B9 ~5 k4 F
{:soso_e127:}

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师傅牛逼  详情 回复 发表于 2015-5-28 19:51
哈士奇是一種連主人都咬的爛狗!

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发表于 2013-6-1 10:05 | 只看该作者
本帖最后由 超級狗 于 2013-6-1 19:57 编辑
) D8 p7 t+ F, s
1 w1 f; H. Q2 O" S5 C100mV 的紋波(Ripple)對數字線路應該沒什麼問題,對模擬線路就看情況了,有的線路很敏感需要更低。但芯片資料展示在滿載(Full Load)狀況下,紋波(Ripple)可以壓到到 20mV 左右。
4 w  w- _+ L8 ^; y7 N1 t, F( [) `6 T  h8 q2 m
佈線建議︰
1 j+ k, P" }# D6 x6 ^
  • L2 在上方但 FB 在 AOZ1050 Pin 4,造成反饋路徑繞了一大圈才回到芯片。將 L2 移到下方,可以縮短反饋路徑。
  • AOZ1050 Pin 3 Power Return Ground 只有單點落地顯得太單薄,要注意一盎司(oz)銅厚下,10 mil 的落孔只有 0.8A 的承受力,如果是使用十字線接地,就 4 條十字線加起來可承受的電流。宜將地鋪大,並多打導通孔與背面的地連通。
  • 注意芯心片資料上的 AOZ1050 Pin 4 PGND 與 R5 落地的畫法,它們是用不同的地符號。意思是說他們建議你用隔離的地(Isolation Ground),做法上就是 R5 和 Pin 4 拉在一起,然後單點落地。
  • 輸出應該先過濾波電容 C58、C59 和 C62 再給其它線路,注意到你的輸入電容 C56 和 C57 就做得不錯,可以參考它的做法。
  • 注意線寬與承載電流的關係,輸入與輸出線寬需要計算。不曉得 C60 "+" 號旁邊那條細線是做什麼用的?看起來很細。
  • 佈線大原則︰
    2 E1 D' T- x+ l& t0 u4 s讓輸入或輸出濾波電容和地造成的迴路越短越好。
    % H" Y5 a- L/ O0 C: Q* K4 u

0 O) y% H; Z6 H3 o( C8 }8 V. f
4 I  x! V2 V" W  M4 h& Q0 i仍需檢視的部份︰+ C. r0 \% y) v: k6 |6 K
  • L2 電感宜選用有屏蔽(Shielding)的封裝,避免漏磁(Magnetic Leakage)干擾。
  • L2 電感的額定電流(IDC1 和 IDC2)宜被檢視,避免峰值電流(Peak Current)超過或溫度升高,造成電感量不足產生紋波和噪聲。
  • L2 直流電阻(DCR)宜被檢視,太高效率不好、容易發熱。
  • AOZ1050 Pin 5 COMP 上的補償電路,芯片資料上有計算公式,宜試算一下是否搭配得宜。
  • 電解電容 C56 和 C60 的 ESR 越小越好,如果您真的很在意紋波及噪聲的大小,電解電容儘量選用可靠一點的廠牌。* z  A" u" d3 r1 L5 F8 M
6 x6 G5 w- w6 l, v

4 |  c1 Q8 I7 X* L1 ], x1 F! k{:soso_e129:}

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敢问师傅,本公司某些人才,要求输入电容跟输出电容的必须要共地,我想问一下,输入电容的地跟输出电容的地会不会彼此相互干扰呢,,我理解降压dcdc电路的输入电容哪随着mos管打开关闭,应该是有较大的脉冲电流电压  详情 回复 发表于 2015-5-28 19:56
支持!: 5
狗版主~~~~威武!!!  发表于 2013-8-7 09:46
支持!: 5
太给力了  发表于 2013-6-24 10:24

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ppyuyi + 5 很给力!
kevin890505 + 5

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哈士奇是一種連主人都咬的爛狗!

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发表于 2013-6-1 11:49 | 只看该作者
版主就是NB啊

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 楼主| 发表于 2013-6-1 14:05 | 只看该作者
非常感谢热心的超级狗大侠的提出的建议,提得很中肯。
* W$ z9 ]/ W9 s1 U- s- r1 s1 e5 @+ H
1、在改版中改善。
9 G) `$ z9 K6 ~* L2、3号引脚标示的为AGND,所以只用了一个0.5/1mm的过孔接地。8 S% ?4 X. |4 E& d& _0 V, ?- }
3、在设计原理图的时候留意到了AGND和PGND,但没有仔细考虑到直接多点接地带来的影响,这点在改版中改善。6 j. N4 t* K; H. Y. ]' @7 f
4、当初C58,C59放在底层是考虑到离电感近点,这里在做法上有点欠考虑,应该在电感输出区域顶层和底层小范围铺铜,然后用过孔连通,这样顶层和底层分别放置的电容滤波效果应该更好一些。当然按照狗大侠的说法输出先过C58,C59和C62,这样更好。
2 J$ b3 h, R7 J8 A, i5、电流输出应该在1.5A以下,走线宽度在30~35mil左右,C60“+”号旁边的那条细线是引出去的一个Test Point。
! o: p# D8 v0 W% o+ k% w' J: \: _# D# l1 }. P( }( y
最后对版主大侠致以诚挚的问候和谢意,EDA365在一群热心的,高水平的大侠的带领下,一定会越来越好!. A/ t7 J5 C- ]/ `2 y; [3 n7 i

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因為芯片上的圖除了 R5 落地和 PGND 是用不一樣的地符號,其它的地都和 AGND 的符號一樣。所以 AGND 有可能才是 Power 的 Return Ground,這點要留意!  发表于 2013-6-1 21:42

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 楼主| 发表于 2013-6-1 22:45 | 只看该作者
狗大侠是人才了,老板都得小心供着呢··{:soso_e113:}; Z: U1 m( \; Y" Y& W% A# ^
8 S( {5 y9 n# C
重新修改了下原理图和PCB图,准备打样测试下,如下所示:
+ o7 V. X1 J/ V$ P& ^' x# y
7 ?5 Z) F6 `' X- J: o  u! v) D( ?  E6 o ( q5 p7 `" n" r, L: f4 Y

$ S# ]2 {. s' U
. ^1 L* f0 ]# h" _& \* W5 g: n  w) J* Q0 Q% c# X! |3 [
# ~# I# V( e% g7 F1 \0 \
" j( M5 O- V* A) R6 X

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发表于 2013-6-2 12:05 | 只看该作者
jielove2003 发表于 2013-6-1 22:45
  g7 K2 r& S8 v$ f( C狗大侠是人才了,老板都得小心供着呢··( i; a2 Q" V1 h( e  Q

. j; V. O* o. P. i% B* Q重新修改了下原理图和PCB图,准备打样测试下,如 ...

9 ?* P- _: D/ |$ J* y# \: q" v/ K4 J快變成牌位被供起來了,哪天要被裁員都不知道。
; b% ^" g5 z2 u6 N% ~2 b! W  X% R: ?5 y* D
{:soso_e110:} % O, T" F4 o1 Z* m" o) a- D

4 w; ~( W5 m( X: _; f+ ^; y通常老闆不需要人才,只需要廉價勞力!# g( D9 i/ G. u* h  F( _6 H: g
8 R4 @( Q# P/ Z# b( H) w" X- e& X. K
{:soso_e119:}

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狗大:您多慮啦!眾多兩岸以及國際的幫粉絲挺你.  详情 回复 发表于 2015-6-28 11:01
哈士奇是一種連主人都咬的爛狗!

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发表于 2013-7-1 15:40 | 只看该作者
路人路过,提个问题。这个原理图里在芯片输出管脚内部开关打开的时候,回流路径是什么样的。不是应该由电感储能供电然后再开关打开的时候提供续流吗,一般会有续流二极管的。这个原理图里面是不是芯片内部解决了啊。还是怎么办的。求解惑。

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 楼主| 发表于 2013-7-1 16:05 | 只看该作者
matlab5000 发表于 2013-7-1 15:40 / {' x" M! S. g" N, C
路人路过,提个问题。这个原理图里在芯片输出管脚内部开关打开的时候,回流路径是什么样的。不是应该由电感 ...

2 P9 z, V, u( y) t( \5 f' y这个是同步整流的,在芯片内部用NMOS代替了。

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发表于 2013-7-1 16:12 | 只看该作者
jielove2003 发表于 2013-7-1 16:05
& P5 T) E2 k% z这个是同步整流的,在芯片内部用NMOS代替了。

) E# R) B8 r) D! K/ \4 F) W这么快啊。呵呵,刚刚发帖就有回复了。原来是这样啊。我没有下载datasheet, 要是这样的话就好理解了。楼主自己用了这样的内部有NMOS的,觉得和外面接二极管有什么区别吗

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 楼主| 发表于 2013-7-1 19:10 | 只看该作者
matlab5000 发表于 2013-7-1 16:12 5 X1 P  x4 W; ]+ y: k
这么快啊。呵呵,刚刚发帖就有回复了。原来是这样啊。我没有下载datasheet, 要是这样的话就好理解了。楼 ...

9 V; c4 ?; ?' u8 Z% _; |$ ?没有太大的区别,用同步整流的损耗会比续流二极管低一些。

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发表于 2013-7-2 14:50 | 只看该作者
jielove2003 发表于 2013-7-1 19:10 ) m2 |+ f' _' G6 v7 ]8 w$ L' b' T
没有太大的区别,用同步整流的损耗会比续流二极管低一些。

) \* c( H) r' @+ E% M- M0 E好的,多谢了。又学习了一个,同步整流。

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发表于 2013-7-3 08:53 | 只看该作者
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发表于 2013-7-3 09:22 | 只看该作者
如果很在意纹波,π型滤波,在IC和电感间,加一个RCD电路,吸收一下尖峰,不过说实话,纹波大是开关电源的一个主要的缺点
时常捡一点过期狗粮,勉强度日,毕竟生活总要继续

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发表于 2013-7-29 13:15 | 只看该作者
第5脚(comp)接个几十pf的电容对地更好些
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