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一般做封装时要做Assembly_top吗?

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发表于 2013-3-19 10:59 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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$ I3 u/ A3 t( Z* P如上图,一般你们做封装时会做Assembly_top吗?% B8 q, M  |' n& i' _
还是只做以下两个就OK了?" A1 F7 O% z+ K5 S
0 \( Y- G$ m1 R' u

点评

建议做上去!  发表于 2013-3-19 11:03
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发表于 2013-3-19 11:39 | 只看该作者
Assembly_top是实体大小
5 M3 x. h# _) A- ?6 [' N3 p. \3 k可用来给机构确认或是标示极性脚位用
" _+ Z; y+ O' F9 \! ]; ~) P, i9 i我目前遇见的此层是必要的

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 楼主| 发表于 2013-3-19 11:58 | 只看该作者
必要?

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 楼主| 发表于 2013-3-19 12:27 | 只看该作者
Assembly_top这个出gerber时貌似用不上啊,还是只是设计时方便做一些标示?

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发表于 2013-3-19 12:32 | 只看该作者
看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可

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 楼主| 发表于 2013-3-19 13:15 | 只看该作者
inspiron1501 发表于 2013-3-19 12:32 ) c' P' F( l5 ]6 n( b8 A6 Z
看公司大小,如果是大公司,有流程,这层必须保留,如果是小公司,有无均可
& o1 b7 ^! q* X& S8 a
那按正规流程走,这层应该画什么东西?

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发表于 2013-3-19 13:19 | 只看该作者
本帖最后由 幸福万岁 于 2013-3-19 13:27 编辑
5 x8 z; h: v3 ?3 \+ s8 w& K
5 K. \& y7 d4 \1 k$ A装配层    比如有些需要外接器件可以多画个place_bound_top# [1 D/ p9 w6 a  K# E
貌似一样 3 f/ e& O6 ~3 d4 \1 J. J
这一层 我从来不画

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发表于 2013-3-19 14:29 | 只看该作者
我一般画原件实际外框

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 楼主| 发表于 2013-3-19 14:54 | 只看该作者
我认为必须画的两个.1,place-bound-top& S9 g: N- _6 u# I+ N
                            2,silkscreen-top  F, @* [6 P4 s5 Y4 |  F' E: t
这两个画了就OK了,有不同见解的吗?

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发表于 2013-3-19 22:14 | 只看该作者
没有必要,但是画上去的话,可以用assembly层出装配文件给装配人员,毕竟有一些板子器件密度太高,用丝印层很难看清楚。

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发表于 2013-3-20 14:18 | 只看该作者
有总比不没有好,等你需要用到这层的时侯,再修改就麻烦了。
# Y* F; d( M! k# J% s; _0 i4 W# x
6 Y+ W, J7 {/ h所以尽量都加上,一般是器件形状,方向和其它一些注脚.
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