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求高手指导高速信号的多层板设计!

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发表于 2012-12-6 23:51 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 ym306529818 于 2012-12-10 23:52 编辑 7 w6 K& P8 ]6 r$ k% x
" ~8 @( U! ^7 I/ j7 I, \
本人手里有一个项目,现在正在进行PCB绘图,+ _, M( @' C- a0 k+ {+ D% H
信号线为高速信号(最大速率是5GB/S,一般速率为2.5GB/S),' L! H1 }- }0 z3 {- i+ r, b. V' s
板层为8层,( f/ ~7 F9 p& D, a+ H8 q3 r
千兆网口,3 a5 j2 y. ], h& N
时钟为150兆左右(多路差分),
3 r3 y3 J* }. S0 R, F, T# W6 o高速差分信号线较多,
$ W: D9 D5 F7 z* L! }电源为12V输入,5V输入,多数电源要求为3.3V和2.5V,' m- ?3 Y" P1 n
包含BGA封装、引脚数超过1000的FPGA。- R  Y* o" z( p( c7 c8 U- F
4 j5 W, @* s! f2 M
求高手指导怎样设计板层,怎样布高速信号线、高速控制线、数据线,PCB设计中应注意的事项及等长数据线、差分线有无特殊要求等。希望各位大虾不吝赐教,小弟拜谢................. [5 N( G/ f( g  t

; o! @  e4 X. n8 L" Y
6 k, N# h' y, G       帖子发了快一周了,踩的不少,回复的更是凤毛麟角,其实这个项目我只是自己尝试布线,板子我已经布了一半左右了,这次想尽量把板子布通,布好。高速信号这块以前没接触过,所以有很多的顾虑...
! ^2 W. |( _: }4 m希望大家先给点板层设计的建议,我明天将我的板层写上来~~(并且以后不断更新这个帖子),希望各位高手和像我一样的菜鸟拍砖,谢谢!
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发表于 2012-12-7 11:51 | 只看该作者
这些都吸很多都是靠经验的  一两句话都说不清的 % `' S1 f: R4 _
LZ可以弄本PCB信号完整性分析的书籍看看
淘沙就不怕鬼,怕鬼就不淘沙

最大的敌人不是粽子或机关,而是自身的恐惧

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发表于 2012-12-7 16:45 | 只看该作者
LZ挺牛的!

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 楼主| 发表于 2012-12-8 00:08 | 只看该作者
黑驴蹄子 发表于 2012-12-7 11:51
- {/ K. U& z9 O0 S这些都吸很多都是靠经验的  一两句话都说不清的 , m* Z; H: }# d
LZ可以弄本PCB信号完整性分析的书籍看看
2 t. X: ]! e% U6 G, L& ^# P  o9 F
请版主推荐一本好的书籍,谢谢!

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 楼主| 发表于 2012-12-8 00:08 | 只看该作者
WALL-E 发表于 2012-12-7 16:45
( h  y5 |$ l# _, l/ e$ nLZ挺牛的!

9 u8 ?3 c1 ]# F. w( Q& }# U我是个菜鸟,只是被赶鸭子上架而已................

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发表于 2012-12-8 08:29 | 只看该作者
本帖最后由 chensi007 于 2012-12-8 08:37 编辑 " e4 ~. U7 Y0 k; `8 V& @

, {0 W" R8 ~- I+ ~* N" n; j8 p首先就是层叠方案的规划,哪层走信号,哪层是平面。要先估计好。2 B, j$ L2 U) F+ ~
( U$ x& Q& f) J; ?
再就是阻抗控制:关键信号单端50OHM.差分阻抗根据SPEC规定的差分阻抗来作(一般100OHM)
; L& r7 I0 i3 K1 o- h  a! t" k" s对于高速信号来讲。同组(例如)信号要等长。千兆网络的差分信号,差分对内(D+D-)要等长。差分对间也要等长。* t, B* x, R- R
5 _2 X& f8 m9 K0 ]; Y! U
还有一个就是串扰控制:把关键信号与关键信号间距拉开。关键信号与不关键信号间距拉开。一般是3W规则。
3 u$ Y( l0 q! E: X* n
2 o3 K: p! W7 f2 I- c( N  ]其它的就是一些常用规则。如BYPASS电容的放置。线长、线宽。电源分割。。。。。。' P# A6 Y: `+ |6 l( x
以上是纯从LAYOUT角度想到哪说到哪。本人菜鸟。说得不对请包含。{:soso_e121:}
+ k0 g7 \6 h0 Y( Z# a! Q书的话。柏格丁的信号完整性分析比较好。很多人买。( Y& Q/ D+ g: b' U  k/ w4 Z
另外。看完柏格丁的书后可以买大学的射频教学课本进行学习。推荐国外译本(很多是由电子工业出版社出版的)
4 G; A' v% P5 r9 m( f自学射频的话有难度,可以买两本不同作者的书,对比学习{:soso_e120:} 。

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感谢分享心得~  发表于 2012-12-10 23:37

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发表于 2013-2-18 22:48 | 只看该作者
做好规划,遵守原则,不用太多顾虑,因为物理层本身就可以容忍一定的设计偏差

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发表于 2013-2-19 08:40 | 只看该作者
两种叠层,可根据布线密度选择:9 k4 h0 `. z; i! q- e5 X
1)TOP-G2-S3-S4-P5-S6-G7-BOT;三个信号内层;
' U8 p1 p* j/ |1 X5 _" o7 c5 b2)  TOP-G2-S3-G4-P5-S6-G7-BOT;两个信号内层有很好的参考平面;
6 }# y5 W. D4 F高速信号、时钟信号少打过孔(不多于2个)。

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发表于 2013-2-19 13:04 | 只看该作者
在百度里面其实是有很多关于高速设计的规范的,在设计的时候多按照规范来即可。当然有时候规范是死的 可以适当的调整,尽量按照规范来即可

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hqg + 5 灵活运用~
Csec + 5 赞一个!

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发表于 2013-2-19 23:41 | 只看该作者
高速信号线布局布线要求: 走线段,过孔少,走弧形线、立体包地、远离干扰源(如AD DA 电源 晶振等)、走线与焊盘接触地方尽量圆滑

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 楼主| 发表于 2013-3-21 23:58 | 只看该作者
hqg 发表于 2013-2-19 08:40 ; f; t; V. G7 X6 V. b; m0 E
两种叠层,可根据布线密度选择:! J0 A' x: O$ j
1)TOP-G2-S3-S4-P5-S6-G7-BOT;三个信号内层;/ x1 L5 R' ~; Y2 y9 B) k% s1 x
2)  TOP-G2-S3-G4-P5-S6- ...
% P% i3 h8 n2 E6 N8 t% g; E
我采用的是你的第一种板层设计,谢谢提醒~

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 楼主| 发表于 2013-3-21 23:59 | 只看该作者
xljun158598 发表于 2013-2-19 23:41 * u" u( g2 O8 c* y0 s4 t' F1 P3 S- ^
高速信号线布局布线要求: 走线段,过孔少,走弧形线、立体包地、远离干扰源(如AD DA 电源 晶振等)、走线 ...
$ ?2 `& |5 g/ Y; P' r  P
这些我会多多考虑下的,谢谢,呵呵!
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