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发表于 2011-9-7 23:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟有块板子,上面一共有6对差分线,但是我画的时候,软件竟然只能识别其中的四对,真是让我感觉莫名其妙的,应该不是设置的问题,因为其他四对都是正常的,求解?(我用的是16.3)
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发表于 2011-9-8 12:48 | 只看该作者
没用过16.3

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发表于 2011-9-9 10:07 | 只看该作者
仔细查你的设置哪里

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发表于 2011-9-9 16:08 | 只看该作者
肯定是你设置的问题!!

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发表于 2011-9-9 16:17 | 只看该作者
再仔细查下设置

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发表于 2011-9-11 15:39 | 只看该作者
晕....可以自己手动设啊" S9 R8 w, d4 `
软件自动抓主要看你的net name 的9 a8 W& j3 w) ~3 S+ m( v

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 楼主| 发表于 2011-9-11 19:24 | 只看该作者
streetflower 发表于 2011-9-11 15:39
0 C2 X$ O7 _) m9 P% N" ?晕....可以自己手动设啊- ]+ D5 D: z3 T& ]0 x$ D; Z
软件自动抓主要看你的net name 的
( y) j! l. h& J5 r/ a
当然是自己设置过了的,约束管理器里边设好了的,包括规则都全部设置好了

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发表于 2011-9-11 20:34 | 只看该作者
那板子我看过,是很诡异的问题,差分对设置是对的,布线的时候软件也认为那段是差分对,但是slide的时候自动分开了,并且确定signal trace 模式是没有勾选的,16.5和16.3都有这个问题,database也检查过了,但是任然无法解决,我还尝试解除差分对重新生成,但是任然不行

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发表于 2011-9-12 00:10 | 只看该作者
bug???

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发表于 2011-9-12 00:17 | 只看该作者
可能是,但是没有理由16.3有,16.5也用啊

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发表于 2011-9-13 11:05 | 只看该作者
如果有端接电阻或者耦合电容,尝试一下删除器件模型,再布线。

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发表于 2011-9-13 13:48 | 只看该作者
是不是又设置了其他更高优先级的规则了或者是设置了等长误差比较大,使这个走线在走线途中可以随便走而不产生DRC?
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