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再发Constraint Manager疑难杂症,高手请进!!!

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发表于 2011-6-8 17:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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" n( s0 W6 J, M9 L: P
7 B1 L* n& P2 m+ x( {$ B) I. [8 y如图中所示,数据线都是一对一的,凭空跑出来很多没用的线,黄色所示,都是其他引脚已经连接的。检查原理图没有问题,没用这些连接关系都是一对一的。1 @' l9 O) h& B4 u: Y" V
前两天发帖有朋友说是模型问题,我用的是排阻,4个一起的。模型都用的一样的,总共64条线别的都没问题,单单这几个有问题,请教高手有遇到过这种情况的吗,该如何解决。先谢了
1 r$ m, D$ W; O5 b9 j( \
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发表于 2011-6-8 21:48 | 只看该作者
是的,需要重设模型!

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发表于 2011-6-8 22:46 | 只看该作者
你确定一对一?  L  e) M% t  ~4 @0 S# P4 O
pin pair改longest或者手动设pin pair试试~

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发表于 2011-6-9 08:38 | 只看该作者
pin pair下清空 scope选择global

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发表于 2011-6-9 08:49 | 只看该作者
关于pin pair下的选项help里面的说明是
8 J. }6 Q$ d' E' R4 cMatch Group. In the Pin Pairs column of the Relative Propagation Delay worksheet, you can guide the generation of pin pairs with the following options: & O1 |) _& _8 }- [9 Z) w1 F+ J
, B% d8 O6 L  |% v
8 q! ]! K9 Z! ~- X$ k
Choosing this option . . .
7 i; r, _; P) W7 VGenerates pin pairs based on . . . / |, a+ a2 D2 u5 l2 C# c# _
* W% ]1 A8 I% E8 Z$ J9 u
All Drivers/All Receivers
/ ?9 o! Q3 g% ~6 G: kAll combinations of drivers and receivers.
4 e) r2 h3 k3 q# r! ^1 b8 K' q8 [/ k) |
Longest Driver/Receiver( \2 T; m6 ^5 a
The longest driver-receiver pin pair. Uses the longest pin pair when there are not any drivers or receivers.
- t5 _3 t2 y7 P" `3 D+ v' ]. K3 S/ S3 J
Longest Pin Pair# _% \* v( \) o& S5 O
The longest pin pair.
+ Y7 O6 o, I! }' y$ M# U! c4 V

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发表于 2011-6-9 09:29 | 只看该作者
建模的时候pin number 12345678对应错了是不是?

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 楼主| 发表于 2011-6-9 19:24 | 只看该作者
回复 wangjing 的帖子2 w% r' x* K+ F, V5 X
  X4 S6 W9 V- e& }0 {
没错啊 对应关系也对着呢 一样的模型 有的是对的 有的是错的

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 楼主| 发表于 2011-6-9 19:25 | 只看该作者
回复 wangxs_song 的帖子' ^1 Z$ ?% [( J) k% ^3 V& k
# \* d# P* J& ~6 z
模型都没问题啊

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发表于 2011-6-10 09:11 | 只看该作者
回复 mcu200689 的帖子' _# d6 j3 w& G6 W
5 C3 `6 w8 V/ I# V- Y8 b( T
你的排阻是不是上拉或下拉?就是一端是电源或者地?而并非两端都是信号。

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 楼主| 发表于 2011-6-10 09:54 | 只看该作者
本帖最后由 mcu200689 于 2011-6-10 10:03 编辑 - y3 v0 ^7 n; y. f8 Z: M. }) ^

% y! b  U% {4 N- G* B6 m. W2 g, E今天找到问题的所在了,DDR2组内8跟数据线是可以互换的,为了布线方便就把原来的一组内的8跟数据线做了调换,约束里边的两条线是换前和换后的(一条绿的是现在的连接关系,黄的是原来的),应该是生成网表的的时候,新的连接关系没有替换掉原来的,造成两根线同时共存,这种情况应该就是OrCad画原理图时的问题了,不知道这种情况怎么解决??

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发表于 2011-6-10 10:30 | 只看该作者
回复 mcu200689 的帖子
( R3 _2 v+ P8 ^6 ]( f
! c1 A# h0 R9 o( |% m调整原理图再导网表啊

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 楼主| 发表于 2011-6-10 10:58 | 只看该作者
回复 wangjing 的帖子. j/ f6 ~) z* q- x$ R9 Z
0 p4 g! T2 x: a- n3 t# B
怎么调?原理图连接关系对着呢啊
# \8 ?! g% x+ l/ G

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发表于 2011-6-10 11:01 | 只看该作者
回复 mcu200689 的帖子
1 Q/ ?' `3 ]* B; Y- \% o8 ~+ r9 a9 P2 R! x( Y5 u+ ?7 B
对着呢怎么会这样,重导网表。
( A& T1 ?) U# I9 H& c: i" C

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 楼主| 发表于 2011-6-10 12:08 | 只看该作者
回复 wangjing 的帖子4 t* ]2 O  U% g7 P+ }

+ \- }) Z1 F# W- i4 B9 ~导啦 我改了连接关系就重新生成网表 导到PCB了 约束关系还是显示两条线 不知道咋回事

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发表于 2011-6-10 13:03 | 只看该作者
回复 mcu200689 的帖子
* n! M5 N- P, u4 O% X/ K. O3 p9 u$ w2 {
不应该会这样 你的原理图没改好吧 再检查一下。换个路径再导一下
% v7 l8 d1 g9 k! g& Q  e/ M
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