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allegro 16.2 在win7里导入网表的问题!

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发表于 2011-4-23 12:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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烦请有人给指导一下!
) ^1 N( b5 ]' [" B! `: d/ a  T在原理图中DEC与生成NET LIST 都没有报错!
/ E# Q; ^; r% @+ @: a小弟在这先行谢谢各位!
6 r2 @6 q0 B; v3 b& o如图:+ T' g/ v* e% t
0 v' [' n( B/ x0 {1 K" H7 u! V

import logic netlist errors.JPG (52.67 KB, 下载次数: 4)

import logic netlist errors.JPG
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发表于 2013-8-22 23:02 | 只看该作者
已解决,是导入logic的时候最后Import directory路径设置不对,应该把路径设置到netlist所在的路径,也就原理图文件夹下allegro的路径。

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发表于 2013-8-22 22:28 | 只看该作者
还是没有解决。

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 楼主| 发表于 2011-4-25 09:09 | 只看该作者
本人已解决!

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发表于 2011-4-25 12:19 | 只看该作者
我的还不行,导入PCB,在勾选放置元件到板上,却看不到元件,等于放空气一样!~麻烦详细指点一下!

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 楼主| 发表于 2011-4-25 12:39 | 只看该作者
你可是把你的错误发上来看看好吧,我也是初学,我们一起搞,兴许都能够解决的!

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发表于 2011-5-1 14:05 | 只看该作者
Cadence Design Systems, Inc. netrev 16.0 Fri Apr 29 11:35:19 2011
9 [- {2 }1 u+ C- y(C) Copyright 2002 Cadence Design Systems, Inc.
9 }& L, R. C6 u) V2 ?0 u) u" [------ Directives ------
7 q4 I4 r- {7 I. M" IRIPUP_ETCH FALSE;, `' A# u4 f; _" T& U% S  u
RIPUP_SYMBOLS ALWAYS;
$ }1 h+ P* `  a0 RMissing symbol has error FALSE;6 K$ X7 [8 I, t& |3 c; e2 d
SCHEMATIC_DIRECTORY 'Z:/project/907/A1';9 m9 c; u- t  b4 P) M
BOARD_DIRECTORY '';/ t3 z0 M- ~* S1 C) i7 q
OLD_BOARD_NAME '907.brd';& Q- f4 w0 a  V& i5 J
NEW_BOARD_NAME '907.brd';
, z3 R5 b2 r# g. q, bCmdLine: netrev -$ -i Z:/project/907/A1'  -y 1  -z Z:/project/907/A1' /#Taaaaaa02688.tmp/ [# L2 M3 a3 t) Y
------ Preparing to read pst files ------; @2 {' H$ t; Y. ~" D: ^
2 M- W: y1 E6 s! c/ u0 x% t
#1   ERROR(24) File not found
3 Q9 I8 Q% M8 S/ y5 z     Packager files not found9 ~" J. g; R: }1 c% x" U
#2   ERROR(102) Run stopped because errors were detected
  I4 H1 ^) b( fnetrev run on Apr 29 11:35:19 20110 n) c6 C9 T+ ?5 r3 E
   COMPILE 'logic'
; Q4 Q9 d2 m1 T; n7 R   CHECK_PIN_NAMES OFF
# k* @, Q2 e% @* U   CROSS_REFERENCE OFF
& n9 e" V/ _2 a6 ^   FEEDBACK OFF/ I. |* C  C; A+ i  O! F9 d+ \
   INCREMENTAL OFF! w5 ]. \% J! z' q) S& a1 ^
   INTERFACE_TYPE PHYSICAL5 B7 I7 @& F% e# Q& l% G" \/ K  q
   MAX_ERRORS 5002 ^9 h: A; h1 u  D5 f# \+ o1 p
   MERGE_MINIMUM 50 m. j# z# b$ I1 o
   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|', o% [; C# d, H  o" [
   NET_NAME_LENGTH 24
7 s7 g4 O# g4 s. B7 h" U9 z   OVERSIGHTS ON
- A# z* W) Z5 F3 }: n   REPLACE_CHECK OFF; V$ A$ f/ I- k+ H$ y
   SINGLE_NODE_NETS ON" G: A' y- w7 D6 u4 M% ]: k
   SPLIT_MINIMUM 0: ?' p" K# D9 F. z& S* I+ U
   SUPPRESS   20
7 k. [, M- b- r. X. }0 x  l1 k   WARNINGS ON# ?/ c; g2 z  X: s
  2 errors detected
4 H# i$ ~' G) Q( j% @! NNo oversight detected, D1 Z4 B2 X/ K2 s7 \; i4 M1 _% Z
No warning detected
0 i* G/ B. M+ W: bcpu time      0:00:29" d$ v( w  `, S& _+ o& @
elapsed time  0:00:00
  C! x4 s- E( J& n" M- A4 o* t& W3 C& X! D
你好,上面是我将网表导入allegro时出错,情形和楼主的一样,到现在还没找到原因,希望楼主指点一下,谢谢!
" f4 J8 G+ e: A) ~. p封装是我自己做的,PAD和PSM路径也都设置好了,就是网表无法导入allegro.

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 楼主| 发表于 2011-5-3 10:11 | 只看该作者
1、输出网表时有没有错;
7 L6 ~5 j- a8 U( o  G% v& J2、输入网表时一错误,在file\viewlog里仔细查看;8 U. V# f- b# u; f
3、在TOOL里放置时,能否看到元件个数;
1 n7 m# O7 s( M$ V9 ]4、在手动放置的时候,如出现问题,请查看输入命令窗口的提示。
/ x3 ]: A( B( _. I* j我就是这么做的!

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发表于 2011-6-8 18:27 | 只看该作者
请问楼主,如何解决的,你的Cadence在Win7下可以仿真吗??

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发表于 2011-6-8 19:23 | 只看该作者
这种问题如何解决。按照你说的方法去检查了。导入网络还是0原件,封装路径设置OK

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发表于 2011-11-15 10:37 | 只看该作者
求这个问题的解决方法。。。。谢谢。。。。

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发表于 2011-11-24 12:08 | 只看该作者
需要以管理员身份运行程序就可以

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发表于 2011-11-24 13:08 | 只看该作者
六楼的封装没有找到,看看是不是封装的路径不对,或者封装的焊盘不对,,又或是封装改名了之类的

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发表于 2012-6-19 23:45 | 只看该作者
封装的路径,封装的焊盘,封装命名不能用这些字符'#%&()*+-./:=>?@[]^_`|'( N( t:

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发表于 2012-6-19 23:52 | 只看该作者
可以强行导入看看,没有FLASH的过孔元件是放置不出来的,全部停在库里

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发表于 2012-11-26 15:33 | 只看该作者
你这个问题是怎么解决的呢?我的问题和你一样

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发表于 2012-11-26 16:02 | 只看该作者
请问下楼主的问题是怎么解决的呀烦请有人给指导一下!
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