学Cadence出的一些错误及解决办法

feilong87

Capture

报错：在生成netlist的时候

Unable to open c:\Cadence\PSD_14.2\tools\capture\allegro.cfg for reading. Please correct the above error(s) to proceed

处理办法：

点生成netlist，点setup，修改路径为capture\allegro.cfg所在路径

报错：

Spawning... "C:\Cadence\PSD_15.1\tools\capture\pstswp.exe" -pst -d "F:\gcht\CC2430\Projects\mysch.dsn" -n "C:\CADENCE\PSD_15.1\TOOLS\PROJECTS" -c "C:\Cadence\PSD_15.1\tools\capture\allegro.cfg" -v 3 -j "CC2430_DEMO"

#1 Error   [ALG0012] Property "PCB Footprint" missing from instance U3: SCHEMATIC1, PAGE1 (2.00, 2.10).

#2 Error   [ALG0012] Property "PCB Footprint" missing from instance C2: SCHEMATIC1, PAGE1 (2.30, 0.30).

#17 Aborting Netlisting... Please correct the above errors and retry.

4 T" g1 `3 ^3 v: \& N' ~: }( ]

Exiting... "C:\Cadence\PSD_15.1\tools\capture\pstswp.exe" -pst -d "F:\gcht\CC2430\Projects\mysch.dsn" -n "C:\CADENCE\PSD_15.1\TOOLS\PROJECTS" -c "C:\Cadence\PSD_15.1\tools\capture\allegro.cfg" -v 3 -j "CC2430_DEMO"

2 l' Y; ]  l' _5 c* ?8 {7 S0 s

错误解释

Error [ALG0012] Property "PCB Footprint" missing from part <Part Reference>: <Schematic> , <Page> (<LocationX> , <LocationY)>

A PCB Footprint (JEDEC_TYPE in Allegro) is required for all parts in Allegro. Therefore all parts without this property are listed before aborting the netlisting. You can add the PCB Footprint property by selecting the part listed, then choosing Edit Properties from the pop-up menu and placing a value, such as dip14_3, on the part.

在Allegro中，每个器件都需要一个PCB封装。所以在取消列出网表之前，软件会列出所有没有此项的器件。你可以选择列出的器件添加PCB封装，然后选择Edit Properties来编辑器件的值。

2 A3 z) M: ]! I6 ^; W, z# R/ t8 g

在导出Netlist 之前，只需要保证每个器件都是由封装的即可

。

[DRC0011] Reference is invalid for this part

The reference for the part is invalid. For example, this occurs when a part reference like U?A has not been updated. Update the part reference。

6 S( |2 B- @5 R4 Z0 A9 n

Reference项不可随意修改。

Allegro

Pin numbers do not match.  Check device file.

原因：原理图中的晶振给了两个管脚，而其封装却是四个管脚。

原理图与PCB封装对应原则：

4 o4 h7 K# C3 T* D; Q& ~$ w

除了PCB Footprint的名字要写对以外，还有一点，就是原理图的元件的管脚数目一定要和封装的管脚数目是一样的。这里说的管脚，包括了原理图中可能没有现实的Power Pins,不包括封装中的machanical pins；另外，原理图和封装的对应关系是依靠pin number来建立的，所以两者的相应的pin number一定要一样，而pin number是不是数字并没有关系。

lj503

bang帮顶下

jan1024

顶！~~~

jan1024

Q宠大斗乐  加人
) C3 o  \& ]1 R2 m. u帮派名号：情义Q宠
; |! p0 M/ ?/ M- h! |帮主尊号：AJAN
帮派ID：753084

hcf830716

从CIS中调用元件，基本上不会出现上面的问题。

爱美丽

不知道该说什么，总之顶下吧，继续

黑月

  K: j0 O2 |0 e5 G4 I原理图和封装的对应关系是依靠pin number来建立的，所以两者的相应的pin number一定要一样，而pin number是不是数字并没有关系。

7 E  N5 _% r8 Z. N( s' j+ D  a顶！！！

qqtolm

bang帮顶下