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关于高速信号线不同层的平行走线

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发表于 2009-9-18 09:22 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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高速信号线相邻两层平行走线会引起串扰等SI问题。可是如果一条走TOP层,一条走BOTTOM层,中间分别隔了VCC和GND层,那么是不是就不存在串扰的问题了?( j7 G: U4 i5 m- L6 }! ]' R$ U
      另外开关电源的Phase线是高干扰源,如果在phase线下面走高速信号线的话,肯定会被干扰,为什么隔了两层还会有干扰,这个怎么理解呢?
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发表于 2009-9-18 13:05 | 只看该作者
注意你的信号回路,是否共用了VCC,GND?- Y$ z9 D1 o5 l$ U4 g' y  g
你的SMPS的f多少?上管Drain电压多少?6 X1 S; ~* b# [4 x
高速信号线频率多少?信号类型?
sagarmatha

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 楼主| 发表于 2009-9-18 13:11 | 只看该作者
高速信号100MHz,SMPS是指开关电源频率吗?那个是300KHz,上管Drain12V,Source 1.2V左右

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 楼主| 发表于 2009-9-18 13:11 | 只看该作者
如果信号不共用是不是就没问题呢

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 楼主| 发表于 2009-9-19 20:51 | 只看该作者
自己顶

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发表于 2009-9-22 09:07 | 只看该作者
“Source 1.2V”
: y4 }5 s0 h2 L( G3 O0 p9 T' u不可能吧,你想想SMPS如何工作的。
6 N1 v, w) _7 |, a/ J2 {' R应该是你的Vout是1.2V吧?
. ?0 }4 d& a7 U  o9 Z; B你用的什么型号的芯片?/ Z1 A8 ?! o8 f; f
干扰通路应该是你的信号回流路径,SMPS中最敏感的信号线就是PHASE线,从板上分析下你的PHASE线回流路径
sagarmatha

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发表于 2009-9-22 17:37 | 只看该作者
那样岂不是把差分线的缺点放大,把优点减到最小,还不是走单线呢。
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