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请教SDRAM等长布线?

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发表于 2009-4-28 22:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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现在布线布到SDRAM了
3 X' A/ ^5 D/ I6 @; e9 X0 L想请教下:" y5 H9 g1 b# b4 B
1:数据线、地址线、控制线 哪一组对等长要求比较严格呀?. G2 F$ a, f: G, m$ Z
2:数据线、地址线、控制线、时钟线 布线的长短关系式怎么样的呀?
% C% ?- Y  u7 G: ?3:DSP到两个SDRAM的数据线 地址线 控制线是在各个SDRAM处等长呀还是两个SDRAM处都要求等长呀?
2 w0 c( J6 s- ?2 H9 @0 q    比如D0、D1到SDRAM1,D2、D3到SDRAM2,这样的话是D0、D1相等呀还是要求D0、D1、D2、D3都必须要相等呀?
$ B. V+ ^, M5 m% M6 h* G    那么地址线 时钟线 控制线也和数据线的要求一样吗?
8 F* i  u! m7 A, h3 Z4:在走线中间加的匹配电阻应该记入等长线里面吗?该如何计算?
& R: h4 r2 J% t4 X7 M* `( e5:等长线是引脚到引脚间的长度吗?
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林嘉欣,我稀罕你!!

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 楼主| 发表于 2009-4-28 22:47 | 只看该作者
关于这点有太多的疑问了
8 w$ B3 R6 F9 s5 n/ Y希望大家多多指点
" t. h5 ?( k4 X# y/ D9 N& r3 u谢谢
- \( H$ Q& r  E; H讲的越详细越好
) ?, Q8 z. F9 w1 {; c谢谢
林嘉欣,我稀罕你!!

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发表于 2009-4-29 09:14 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。

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 楼主| 发表于 2009-4-29 09:39 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。( D2 p6 X, N# ?3 A* S- ^
liqiangln 发表于 2009-4-29 09:14

$ |/ P, }5 {3 _0 z7 H& O) q, E; k3 O谢谢
3 W3 v8 G! j' C能不能说的详细点呢
林嘉欣,我稀罕你!!

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发表于 2009-4-29 14:52 | 只看该作者
本帖最后由 _hhh_ 于 2009-4-29 14:53 编辑 & ^- R  O# c3 t( e1 ~
7 r: w( W( r7 ^& C
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!

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 楼主| 发表于 2009-4-29 15:10 | 只看该作者
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!" Q; h2 {2 C; N( i9 ^1 l
_hhh_ 发表于 2009-4-29 14:52
: J& |- j/ {6 Y# n& v
所有的走线都不考虑等长吗?
林嘉欣,我稀罕你!!
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