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PROTEL99SE原理图的元件引脚性能说明

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发表于 2009-2-20 13:58 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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为了对原理图设计进行可靠的电气法则检查,在创建元件的时候应该注意其各个引脚的电气特性
& @/ o3 x; ]6 y引脚可供设置的电气特性有以下八种:7 N6 |5 ]- Y# v* \& J3 O
INPUT 输入型。作为输入引脚使用! w, f9 P& A4 g3 a' X/ z
IO 双向型。既可作为输入,又可作为输出引脚。: U0 |0 C, n+ Q! J
OUTPUT 输出型。作为输出引脚使用
0 R5 x4 M' }) |& t5 D* e1 qOPENCOLLECTOR 集电极开路的引脚
( u& w1 [1 F5 E5 _PASSIVE 无源型。该引脚为无源引脚/ [; Z7 l) g' S- @- C2 E1 p; ?% }
HIZ 高阻型。为高阻状态的引脚) \/ ^' v% X& a5 z* g/ v& O& |! w
OPENEMITTER 发射极开路的引脚
6 V9 T& p5 W- W% d) L' K+ s/ IPOWER 电源型。该引脚接电源或地' O8 k* e' i; r2 h+ a, D$ M
带有上划线的引脚名称的输入:每输入一个字母后,紧随一个“\”,& v2 }" @% g, Q# l( {- G8 {; l
-----
% C1 G- P3 a. G. q6 W3 k如:R\E\S\E\T 的显示结果为: RESET
8 r5 }4 \5 O: v) n) O0 w$ \! ^+ @; g! l负电平输入有效的引脚外观设置:在DOT项前打勾选中
4 z% \5 Q) j1 I( M! Z4 R5 U: \% _时钟信号引脚就在CLK项前打勾选中
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 楼主| 发表于 2009-2-20 14:20 | 只看该作者
自己温习
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