[發問] Optimize PI 模擬會經過bead

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請問各位有遇到此狀況嗎？例如: 0.9V_PMIC ---> BEAD ---> 0.9V_PLL
此時我要模擬0.9V_PLL時，模擬時只會將0.9V_PLL上的電容納入計算，
2 J) |; v. |% B1 ~& n" cBEAD本身特性和BEAD之前的電容都不納入考量，這樣該如何是好。
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還有就是三端子電容如果左右兩端的net name不同，也會有此狀況。
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ladice

把它短路或是建model

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謝謝建議，可以試試看。不過針對三端子電容的應用，請問是否有範例，這方面試過幾次還是有點問題，到最後只能用一般兩端子電容帶過。