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2017年12月29日QA检查报告节选

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发表于 2017-12-30 08:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.电源太细
% A: }  S5 ^$ }$ f( Q; e! p 7 p" W7 o: e, n  h0 y+ `
[url=https://www.eda365.com/thread-160823-1-1.html][/url]
6 b% H: a" C% }3 E9 ?! b7 }
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发表于 2018-1-2 20:11 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53' N0 l2 l9 |. \- e" x
4.多个千兆网口线建议有参考面

4 `* o( F) N, t% {0 K. y为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。
) \5 x- U4 ]- u' u! Q  A

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发表于 2018-1-2 09:29 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53; Q5 S9 M# P# B* l0 d5 q9 D
4.多个千兆网口线建议有参考面
/ ?$ R3 z1 O6 E8 P6 \
请教一下,这个参考面是需要用外壳地来做吗?
4 ?; u3 \9 z9 z( _/ p4 x$ M

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发表于 2018-1-2 13:30 | 只看该作者
EDA365QA 发表于 2017-12-30 08:53
; F( l+ h1 Z; A$ v4 f* D9 _" R5 |! j4 t4.多个千兆网口线建议有参考面

  ]1 ]8 \# ?; S+ P. G3 x建议用中心抽头上的地,不能用机壳地!
  [2 R8 X" B! |

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
2.电感加强
2 v) n: B5 p6 J4 a8 U, v- F
( \6 _. f+ L/ ~; g+ N" ]% \

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
3.电阻两端需等长. i$ z3 U+ A6 H' S
: ?0 O$ q6 i% W$ o+ [6 E; U

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 楼主| 发表于 2017-12-30 08:53 | 只看该作者
4.多个千兆网口线建议有参考面
- r# [) w8 F, d+ H
& A! i) ~0 Y# h

点评

为啥有参考面,以哪个地作为参考面?机壳地?打静电时有没有影响,有什么理论依据,我设计的一块也是多个千兆网口,一开始是机壳地做参考,最后还是没做参考,EMC测试没问题。  详情 回复 发表于 2018-1-2 20:11
建议用中心抽头上的地,不能用机壳地!  详情 回复 发表于 2018-1-2 13:30
请教一下,这个参考面是需要用外壳地来做吗?  详情 回复 发表于 2018-1-2 09:29

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
5.USB参考平面要完整
) b( Y0 R- G" S4 {: C   N; r: m4 i" ?1 b" O+ c( Q+ c' m, h

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
6.电源有瓶颈+ l8 z( K/ A3 r0 z" q7 K' M
# y6 e& ~' N; _

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
7.有部分模拟线没加粗
% z4 a$ G4 W/ O$ A9 B
$ j" W' }) b7 X; u/ H2 D

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
8.电源加粗% Q3 m& s) V% Z* Z- x7 B  B
( f" N, E( p) [

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 楼主| 发表于 2017-12-30 08:54 | 只看该作者
9.CAN走差分
) W; H: }' F) S& S( z
  w( w8 f' c  B7 e

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 楼主| 发表于 2017-12-30 08:55 | 只看该作者
10.电源输入在电容前打VIA,输出电源加粗.
" b( N. A3 Q1 N/ l' K+ N ) u8 G) A/ U" j, w

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