2017年11月12日QA检查报告节选

EDA365QA

1.top参考第三层没有铺铜

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2.差分线跨分割

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3.电源不要走到RF区域
! B1 }1 C5 H" L
. I/ Y4 M0 y6 a9 n2 L

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4.电源补强
* z/ ]' r7 x0 n+ ^' T% d% S4 |# V; {
$ X5 D/ G8 B# |) C, w

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5.共模电感前后分开
! y6 t9 q$ t8 |- k4 L9 F0 D2 ~

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6.电源输出加宽

EDA365QA

7.匹配电阻应该放置到末端

/ t" M, _5 P; v/ `! t

EDA365QA

8.上下隔离部分不能放一起建议独立分开
4 O' B- j7 z9 e' H" K5 w  h

EDA365QA

9.规则设置不合理，走线部分没有参考平面了
$ `& P! s  W* U3 k

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10.时钟源端匹配靠近放置

+ h* A4 |" M; f

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11.时钟线不要直接在滤波电容中间穿过
  |$ j" ~) d' T) w' [! C+ J
; D' a! G# \. |( k( `

剑铮奇迹

EDA365QA 发表于 2017-11-13 09:42
% [! G4 }/ |% \) J11.时钟线不要直接在滤波电容中间穿过

; n6 h% E. e4 v- k- T# k& t怎么感觉这个晶振周围没器件呢，难道把电源电路和使能电阻放背面了吗？
晶振处理方法最好是电源和使能都放在同一面，周围包一圈地铜与其他隔离
$ i  ~* H: t5 z

dhhtmqh

EDA365QA 发表于 2017-11-13 09:42
11.时钟线不要直接在滤波电容中间穿过

这个是有源晶振，外围不需要什么器件了吧
; x; ?# u9 s, {0 E# z

648638520

学习了

guhanzuiying