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2017年9月24日QA检查报告节选

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发表于 2017-9-25 09:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.此LDO的散热焊盘并非接地网络。现在引起强连短路。9 G/ X3 m- q/ N1 g. ~1 L
5 n1 v1 X! K6 F9 R
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发表于 2017-9-28 16:57 | 只看该作者
EDA365QA 发表于 2017-9-25 09:41
) ^; a1 @  V! i  Q3.平面对齐金手指PIN
0 ~/ F& [' J5 W3 N" a( E+ g& h5 `
请教下,这是考虑啥因素,要求平面对其金手指.
* X" o/ a' Z. n+ d/ [8 [

点评

平齐可以保证走线有完整的参考平面,现在这样部分走线参考面是缺失的。  详情 回复 发表于 2017-9-28 17:27

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 楼主| 发表于 2017-9-28 17:27 | 只看该作者
wang09 发表于 2017-9-28 16:57
# K  v% a' ?% t+ E7 E' }5 e, {! d. e请教下,这是考虑啥因素,要求平面对其金手指.

; Y8 v- q$ E9 b. X平齐可以保证走线有完整的参考平面,现在这样部分走线参考面是缺失的。

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 楼主| 发表于 2017-10-9 10:05 | 只看该作者
twffwt 发表于 2017-10-6 21:28
; e$ e4 f7 y  ^" G; H  b, _6 R差分在终端匹配,单端在源端匹配哈
' L# W' s4 K$ F! t; [! Z
并联100欧姆的电阻是此时钟的终端匹配。8 j# Z* X! `) g7 f5 U6 v3 X

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 楼主| 发表于 2017-9-25 09:41 | 只看该作者
2.电容接地孔太长了. _' M" ^! ?9 x. }; J/ f: H% m

8 _8 u: r+ U( B4 e0 R2 C

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 楼主| 发表于 2017-9-25 09:41 | 只看该作者
3.平面对齐金手指PIN* z6 {4 K$ X3 p7 B+ o

+ s+ S) {: X, j) ]1 j- K; ?) G2 F% p

点评

同时记得差分线加回流地孔。  详情 回复 发表于 2017-10-26 09:36
请教下,这是考虑啥因素,要求平面对其金手指.  详情 回复 发表于 2017-9-28 16:57

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 楼主| 发表于 2017-9-25 09:44 | 只看该作者
4.相邻走线层走线重叠引起串扰严重5 m% p* r, y+ s' M6 T! e

; f5 O1 w; f; H

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 楼主| 发表于 2017-9-25 09:45 | 只看该作者
5.继电器控制线加粗到10MIL以上/ G" e+ }) S7 M* t; Z2 k# V
; _9 ]2 \: h9 i) H$ l

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 楼主| 发表于 2017-9-25 09:45 | 只看该作者
6.时钟电阻匹配位置应在末端
. Y; K$ ]8 H1 p6 L1 k' }; R ( {7 _4 Q  t- n

点评

差分在终端匹配,单端在源端匹配哈  详情 回复 发表于 2017-10-6 21:28

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 楼主| 发表于 2017-9-25 09:45 | 只看该作者
7.约束规则设置漏等长线# r: e9 H9 F' N3 G

; A, {' E1 ~) ^" n: s' ]) H0 V% z

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 楼主| 发表于 2017-9-25 09:45 | 只看该作者
8.走线多余,导致成环
7 R5 @+ ]9 N/ i4 f, w1 P; h' W! x   U" q" a- t5 {; S! E0 D3 ]  Q4 M

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 楼主| 发表于 2017-9-25 09:45 | 只看该作者
9.有时序要求线组中部分走线的拓扑不一致
! P0 T! H5 r! O' E ' s. t& Q; [) b9 u

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 楼主| 发表于 2017-9-25 09:46 | 只看该作者
10.POE的线加粗到20MIL,整流挖空多些
% z9 Q3 N' U# k: U* Z" ]
( u8 D5 m3 q  t) L% \

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