ddr3控制器不支持读写平衡

ann_wz · 发表于 2017-9-6 21:44

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如果ddr3控制器不支持读写平衡，那么这个是不是可以参考ddr2的规范设计时序，拓扑之类的，走T形拓扑，DQS跟CLK做等长？求指正

12345liyunyun · 发表于 2017-9-7 11:12

DDR3是由DDR2改进而来，DDR3都能走T形结构，控制器不支持读写平衡情况下不能走FLY-BY，具体时序等长要看频率

子建 · 发表于 2017-9-7 11:33

MARK

紫菁 · 发表于 2017-9-7 15:45

MARK

liuchengyun · 发表于 2017-9-8 16:53

CLK时钟线走T型，DQS和DATA做等长，地址线走T型做等长

AD9_PCB · 发表于 2017-10-20 14:26

没必要DQS和CLK做等长吧？DDR2这样做？

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