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2017年6月13日公益PCB评审报告节选

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发表于 2017-6-13 19:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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应众多网友要求,希望公开评审意见以便让更多人学习,本贴为6月13日公益PCB评审报告节选。
旨在传播规范的PCB设计理念,帮助设计师们提升设计水平,提高设计质量。
欢迎大家在每日贴吧中打卡讨论学习。
4 f3 s2 G9 W7 L, V1 Z! z
PS:如果想要得到一份专属于您的评审报告,让自己的设计文件与专家见面,那就快快行动起来,发送给我们

9 ~- j% G/ }8 O3 R& c( |7 V
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 楼主| 发表于 2017-6-13 20:00 | 只看该作者
5、FPGA的特殊要求:接入的100欧电阻到FPGA的走线长度相等,故接入到1.2V电源的走线应在电阻走而不能从过孔直接取电。
; _8 C, ^8 O& @8 v' _# U; O

0613-5芯片特殊等长要求.jpg (31.57 KB, 下载次数: 9)

0613-5芯片特殊等长要求.jpg

点评

报告:这个不太懂。怎么叫不能从过孔取电?这个电阻靠近FPGA的接入点放置,不是通过打孔接起来的吗?两边都是通过VIA接起来的吧?  详情 回复 发表于 2017-6-23 13:47

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发表于 2018-1-9 17:26 | 只看该作者
太好了这个=-=点赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞赞;P

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发表于 2017-6-23 13:47 | 只看该作者
EDA365QA 发表于 2017-6-13 20:00+ V! W% c$ [( I- D* ~/ a" W
5、FPGA的特殊要求:接入的100欧电阻到FPGA的走线长度相等,故接入到1.2V电源的走线应在电阻走而不能从过孔 ...
6 `3 j# ?$ ~! A, T& D
报告:这个不太懂。怎么叫不能从过孔取电?这个电阻靠近FPGA的接入点放置,不是通过打孔接起来的吗?两边都是通过VIA接起来的吧?9 r% }1 @5 j- ]4 h! B! N4 Q$ H

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 楼主| 发表于 2017-6-13 19:58 | 只看该作者
1、结构要求此处兼容设计两类过孔,板内封装没有加入此孔且无特别说明此处需要挖槽处理。制版后影响结构安装。% y( N( s, W% Y7 V

0613-1封装与结构图不匹配.jpg (59.12 KB, 下载次数: 7)

0613-1封装与结构图不匹配.jpg

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 楼主| 发表于 2017-6-13 19:58 | 只看该作者
2、422串口的最大传输速率是10Mb/s。采用差模传输,抗干扰能力强。" k7 r1 M2 q2 I5 f6 y

0613-2差分走线按单端走线走.jpg (24.14 KB, 下载次数: 11)

0613-2差分走线按单端走线走.jpg

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 楼主| 发表于 2017-6-13 19:59 | 只看该作者
3、音频信号是模拟信号,为了得到更好的信号质量,通常都会包地并打地过孔处理。
# _$ n& ~6 l- _. n% o

0613-3模拟线没有包地.jpg (26.48 KB, 下载次数: 2)

0613-3模拟线没有包地.jpg

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 楼主| 发表于 2017-6-13 19:59 | 只看该作者
本帖最后由 EDA365QA 于 2017-6-13 20:06 编辑 . b: v: [9 C7 ^; F
  m* h3 {' g( w; V8 A- }) h
4、电源地和板内地互联磁珠需要短而粗的走线及更多的过孔来降低阻抗和保证通流量。
7 y0 I# K7 y8 }& [/ @/ [# `! j

0613-4板内两种地连接瓶颈.jpg (62.11 KB, 下载次数: 3)

0613-4板内两种地连接瓶颈.jpg

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 楼主| 发表于 2017-6-13 20:00 | 只看该作者
6、射频部分需要控制50欧姆阻抗线,第二层挖空后第三层需要埔地作为回流参考平面。4 s$ G/ i' K% L

0613-6射频线没有控制阻抗.jpg (31.13 KB, 下载次数: 2)

0613-6射频线没有控制阻抗.jpg

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 楼主| 发表于 2017-6-13 20:01 | 只看该作者
7、电源需要短粗布线,提供芯片工作电流。; g' i- I/ a1 v6 K! k

0613-7电源线过细.jpg (37.8 KB, 下载次数: 3)

0613-7电源线过细.jpg

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 楼主| 发表于 2017-6-13 20:02 | 只看该作者
8、电源芯片的正负sense是很重要的采样点,需要走类差分在滤波电容后取电。不正确的连接会影响输出电压的准确性。
  W: @$ m+ U+ G# [6 p" |

0613-8电源芯片sense处理不当.jpg (39.12 KB, 下载次数: 2)

0613-8电源芯片sense处理不当.jpg

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 楼主| 发表于 2017-6-13 20:03 | 只看该作者
9、高速射频不要走无关电源到其下方,否则会引起不必要的干扰。射频部分电源不大的情况可以采用走线形式处理,保证过流量即可。" j" S7 @/ \, z4 `( k/ n

0613-9无关电源铺铜到射频区域.jpg (14.22 KB, 下载次数: 3)

0613-9无关电源铺铜到射频区域.jpg

点评

这意思是电源层在划分铜箔时,射频信号及其相关零件下面直接不要铺就可以了吗?  详情 回复 发表于 2017-8-21 14:51

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 楼主| 发表于 2017-6-13 20:03 | 只看该作者
10、走线走在平面挖空区,阻抗线没有参考平面会引起阻抗不连续。7 P% V$ R6 V$ G

0613-10走线在分隔带上.jpg (19.19 KB, 下载次数: 3)

0613-10走线在分隔带上.jpg

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发表于 2017-6-13 20:25 | 只看该作者
学习了,先打卡。

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持续学习哦。  详情 回复 发表于 2017-6-14 09:56

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发表于 2017-6-14 08:47 | 只看该作者
非常好的学习要点,必须先赞一个.

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发表于 2017-6-14 09:20 | 只看该作者
必须点赞

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每天进步一点点,我们会持续更新,请继续关注支持。  详情 回复 发表于 2017-6-14 09:59

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发表于 2017-6-14 09:34 | 只看该作者
这个活动好,强烈支持!评审意见多多益善!

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每天进步一点点,我们会持续每天更新,请继续关注支持。  详情 回复 发表于 2017-6-14 09:59
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