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求助:allegro 封装更新后原先的地孔网络属性变了?

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发表于 2017-2-8 11:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请教:allegro 封装更新后,原先的地孔网络属性变成了3.3V,怎么能保持这些孔的网络不变?. b: e0 e% ^2 R3 t4 V6 f0 S

: ^/ w, H1 ]# o( \4 q2 f+ }5 M8 P$ E
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) m1 J+ J' T& CUpdating dynamic shape (1 of 6) 3.3V, Boundary/Inner Layer 3 @ (198.0000 0.2000) ...
" w) R- H% B  Q+ I% LUpdating dynamic shape (2 of 6) Agnd, Boundary/Top @ (198.0000 0.2000) ...9 Q( t8 y0 a; `
Updating dynamic shape (3 of 6) Agnd, Boundary/Bottom @ (198.0000 0.2000) ...+ d$ s; B& ^1 ]9 I' p9 C
Updating dynamic shape (4 of 6) Agnd, Boundary/Inner Layer 2 @ (198.0000 0.2000) ...
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 楼主| 发表于 2017-2-8 14:08 | 只看该作者
没有人知道吗?其实就是怎么在重新铺铜的时候保持所有过孔的网络不变?

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发表于 2017-2-8 16:05 | 只看该作者
可以使用Logic——Net Logic 重新赋予PIN网络

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发表于 2017-2-8 18:30 | 只看该作者
不要打断 原来的连接 就不会变

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发表于 2017-2-23 11:08 来自手机 | 只看该作者
检查原理图封装是不是跟新的PCB 封装对不上了才导致管脚属性变了
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