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[Ansys仿真] siwave中的pin

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发表于 2016-2-24 16:29 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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做一个对比仿真的study,手动在siwave内画了简单的几条线,整个板子没有器件(当然也就没有pin了)9 H1 N& ]- r6 z5 r4 g% Z$ i( X0 _; p
但是像tdrwizard,signal net analyzer这样的分析却一定要pin& D/ H9 w' s( I' T; W4 n
这要怎么破?/ ?0 F3 l  a7 @2 s
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发表于 2016-2-24 16:48 | 只看该作者
下via,修改properties,定义成单独的pin就可以。
8 [- _; `5 Z3 W8 p9 \6 ^此via的padstacks定义成单面的焊盘即可。
+ R1 }0 @+ T$ x. @9 z
0 n( c/ B- N- i3 v$ _  @6 |
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发表于 2016-2-24 16:48 | 只看该作者
下via,修改properties,定义成单独的pin就可以。
. N9 d: {$ [4 `/ l; Q! V此via的padstacks定义成单面的焊盘即可。
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点评

谢谢cousins版主 另外,关于pin的类型,die类型的pin是连接到硅片上的,bga类的pin是连接到pcb上的,可以这样理解吗?  详情 回复 发表于 2016-2-24 17:37
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 楼主| 发表于 2016-2-24 17:37 | 只看该作者
cousins 发表于 2016-2-24 16:48
' q6 x7 x: L- l# J% U) \" k* b* K* V下via,修改properties,定义成单独的pin就可以。& v0 q" F+ G- m* ?2 R$ ?4 A- \
此via的padstacks定义成单面的焊盘即可。
  O" d' q. m( \5 k5 u9 I& C3 L1 O4 \' G
谢谢cousins版主 + C+ w$ N$ d4 {; r, c2 j1 E" W1 a
$ A# y- L; U% P* v6 c
另外,关于pin的类型,die类型的pin是连接到硅片上的,bga类的pin是连接到pcb上的,可以这样理解吗?$ c7 y2 f" b* U0 v+ b/ z

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发表于 2016-2-25 08:07 | 只看该作者
是的
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 楼主| 发表于 2016-2-25 11:06 | 只看该作者
% Z8 Y8 y: b1 ?" i+ h7 t
thx

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发表于 2016-4-4 21:45 | 只看该作者
请问我先画了Trace,然后再下Via,将Via改成Pin。这样可以做Single Net Analysis,但是仍然无法使用TDR,他还是显示这个Net没有两个Pin。请问这个问题怎么解决呢?

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那就两个via,做两个pin  详情 回复 发表于 2016-4-5 08:46

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发表于 2016-4-5 08:46 | 只看该作者
HolmesChang 发表于 2016-4-4 21:450 ]1 q+ Y( P! d  B! s
请问我先画了Trace,然后再下Via,将Via改成Pin。这样可以做Single Net Analysis,但是仍然无法使用TDR,他 ...

! p. j8 |5 W6 h7 O那就两个via,做两个pin+ R. t1 c( a; O6 d! [, x
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发表于 2016-4-7 00:31 | 只看该作者
我有做两个Via,设定成两个Pin,但是TDR没办法跑,不知道是什么问题。 SIwave 4.0好像也不用特别设定Pin,画好传输线就可以跑TDR了

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一个pin为激励,一个pin做terminal才能分析。 顺便说一下,新版做不了TDT有点渣渣。  详情 回复 发表于 2016-4-7 06:41

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发表于 2016-4-7 06:41 | 只看该作者
HolmesChang 发表于 2016-4-7 00:315 e- l2 s" j  I" P) W; L: Q3 Z
我有做两个Via,设定成两个Pin,但是TDR没办法跑,不知道是什么问题。 SIwave 4.0好像也不用特别设定Pin, ...
1 _9 o6 [; e8 Z: e% {: ~) X: p
一个pin为激励,一个pin做terminal才能分析。
; L, l6 W5 Y7 C4 E% l2 `顺便说一下,新版做不了TDT有点渣渣。  ?6 l4 J, @& }# t! }# O" W! Z
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