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求《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件

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发表于 2015-5-28 21:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问能提供《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件吗?我照着书本,还是完成不了。3 L+ c, N$ Y6 e# ~
比如:
( X( n2 W0 r# b5 k/ X4 |( z
! _8 u( a' b& K5 s/ D/ r
& q! n# s1 f& o. \
4.12节怎么摆放都有DRC;
6 n, J7 {* }% ]4.15调整不好交叉鼠线;( V, l1 q! b1 Q
....& P2 d0 S# I9 g) i: h
(可能我太笨了)
' A# u, t* ^7 l( s" a$ r/ O6 L" D+ d4 l' S
& W2 M4 I& B2 P+ h2 t$ ?
无法进行下一步,特请高人发布一下文件,谢谢!
; W3 q  f/ [" k9 S) e: U& h% @  {
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 楼主| 发表于 2015-5-29 10:33 | 只看该作者
4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?

点评

可以不用放置在die flag, 有位置就可以咯。  详情 回复 发表于 2015-7-22 16:55

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发表于 2015-7-22 16:53 | 只看该作者
DRC可能使DIE pin之间的间距小于你的约束值, 交叉鼠线存在不代表就不好呀,鼠线是直线路径显示,不要太在意。

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发表于 2015-7-22 16:55 | 只看该作者
jason1937 发表于 2015-5-29 10:33% G( i  p6 a( Z* y3 `5 d5 v0 {
4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?
7 H. c! L+ R0 Z# \- }
可以不用放置在die flag, 有位置就可以咯。
+ D# b0 y+ {, a# k4 Q2 b

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发表于 2016-5-9 23:44 | 只看该作者
同求

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每一小节的工程保存文件
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